数电实验5(寄存器).ppt

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1、下周实验：计数器请确认本次实验集成电路芯片：74112、两片、7474两片、74194的安插位置。周围插孔有没有堵塞。注意：不要在数电箱面板上写字！实验五寄存器5.1实验目的1、学习用集成JK触发器和集成D触发器组成并行输入、并行输出数据寄存器并测试其逻辑功能。2、测试中规模集成电路四位双向移位寄存器74LS194的功能。5.2实验内容及步骤5.2.1用集成JK触发器组成四位单端并行输入、并行输出数据寄存器并测试其逻辑功能（选做！）所用集成JK触发器为两片双JK下降沿触发器74LS112。（管脚图见图4-

2、6)所用集成JK触发器为两片双JK下降沿触发器74LS112。（管脚图见图4-6)6（1）按图5-1连好线路。①输出端Q1~Q4分别接状态显示二极管。（Q4在左，Q1在右）③输入端J1~J4分别接逻辑开关,（J4在左，J1在右）K1~K4接高电平。④CP1~CP4连在一起接单正脉冲。不得悬空！②复位端～连在一起接逻辑开关。1dR4dR11514133115974112-111514133115974112-2（1）清零（接一下低电平）。（2）从J1~J4分别输入待寄存数码。（3）CP端加单正脉冲，观察CP

3、作用前后，输出端Q1~Q4的状态，纪录于表5-1中。dR表5-1未加1100（清零）未加1100（不清零）加入加入加入未加0101Q4Q3Q2Q1CP脉冲J端状态5.2.2用集成D触发器组成四位单端并行输入、并行输出数据寄存器并测试其逻辑功能（1）按图5-2连线。所用D集成触发器为两片双D上降沿触发器74LS74。输入端D1~D4分别接逻辑开关，输入待寄存数码，其它同上。（2）CP端加单正脉冲，观察CP作用前后，输出端Q1~Q4的状态，纪录于表5-2中。表5-2加入未加加入未加Q4Q3Q2Q1CP脉冲D4

4、D3D2D101011100VCC：+5V、VSS：⊥rC：清零端，低电平有效。D3~D0：并行数据输入端。Q3~Q0：数据输出端。CP：时钟脉冲输入。SR：右移串行输入。SL：左移串行输入。S1、S0：工作模式选择。5.2.3测试四位双向移位寄存器74LS194的功能四位双向移位寄存器74LS194的管脚图如图5-3所示：（1）、S1、S0、SL、SR、D3~D0、分别接逻辑开关；Q3~Q0接状态显示二极管；CP接单正脉冲。（2）按表5-3所列输入状态，逐项观察并纪录输出端的状态，归纳总结其功能。rCX

5、XXXXX001XXXXX1011XXXXX1011XXXXX1011XXXXX1011XXXX0X101XXXX0X101XXXX1X101XXXX0X1011011XX111XXXXXXXXX0Q3Q2Q1Q0D3D2D1D0SRSLCPS0S1Cr功能总结并行输出并行输入串行输入时钟模式清零表5-3（3）观察循环移位寄存器的逻辑功能：①按图5-4接成四位右移循环移位寄存器。SR必须从逻辑开关上摘下来，接到Q0上。②（不做）③CP接连续脉冲，用示波器观察并对应记录CP和Q3~Q0的波形。（注意：必须重

6、新清0、置数（0100）、右移！）CPQ3(示波器双通道同时测量CP、Q3)Q2(示波器双通道同时测量Q3、Q2)Q1(示波器双通道同时测量Q2、Q1)Q0(示波器双通道同时测量Q1、Q0)