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时间:2020-11-28
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1、轻松学会DSP——第12章-工程设计讲座TMS320C542A/DA/DFILTERD/ACONTROLLEREPROMRAMFILTER/MUX一个典型DSPSOLUTION设计设计步骤算法分析和优化;DSP的选择;DSP最小系统设计;模拟电路接口;系统控制电路;软件编写和调试系统测试与验证设计要素:数字化要求模拟混合电路(ADC/DAC)设计处理需求(DSP运算量)吞吐量需求存储器需求(SRAM、ROOM、FLASH等)通信口需求其它控制(电源设计、状态控制、时钟控制、多DSP控制、......)(二)模数与数模转换1基带信号采样定理要想连续信号抽取后能够不失真地还原出原信号,则抽取频率必
2、须大于或等于两倍原信号频谱的最高频率。(Nyquist定理)2带通采样定理带通采样时采样频率不一定要满足Nyquist准则,带通采样的采样频率选择方法为:(1)fs>2f(BW)(2)fs=4fc/(2NZ-1)其中,NZ=1,2,3,…的最大整数。3量化与量化误差连续信号经量化处理要产生量化误差,对于均匀量化,量化误差的大小为:其中,E为FS电平,us为信号有效电平。对于FS正弦输入,量化误差为:4ADC/DAC的选择(1)ADC的种类:逐次比较ADC双线性ADCFLASHADC-ADC(2)ADC选择的标准:分辨率、速度、输入动态范围、POWER等(3)DAC的选择(4)滤波
3、器设计5、DSP与ADC/DAC的接口(1)对于串型ADC/DAC接口一般使用DSP的串口进行数据通信。如C25与11通道的12位ADCTLC2543的接口设计如下:(2)对于并型ADC/DAC接口一般使用DSP的I/O口进行数据通信。如DSP与12位ADCAD678的接口设计如下:(三)目标系统硬件设计1DSP的选择运算量价格外设需求管脚分布其他因素……2DSP配置DATA存储器大小PROGRAM存储器大小存储器速度要求I/O口配置……管脚注意事项外部中断不使用时拉高复位管脚有效的要求MP/MC管脚在启动时起作用HOLD和HOLDA的作用JTAG接口XF标志3、DSP基本系统设计与模数电路接
4、口BOOTLOADER设计扩展存储器设计时钟设计中断设计外设的使用电源管理其他…….1)系统时钟设计与控制CLKOUTVCCcrystaloscillatorGNDExternalClock3.3V电路的两种接法:内部振荡器外部晶振内部振荡器,实际是内部一个放大器;外部晶振,实际是有源晶振。两种时钟控制方式a、Hardware-programmablePLL(C541、C542、C543、C545&C546)b、Software-programmablePLL(C541B/C545A/C546A/C548/C549/C5402/C5410/C5420)由时钟模式寄存器控制(CLKMD):软件编
5、程控制时钟举例:(设置CLKOUT=CLKINx3)STM#0h,CLKMD;switchtoDIVmodeTstStatu:LDMCLKMD,AAND#01b,A;pollSTATUSbitBCTstStatu,ANEQSTM#0214fh,CLKMD;SetPLLON/OFFwhen;STATUSisDIVmode;PLLMUL=0010,PLLDIV=0;PLLCOUNT=00101000(41)4)、中断处理a、外部中断引脚连接b、修改中断向量表c、中断服务程序5)电源设计交流变直流在高频电路中学过,其过程如下。在通常的数字电路中,使用12V、5V作为基本的直流电源,其他直流电一般都是
6、通过这些电源加上DC-DC芯片产生。市电变压整流稳压滤波DSP的工作电压核心电源CVDD,根据型号不同,可以是2.5伏,也可以是1.8伏。供电对象是DSP内部所有设备,包括CPU,时钟和外设I/O口电压DVDD3.3伏。高级的芯片都是3.3伏,因为这样可以减少芯片的功耗和体积。但是,5伏器件价格更便宜,购买更方便。供电对象只是管脚。电路设计通过5伏电压的分压,缺点是不够稳定使用专用电源芯片,实际就是DC-DC芯片,如:单电源输出TPS7333,TPS7133双电源输出TPS73HD318凡是DSP的DVCC和CVCC管脚,都应该加上旁路电容10u,0.1u具体电路参考数据手册6)JTAG电路设
7、计JTAG的基本概念JTAG是JOINTTESTACTIONGROUP的缩写。这个组织设计了一种基于边界扫描的接口,用于集成电路芯片的测试,协议为IEEE1149.1。芯片执照商设计芯片时,需要遵循这样的协议,从而建立一个JTAG接口。通过这个接口,可向芯片发送数据,进行调试。边界扫描结构结构上,他包括三个部分,软件部分,硬件部分,目标设备。结合DSP,软件是CCS,硬件是仿真器,目标设备是PCB
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