组成原理练习题.doc

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1、一、选择题1某SRAM芯片，存储容量为64K×16位，该芯片的地址线和数据线数目为______。A64，16B16，64C64，8D16，16。2交叉存贮器实质上是一种______存贮器，它能_____执行______独立的读写操作。A模块式，并行，多个B模块式串行，多个C整体式，并行，一个D整体式，串行，多个3用某个寄存器中操作数的寻址方式称为______寻址。A直接B间接C寄存器直接D寄存器间接4完整的计算机应包括______。A运算器、存储器、控制器；B外部设备和主机；C主机和实用程序；D配套的硬件设备和软件系统5某机字长32位，存储容量为1

2、MB，若按字编址，它的寻址范围是______。A0—1MB0—512KBC0—256KD0—256KB6寻址方式中，设A为通用寄存器，SP为堆栈指示器，MSP为SP指示器的栈顶单元，如果操作的动作是：（A）→MSP，（SP）-1→SP，那么出栈的动作应是______。A（MSP）→A，（SP）+1→SP；B（SP）+1→SP，（MSP）→A；C（SP）-1→SP，（MSP）→A；D（MSP）→A，（SP）-1→SP；7指令周期是指______。ACPU从主存取出一条指令的时间；BCPU执行一条指令的时间；CCPU从主存取出一条指令加上CPU执行这条

3、指令的时间；D时钟周期时间；8在______的微型计算机系统中，外设可和主存贮器单元统一编址，因此可以不使用I/O指令。A单总线B双总线C三总线D多总线9在机器数______中，零的表示形式是唯一的。A原码B补码C移码D反码10在定点二进制运算器中，减法运算一般通过______来实现。A原码运算的二进制减法器B补码运算的二进制减法器C原码运算的十进制加法器D补码运算的二进制加法器11某计算机字长32位，其存储容量为4MB，若按半字编址，它的寻址范围是______。A0—4MBB0—2MBC0—2MD0—1M12主存贮器和CPU之间增加cache的目

4、的是______。A解决CPU和主存之间的速度匹配问题B扩大主存贮器容量C扩大CPU中通用寄存器的数量D既扩大主存贮器容量，又扩大CPU中通用寄存器的数量13假定下列字符码中有奇偶校验位，但没有数据错误，采用偶校校验的字符码是______。ABCD14按其数据流的传递过程和控制节拍来看，阵列乘法器可认为是______。A全串行运算的乘法器B全并行运算的乘法器C串—并行运算的乘法器D并—串型运算的乘法器15双端口存储器在______情况下会发生读/写冲突。A左端口与右端口的地址码不同B左端口与右端口的地址码相同C左端口与右端口的数据码相同D左端口与右

5、端口的数据码不同16程序控制类指令的功能是______。A进行算术运算和逻辑运算B进行主存与CPU之间的数据传送C进行CPU和I/O设备之间的数据传送D改变程序执行顺序17由于CPU内部的操作速度较快，而CPU访问一次主存所花的时间较长，因此机器周期通常用______来规定。A主存中读取一个指令字的最短时间B主存中读取一个数据字的最长时间C主存中写入一个数据字的平均时间D主存中读取一个数据字的平均时间18系统总线中控制线的功能是______。A提供主存、I/O接口设备的控制信号响应信号B提供数据信息C提供时序信号D提供主存、I/O接口设备的响应信号

6、19某SARM芯片，其存储容量为64K×16位，该芯片的地址线数目和数据线数目分别是___。A.64,16B16,64,C64,8D16,1620以下四种类型指令中，执行时间最长的是___。A.RR型指令B.RS型指令C.SS型指令D.程序控制指令21在下面描述的RISC指令系统基本概念中不正确的表述是___。A.选取使用频率低的一些复杂指令，指令条数多。B.指令长度固定C.指令格式种类多D.只有取数/存数指令访问存储器22多总线结构的计算机系统，采用___方法，对提高系统的吞吐率最有效。A.双端口存储器B.提高主存速度C.交叉编址多模块存储器D.

7、cache23、定点8位字长的字，采用2的补码形式表示时，一个字所表示的整数范围是___。A.–128—+127B.-127—+127C.-129—+128D.-128—+12824运算器虽有许多部件组成，但核心部分是___。A.数据总线B.算术逻辑单元C.多路开关D.通用寄存器25某寄存器中的值有时是地址，因此只有计算机的______才能识别它。A译码器B判断程序C指令D时序信号26以下四种类型的半导体存储器中，以传输同样多的字为比较条件，则读出数据传输率最高的是______。ADRAMBSRAMC闪速存储器DEPROM27指令的寻址方式有顺序和

8、跳跃两种方式，采用跳跃寻址方式，可以实现______。A堆栈寻址；B程序的条件转移；C程序的无条件转移；D程序的条件转移或