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1、第四章触发器4.1概述4.2RS触发器4.3JK触发器4.4D触发器、其他触发器4.5触发器的相互转换4.1概述能够存储1位二进制型号的基本电路单元称为触发器按功能分类RS触发器JK触发器D触发器T触发器T’触发器按结构分类基本RS触发器同步RS触发器主从RS/JK触发器边沿触发器触发器是构成时序逻辑电路的基本逻辑部件。它有两个稳定的状态：0状态和1状态；在不同的输入情况下，它可以被置成0状态或1状态；当输入信号消失后，所置成的状态能够保持不变。由于存在记忆（存储），触发器的输出（状态）具有时间性，我们把分析问题时立足点的输出状态称为现态，而把下一个时间点时的输出状态称为次态。t
2、ABCD4.2RS触发器开始基本RS同步RS主从RS实例电路结构工作原理特性表次态卡诺图波形图状态转换图动作特点符号说明立即置数与复位.1基本RSQ和Q是触发器的输出端触发器的0状态触发器的1状态假设现在的触发器状态为0状态(现态)1)当RD=0,SD=1时,将得到一个新的触发器状态(次态)1状态一.基本RS触发器电路结构与工作原理实际上,无论现态是0状态还是1状态,只要RD=1,SD=0,次态就是0状态;RD=0,SD=1,次态就是1状态。所以,RD叫做复位输入端,也叫置0端，SD叫做置位输入端,也叫置1端。例如现态为0状态,且RD=1SD=0时，次态仍为0状态。显然,现态和次态相同
3、,也就是状态没有改变为了区分现态和次态,规定:2)接着,当RD=1,SD=0时,也将得到一个新的状态(次态)0状态表示现态表示次态此例中保持不变3)RD=SD=0时,不管现态是0状态还是1状态,次态都保持原状,即:4)当RD=SD=1时,不管现态是0状态或是1状态,输出为:非法状态因此RD=SD=1是不允许输入的信号,即有输入约束条件:RDSD=0总结得到基本RS触发器的真值表:状态变量（输入）状态输出设：RDSD说明0000不变0011不变0101同SD0111同SD1000同SD1010同SD110不定非法111不定非法基本RS触发器的特性表RDSD说明000不定非法001不定非法
4、0100同SD0110同SD1001同SD1011同SD1100不变1111不变与非门组成的基本RS触发器的特性表与非门组成的基本RS触发器次态卡诺图X11X10001111001QnRDSDQn+1次态方程约束条件考虑约束条件时：二.基本RS触发器的动作特点RD和SD是直接加在输出门上,在输入信号的作用时间内,都能直接改变输出状态。例如,输入信号如图,看看输出信号情况:SDRDQQ.2同步RS触发器CP是同步信号，叫做时钟脉冲信号，简称时钟信号或时钟。当CP=0时，两个输入与门被封锁，触发器的状态不变；当CP=1时，两个输入与门被打开，触发器的状态由RS决定。当第一个CP=1时决定的
5、触发器状态，只有到下一个CP=1到来时才有可能改变一电路结构例如输入信号如图CPSRQQ同步RS触发器的特性表RS说明0000不变0011不变0101同S0111同S1000同S1010同S110不定非法111不定非法CP111111110XX不变X约束条件：RS=0带异步置位、复位端的同步RS触发器 （a）电路结构（b）图形符号注意图形符号显然，RDSD都不受同步信号的控制所以，称SDRD为异步置位复位端。当SD或RD有效时（输入低电平）输出立即被置位或复位。RDSD不能同时有效。为了设置触发器的初态，有时还增加两个输入信号：SD和RD，如图二同步RS的动作特点时钟电平控制。当CP=
6、0时,触发器的状态不受RS的直接控制,RS的变化不能改变触发器的输出状态;当CP=1时,RS的变化直接影响Q,且RS变化多少次,Q相应地变化多少次。即：多次变化现象.R、S之间有约束。不能允许出现R和S同时为1的情况，否则会使触发器处于不确定的状态。CPQRSCP=0时最后留下的状态是由最后一个不等于00的RS决定.3主从触发器——RS、JK一主从RS触发器的结构及工作原理1）当CP=1，主触发器打开，从触发器被封锁主触发器输出由RS决定从触发器输出保持原状整个触发器的输出状态保持不变2）当CP从1变到0的时刻，主触发器被封锁，从触发器被打开,主触发器的输出保持了CP=1时由RS决定的
7、最后状态，且在整个CP=0期间主触发器的输出保持不变；从触发器的输出由主触发器的输出决定，则从触发器的输出在整个CP=0期间保持不变。所以，整个触发器的输出变化只发生在CP信号的下降沿下降沿时钟CP主从RS触发器的特性表CPSRQ’QQ’QCPSR说明X不变X00不0011变00000110同0101S1011100不定非111不定法11CP回到低电平后输出状态不定波形图（时序图）1主从RS触发器采用主从控制结构，从根本上解决了输入信号直接控制
