LED动态扫描驱动ppt课件.ppt

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1、VerilogHDL硬件描述语言第三讲长江大学电信学院7/29/20211第二讲回顾1、什么是状态机2、一个实例—简单的状态机（8状态）3、实验硬件平台4、硬件框图5、软件框图6、用verilog语言实现状态机（重点）7/29/20212本节课计划：1、分析具体实例—LED动态扫描驱动2、演示设计效果。3、分析语言。4、以解决具体问题为导向进行学习。7/29/20213LED动态扫描驱动实例1、LED动态扫描的原理2、一个实例—LED动态扫描（8位）3、实验硬件平台4、硬件框图5、软件框图6、用verilog语言实现LED动态扫描（重点）7/29/20

2、214使用LED显示器时，要注意区分这两种不同的接法。为了显示数字或字符，必须对数字或字符进行编码。七段数码管加上一个小数点，共计8段。因此为LED显示器提供的编码正好是一个字节。共阴极共阳极1、LED动态扫描的原理7/29/20215LED数码显示方式及电路静态显示方式LED显示器工作方式有两种：静态显示方式和动态显示方式。静态显示的特点是每个数码管的段选必须接一个8位数据线来保持显示的字形码。当送入一次字形码后，显示字形可一直保持，直到送入新字形码为止。这种方法的优点是占用CPU时间少，显示便于监测和控制。缺点是硬件电路比较复杂，成本较高。7/29

3、/20216动态显示动态显示的特点是将所有位数码管的段选线并联在一起，由位选线控制是哪一位数码管有效。选亮数码管采用动态扫描显示。所谓动态扫描显示即轮流向各位数码管送出字形码和相应的位选，利用发光管的余辉和人眼视觉暂留作用，使人的感觉好像各位数码管同时都在显示。动态显示的亮度比静态显示要差一些，所以在选择限流电阻时应略小于静态显示电路中的。7/29/202171、LED动态扫描的原理7/29/202187/29/202192、一个实例—LED动态扫描（8位）1.利用动态扫描方法在八位数码管上显示出稳定的76543210.2.用动态扫描方法和定时器1在数

4、码管的前三位显示出秒表，精确到1%秒，即后两位显示1%秒，一直循环下去。7/29/2021103、实验硬件平台7/29/2021114、硬件框图FPGALED详细图片加驱动电路板书（略）7/29/2021124、硬件框图1、FPGA的外围电路2、LED数码管的结构（8段数码管）3、FPGA与LED直接连接（利弊）4、FPGA与LED之间采用简单驱动连接。（段码通常采用74LS573,位选通常采用74LS04，或者三极管）7/29/2021134、LED动态扫描的原理图7/29/2021144、LED动态扫描的原理图7/29/2021155、软件框图并行

5、模块1：LED动态扫描，使能信号en[7：0]同一时间，只有1位为低电平0，其余7位为高电平1，且低电平0在8位使能信号间轮流赋值。LED0--LED1--LED2--LED3--LED4--LED5--LED6-LED7--LED0并行模块2：对应于每个确定的位，赋值固定的数据。LED0：0LED1：1LED2：2LED3：3LED4：4LED5：5LED6：6LED7：7并行模块3：译码表；对应于每个固定的数据，有一个对应的译码。0：8‘b0000_00111：8’b1001_1111………7/29/2021166、用verilog语言实现LED动

6、态扫描（重点）1、VerilogHDL设计流程2、模块的输入输出端口3、条件判断语句4、程序中的数据表达方式5、功能仿真6、举一反三7/29/2021171、VerilogHDL设计流程自顶向下(Top-Down)设计7/29/2021182、模块的输入输出端口moduleseg71(clk,rst,dataout,en);;//定义模块名inputclk,rst;output[7:0]dataout;output[7:0]en;//COM使能输出reg[7:0]dataout;//各段数据输出reg[7:0]en;reg[15:0]cnt_scan;

7、//扫描频率计数器reg[4:0]dataout_buf;………………//定义模块功能endmodule7/29/2021193、条件判断语句----case语句case语句是一种多分支选择语句.case(敏感表达式）分支表达式1：语句1；分支表达式2：语句2；……分支表达式n：语句n；default:语句n+1;endcase7/29/202120case语句case括弧内的表达式称为控制表达式（也称为敏感表达式），case分支项中的表达式称为分支表达式。控制表达式通常表示为控制信号的某些位，分支表达式则用这些控制信号的具体状态值来表示：

8、分支表达式是常量表达式。case语句的行为如同一个嵌套的if语句。当控制表达式的值与分支表达式