组合逻辑电路作业key.doc

《组合逻辑电路作业key.doc》由会员上传分享，免费在线阅读，更多相关内容在教育资源-天天文库。

1、数字电路基础——组合逻辑电路习题班级:学号:姓名:一、单项选择题(10小题)(1)若在编码器中有50个编码对象，则要求输出二进制代码位数为（   ）位。 A、5       B、6        C、10     D、50(2)在下列逻辑电路中，不是组合逻辑电路的有A、译码器     B、编码器     C、全加器    D、寄存器(3)用四选一数据选择器实现函数，应使。A、D0=D2=0，D1=D3=1     B、D0=D2=1，D1=D3=0C、D0=D1=0，D2=D3=1     D、D0=D1=1，D2=D3=0(4)当编码器74LS147的输入端I1、I5、I6、I

2、7为低电平，其余输入端为高电平时，输出信号为。A、1110        B、1010            C、1001                D、1000(5)A、B为逻辑门的2个端入端，Y为输出。A、B和Y的波形如图所示，则该门电路执行的是（   ）逻辑操作。A、与    B、与非    C、或   D、或非(6)图为双四选一数据选择器构成的组合逻辑电路，输入变量为A、B、C，输出逻辑函数为F1、F2，其功能为（   ）。A、F1=∑m(1,2,4,7)，F2=∑m(3，5，6，7)， 全加器B、F1=∑m(1,2,4,7)，F2=∑m（1，3，6，7），全减器C、

3、F1=∑m(1,2,4,7)，F2=∑m(4，5，6，7)， 全加器D、F1=∑m(1,2,3,7)，F2=∑m（3，5，6，7），全减器 (7)八路数据分配器，其地址输入端有（   ）个。A、1 B、2 C、3 D、4(8)用四选一数据选择器实现函数应使。A、B、C、(9)图的4个逻辑图中不是“异或”逻辑关系的1项是（    ）。(10)选出与图所示逻辑图对应的逻辑关系式。A、Y=A+B+   B、Y=AB+C、Y=（A+）（+B）        D、Y=B+A=====答案=====(1)B(2)C(3)A(4)D(5)A(6)A(7)C(8)C(9)C(10)D二、多项选择

4、题(5小题)(1)用三线-八线译码器74LS138实现原码输出的8路数据分配器，应。A、=1，=D，=0    B、=1，=D，=DC、=1，=0，=D    D、=D，=0，=0(2)一个8选1数据选择器的数据输入端有（   ）个，地址输入端有（   ）个。A、1     B、2       C、3     D、4    E、8(3)组合逻辑电路消除竞争冒险的方法有A、修改逻辑设计     B、在输出端接入滤波电容C、后级加缓冲电路   D、屏蔽输入信号的尖峰干扰(4)以下电路中，加以适当辅助门电路，（   ）适于实现单输出组合逻辑电路。A、二进制译码器   B、数据选择器  

5、  C、数值比较器   D、七段显示译码器(5)函数，当变量的取值为（   ）时，将出现冒险现象。A、B=C=1   B、B=C=0   C、A=1，C=0   D、A=0，B=0=====答案=====(1)ABC(2)EC(3)AB(4)AB(5)AD三、判断题(9小题)(1)二进制译码器相当于是一个最小项发生器，便于实现组合逻辑电路。（   ）(2)液晶显示器的优点是功耗极小、工作电压低。（   ）(3)液晶显示器可以在完全黑暗的工作环境中使用。（   ）(4)共阴接法发光二极管数码显示器需选用有效输出为高电平的七段显示译码器来驱动。（   ）(5)组合逻辑电路中产生竞争冒

6、险的主要原因是输入信号受到尖峰干扰。（   ）(6)组合逻辑电路任意时刻的稳态输出，与输入信号作用前电路原来状态有关。（   ）(7)在二-十进制译码器中，伪码应做约束项处理(   )。(8)编码器在任何时刻只能对一个输入信号进行编码(   )。(9)数据选择器和数据分配器的功能正好相反，互为逆过程(   )。=====答案=====(1)对(2)对(3)错(4)对(5)错(6)错(7)对(8)对(9)对四、填空题(3小题)(1)半导体数码显示器的内部接法有两种形式：共（     ）接法和共（    ）接法。(2)对于共阳接法的发光二极管数码显示器，应采用（       ）电平驱

7、动的七段显示译码器。(3)消除竟争冒险的方法有（       ）、（       ）、（       ）等。=====答案=====(1)阴 阳(2)低电平(3)修改逻辑设计 接入滤波电容  加选通脉冲四、解答题(10小题)(1)化简如图所示电路，并分析其功能。(2)分析如图所示的逻辑电路，做出真值表，说明其逻辑功能 (3)画出用两片4线-16线译码器74LS154组成5线-32线译码的接线图。图是74LS154的逻辑框图，图中、是两个控制端（亦称片选端）译码器工作时应使、同时为