数字逻辑电路基础ppt课件.ppt

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1、4.4单元级组合逻辑电路的设计和分析方法以模块化的组合逻辑单元电路为主构成的组合逻辑电路称为单元级组合逻辑电路。①进行逻辑抽象，列出逻辑真值表。②根据真值表，写出相应的逻辑函数表达式。③将逻辑函数表达式变换为适当的形式，以满足组合逻辑单元电路芯片的输入、输出要求。④根据变换的逻辑函数表达式画出逻辑电路连接图。（切记：组合逻辑单元电路的附加控制端的连接！）一、单元级组合逻辑电路的设计方法分析过程一般按下列步骤进行：逻辑图③②①④实际逻辑问题真值表逻辑表达式适当的逻辑表达式变换2021/10/611.用译

2、码器设计组合逻辑电路①写出函数的标准与或表达式（最小项之和），并变换为与非-与非形式；②画出用二进制译码器和与非门实现这些函数的接线图。n线—2n线译码器有2n个代码组合，包含了n变量函数的全部最小项。当译码器的使能端有效时，每个输出（一般为低电平输出）对应相应的最小项,即。因此只要将函数的输入变量加至译码器的地址输入端，并在输出端辅以少量的门电路，便可以实现逻辑函数。一般步骤：2021/10/62例：试利用3线－8线译码器74LS138设计一个多输出的组合逻辑电路。输出的逻辑函数式为：解：①最小项之和形式②

3、化为与非－与非式2021/10/63③画逻辑电路2021/10/64例：试利用3线－8线译码器产生一组多输出逻辑函数。解：当S=1时，3线—8线译码器各输出端的函数式为：①将Z1～Z4化为最小项之和的形式：2021/10/65②经转换得：Z1=m3m4m5m6Z2=m1m3m7Z3=m3m4m5m6m7Z4=m0m2m4m7③画逻辑图2021/10/662.用数据选择器设计组合逻辑电路因为任何组合逻辑函数总可以用最小项之和的标准形式构成。所以，利用数据选择器的输入Di来选择地址变量组成的最小项mi，可以实现任

4、何所需的组合逻辑函数。如果一个MUX的地址变量个数为n，则对这个2n选1的MUX的输出具有标准与或表达式的形式。若组合逻辑函数的输入变量为K个，MUX的地址变量为n个，则有三种情况：K＝n、K>n、Kn（K＝n+1）例：试用4选1数据选择器74LS153实现如下逻辑函数的组合逻辑电路。解：逻辑函数变形为

5、最小项之和形式比较可得：当A1A0＝AB时，D0=C，D1=1，D2=C，D3=1选地址A1A0=AB2021/10/69练习：试用4选1数据选择器74LS153实现如下逻辑函数的组合逻辑电路。2021/10/610③K

6、83构成4位减法器。解：设被减数为A3A2A1A0，减数为B3B2B1B0。由二进制运算法则可知，A3A2A1A0减去B3B2B1B0等于A3A2A1A0加上B3B2B1B0的补码。而补码等于反码加1。故B3B2B1B0的补码可以利用非门求B3B2B1B0的反码，利用低位进位输入端CI接1实现B3B2B1B0的反码加1。2021/10/612例：设计一个能将BCD代码转换为余3代码的代码转换器。解：列出代码转换电路的逻辑真值表：可得：Y3Y2Y1Y0=DCBA+00112021/10/613二、单元级组合逻辑

7、电路的分析方法1.以译码器、数据选择器为核心的组合逻辑电路①写出逻辑表达式；②列出真值表；③分析电路的逻辑功能。2.以优先编码器、超前进位加法器、数值比较器为核心的组合逻辑电路①列出逻辑真值表；②分析电路的逻辑功能。2021/10/614例：分析下图电路的逻辑功能。解：①逻辑表达式2021/10/615②逻辑真值表2021/10/616例：分析下图电路的逻辑功能。解：①逻辑表达式2021/10/617②逻辑真值表③功能分析此电路是1位加法器。A是低位的进位CI，B、C是两个加数，Y1为加法器的和S，

8、Y2为加法器向高位的进位CO。2021/10/618例：分析下图电路的逻辑功能。4位加法器4位数值比较器2021/10/619解：①逻辑真值表②分析：当D3～D0≤9时，Y（A>B）＝0，Y3～Y0等于D3～D0，即为十进制数的0～9；当D3～D0＞9时，Y（A>B）＝1，则加法器将D3～D0加上6，Y3～Y0就等于调整后的十进制数的个位，同时CO＝1表示十进制数的十位。③结论：此电路是将4位二进制