MAXPLUS-II开发软件简介.doc

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1、MAXPLUSⅡ设计环境MAX+plusII界面友好，使用便捷，被誉为业界最易用易学的EDA软件。MAX+plusII支持原理图、VHDL和Verilog语言文本文件，以及波形与EDIF等格式的文件作为设计输入，并支持这些文件的任意混合设计。MAX+plusII具有门级仿真器，可以进行功能仿真和时序仿真，能够产生精确的仿真结果。在适配之后，MAX+plusII生成供时序仿真用的EDIF、VHDL和Verilog三种不同格式的网表文件。MAX+plusII支持主流的第三方EDA工具，如Synopsys、Cadence、Synplicity、Mentor、Viewlogic、E

2、xemplar和ModelTechnology等。MAX+plusII支持除APEX20K系列之外的所有AlteraFPGA/CPLD大规模逻辑器件。图1MAX+plusII的管理器窗口MAX+plusII的管理器窗口可以对MAX+plusII的所有功能进行管理和控制。图2MAX+plusII的图形编辑器MAX+plusII图形编辑器(GraphicEditor)是一个国标选取模式的程序,可快速建立简单或复杂的设计。完成的文件格式为*.gdf，也可读入OrCAD*.sch。图3MAX+plusII的HDL文本编辑器MAX+plusII的HDL文本编辑器是很有弹性的工具，提供

3、多种硬件描述语言的文字编辑与合成的环境。其中包括有：1、AlteraHardwareDescriptionLanguage(AHDL)2、VeryHighIntegratedCircuitHardwareDescriptionLanguage(VHDL)3、VerilogHardwareDescriptionLanguage(VeriligHDL)以AHDL语法编写的文件格式为*.tdf，以VHDL语法编写的文件格式则为*.vhd，而以VerilogHDL语法编写的文件格式则为*.v。可以设计程序创建一个符号文件供图形编辑器使用。图4MAX+plusII的波形编辑器MAX+

4、plusII的波形编辑器是个可做多方面应用的编辑器：一方面可用来设计电路，其文件格式为*.wdf,另一方面则可以用来观察或输入仿真时的波形，文件格式为*.scf。图5MAX+plusII的符号编辑器MAX+plusII的符号编辑器可用来观看逻辑电路的符号，也可以编辑或创建符号文件，文件的格式为*.sym。可由电路图编辑器中选取符号文件以图形模式编辑。图6MAX+plusII的编译器窗口MAX+plusII的编译功能是将电路设计文件转换成编程下载用的输出文件，包括*.pof文件与*.sof文件。编译成功后还会产生一些文件名相同但扩展名不同的文件，如*.cnf文件、*.rpt文

5、件与*.snf文件。设计的程序必须经过编译后才可以进行时序分析、仿真与下载。图7MAX+plusII的主菜单MAX+plusII的主菜单用于启动各种应用功能，并在各种应用功能间切换。图8MAX+plusII的新建文件MAX+plusII的新建文件中包括4种类型，图形编辑文件（GraphicEditorfile）、符号编辑文件（SymbolEditorfile）、文本编辑文件（TextEditorfile）和波形编辑文件（WaveformEditorfile）。图9MAX+plusII的仿真器界面MAX+plusII的仿真功能非常强大，能够测试显现出所设计电路的逻辑与时序，故

6、利用此仿真功能可以验证电路的正确性，并可以找出错误的原因。图10MAX+plusII的时序分析器界面MAX+plusII的时序分析功能可用来分析设计编译后合成的性质。将电路设计文件转换成下载用的输出文件，例如*.pof文件与*.sof文件。借助时间分析的功能可达到最佳的布局规划，从而加快所设计器件的的处理速度，时序分析器包括延时矩阵分析、建立和保持时间分析以及寄存器性能分析。图11MAX+plusII的底层图编辑器界面MAX+plusII的底层图编辑器，也可以称为引脚平面编辑器，此功能可以如同在实际器件配线般的配置电路输入和输出引脚，也可观看和修改编译后计算机自动配线的结果

7、。另外，利用底层图编辑器可以很直观地进行器件管脚锁定。在MAX+plusII的底层图编辑器视图上双击左键来改变一下观察模式，包含Deviceview和LABview两种模式，同样可以在菜单下选择。图11为LABview模式，图12为Deviceview模式。图12MAX+plusII的底层图编辑器Deviceview模式MAX+plusII的编程器的功能是将电路设计文件转换后的输出文件，例如*.pof文件与*.sof文件，烧写至FLEX系列器件或下载至MAX系列器件，亦可用来检验与测试器件或转换烧写文件格式。此功能