模拟集成电路版图设计与验证.doc

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1、电子科技大学微电子与固体电子学院标准实验报告（实验）课程名称模拟集成电路原理电子科技大学教务处制表电子科技大学实验报告学生姓名：学号：指导教师：实验地点：211-606实验时间：2011-06-14一、实验室名称：微电子技术实验室二、实验项目名称：模拟集成电路版图设计与验证三、实验学时：4四、实验原理2.2基于Cadence平台的电路设计与仿真2.2.1Cadence环境的调入1、在UNIX操作系统的Terminal窗口下→setenvDISPLAY100.100.21:0(注意：100.100.100.21是本机的IP地址，不同的计算机，IP地址不同，应该根据实际

2、的IP地址来设置。)→cduser/userxxx→mkdiruser/userxxx/Project→cduser/userxxx/Project→icfb&或者layoutPlus&2、出现CIW(commandInterpreterwindow)命令解释画面3、点选在CIW窗口的上面工具列Tools→LibraryManager，会出现LM窗口LM(LibraryManager)2.2.2建立新的Library1.点选LM窗口上面的工具列File→New→Library2.会产生NewLibrary画面3.出现右图画面在name填上Library名称点选下面的

3、OK4、出现LoadTechnologyFile窗口，添加工艺文件2.2.3版图设计LayoutViewDesign1、在LM窗口用鼠标左键点选Library的hw1→再点选cell的test→双击view的layout两次，或是用右键open,即可开启layout窗口2、调入版图编辑器LayoutEditor因为前面的工艺文件已设置，所以版图层选择窗口LSW应该是看到以上的画面。如果不是的话，则有可能是createlibrary时technologyfile没有设置对，需要重新配置3、Layout的基本操作（1）设定窗口的点距(Grid)，点选Layout窗口上面

4、的指令选项Option→Display（2）设定是否有Gravity的功能，点选Layout窗口的指令列Options→LayoutEditor，依照个人使用习惯与需要来选择是否GravityOn.。一般对于初学者不要设定GravityOn(重力效果)。GravityOn：当鼠标指针靠近对象时即被吸到该对象的边缘（3）用ruler把长度量好,用右键点选LSW中所要用的layer,再点选常用功能栏中的rectangular或polygon来画。（4）如果边长要纠正的话,可使用stretch来达成,或者是用reshape功能。（5）若要取消指令重选新指令，最好先按Esc

5、键。（6）Layout时要注意layers之间的距离(参考designrule)。（7）一段时间后应点选Layout上面的指令Design→Save做储存动作，以免意外掉电、误操作等导致已做的工作丢失。（8）用本层来定义当前层所对应的端点名称，每当打上label时，记得要点选该label，然后按q,改变该label的layer成当前所用层。4、NMOS和PMOS晶体管的Layout版图示2.3版图验证1、设计规则DRC检查与验证当版图绘制完成后，需要调用版图设计规则检查DRC来验证是否违反设计规则。（1）点选Layout窗口上面的指令Verify→DRC（2）出现D

6、RC窗口（3）按OK之后，会开始跑DRC，若有错误，CIW对话框会显示错误并且在Layout窗口也会有光标marker闪烁。（4）可以点选Layout窗口上面的指令Verify→Makers→Explain，然后选择Layout窗口中闪动线条，即可知所犯的错误（5）若要消除在Layout窗口闪烁的marker，点选Layout窗口上面的指令Verify→Markers→deleteall，出现下面窗口，再点选OK即可。2、根据与DRC验证类似的步骤进行版图的电气规则ERC检查。注意：如整个版图由多个分图合成，则合并版图后，即使单个的分图均通过DRC/ERC验证，也必

7、须再次进行DRC/ERC检查，往往拼接过程中会引入新的错误。五、实验目的·根据实验任务要求，综合运用课程所学知识自主完成相应的模拟集成电路版图设计，掌握基本的IC版图布局布线技巧。·学习并掌握国际流行的EDA仿真软件Cadence的使用方法，并进行版图的的设计与验证。六、实验内容1、UNIX操作系统常用命令的使用，CadenceEDA仿真环境的调用。2、根据设计指标要求，自主完成版图设计，并掌握布局布线的基本技巧。3、对所绘制的版图进行DRC、ERC检查验证。4、整理版图生成文件，总结、撰写并提交实验报告。七、实验仪器与器材（1）工作站或微机终端一台（2）局域网