Verilog编写的8-3编码器电路代码.doc

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1、Verilog编写的8－3编码器电路代码/*******************************************************************************CIRCUIT:aencoder8-3circuit*******************************************************************************moduletop(IN,//inputOUT);//outputparameterWL=16;input[7:0]IN;

2、output[2:0]OUT;reg[2:0]OUT;//gettheOUTalways@(IN)begincase(IN)8'b0000_0001:OUT=3'b000;8'b0000_0010:OUT=3'b001;8'b0000_0100:OUT=3'b010;8'b0000_1000:OUT=3'b011;8'b0001_0000:OUT=3'b100;8'b0010_0000:OUT=3'b101;8'b0100_0000:OUT=3'b110;8'b1000_0000:OUT=3'b111;//thedefault

3、caseshouldnotoccurdefault:OUT=3'b000;endcaseendendmodule//endmoduletop