编码器和译码器课件.ppt

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1、常用组合逻辑电路--编码器和译码器编码器的概念与类型编码将具有特定含义的信息编成相应二进制代码的过程。实现编码功能的电路编码器二进制编码器二-十进制编码器优先编码器编码器(即Encoder)被编信号二进制代码编码器常用组合逻辑电路--编码器二进制编码器（8421编码）3位二进制编码器有8个输入端，3个输出端，所以常称为8线—3线编码器，其功能真值表见右表：（输入为高电平有效）用门电路实现逻辑电路：I1I2I3I4I5I6I7Y0Y1Y2I8I9Y38421BCD码编码器二－十进制编码器I0省略不画输出4位二进制代码

2、原码输出10011000000000000101000000001110001000000001100001000000101000001000000010000001000011000000001000010000000001001000000000001000000000000001Y0Y1Y2Y3I9I8I7I6I5I4I3I2I1I0输　出输　　　　入被编信号高电平有效将0~9十个十进制数转换为二进制代码的电路。又称十进制编码器。允许同时输入两个以上信号，并按优先级输出一般数大优先集成优先编码器举例——7

3、4LS148（8线-3线）优先编码器注意：该电路为反码输出。EI为使能输入端(低电平有效)，EO为使能输出端(高电平有效)，GS为优先编码工作标志(低电平有效)。集成优先编码器举例——74LS148（8线-3线）注意：该电路为反码输出。EI为使能输入端(低电平有效)，EO为使能输出端(低电平有效)，GS为优先编码工作标志(低电平有效)。CT74LS147I8I1I2I3I4I5I6I7Y0Y1Y2Y3I9二-十进制优先编码器CT74LS147I9=1，I8=0时，不论I0~I7为0还是1，电路只对I8进行编码，输出

4、反码0111。反码输出被编信号输入，(省略了I0)，低电平有效。0111111111110101111111110×00111111110××1101111110×××010111110××××10011110×××××0001110××××××111010×××××××01100××××××××1111111111111Y0Y1Y2Y3I9I8I7I6I5I4I3I2I1输　出输　　　入I9=0时，不论其他Ii为0还是1，电路只对I9进行编码，输出Y3Y2Y1Y0=0110，为反码，其原码为1001。111010

5、×××××××01100××××××××1111111111111无编码请求Y3Y2Y1Y0=1111依次类推CT74LS147I8I1I2I3I4I5I6I7Y0Y1Y2Y3I9被编信号优先级别从高到低依次为I9、I8、I7、I6、I5、I4、I3、I2、I1、I0。译码是编码的逆过程。将表示特定意义信息的二进制代码翻译出来。实现译码功能的电路译码器二进制译码器二-十进制译码器数码显示译码器译码器(即Decoder)二进制代码与输入代码对应的特定信息译码器译码器的概念与类型译码器CT74LS138A2A1A0Y0

6、Y1Y2Y3Y4Y5Y6Y7STCSTBSTAY0Y1Y2Y3Y4Y5Y6Y7逻辑功能示意图3线－8线译码器CT74LS138简介3位二进制码输入端8个译码输出端低电平有效。使能端STA高电平有效，STB、STC低电平有效，即当STA=1，STB=STC=0时译码，否则禁止译码。CD4511/74HC4511显示译码器测试灯消隐锁定1.半加器能对两个1位二进制数进行相加而求得和及进位的逻辑电路称为半加器。加数本位的和向高位的进位2.全加器能对两个1位二进制数进行相加并考虑低位来的进位，即相当于3个1位二进制数相加，

7、求得和及进位的逻辑电路称为全加器。Ai、Bi：加数，Ci-1：低位来的进位，Si：本位的和，Ci：向高位的进位。用来完成两个二进制数的大小比较的逻辑电路称为数值比较器，简称比较器。1.1位数值比较器设A＞B时L1＝1；A＜B时L2＝1；A＝B时L3＝1。得1位数值比较器的真值表。数值比较器集成比较器比较器在各种数字系统尤其是在计算机中，经常需要对两个二进制数进行大小判别，然后根据判别结果转向执行某种操作。用来完成两个二进制数的大小比较的逻辑电路称为数值比较器，简称比较器。在数字电路中，数值比较器的输入是要进行比较的

8、两个二进制数，输出是比较的结果。4选1数据选择器真值表逻辑表达式地址变量输入数据由地址码决定从４路输入中选择哪１路输出。数据选择器集成数据选择器集成双4选1数据选择器74LS153选通控制端S为低电平有效，即S=0时芯片被选中，处于工作状态；S=1时芯片被禁止，Y≡0。集成8选1数据选择器74LS15174LS151的真值表数据选择器小结数据选择器是能够从来