数字电路期末考试复习题课件.ppt

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1、1、将十进制2075转换成二进制（）B、八进制（）O和十六进制数（）H。将十进制20.75转换成二进制（）B、八进制（）O和十六进制数（）H。将十进制数3692转换成8421BCD码（）8421BCD。2075=（100000011011）B=（4033）O=（81B）H。20.75=（10100.11）B=（24.6）O=（14.C）H。3692=（0011011010010010）8421BCD。一、（20分）填空题2、在输入情况下，正逻辑“与非”运算的结果是逻辑0。3、逻辑函数的常用表示方法有、、、。全“1”真值表、逻辑表达式、逻辑图、卡诺图。4、数字系统中可以

2、实现“线与”功能的门电路有。OC。5、逻辑表达式Y=AB+C中,存在竞争冒险。（可能or不）6、N个触发器可以构成能寄存位二进制数码的寄存器。7、为实现高频率稳定度，常采用振荡器；单稳态触发器受外触发时进入态。石英晶体暂稳可能N8、电可擦除可编程存储器E2PROM芯片型号为2864有13根地址线，8根数据线，其存储容量为位（bit）。9、8位D/A转换器分辨率为。10、在三种A/D转换器中，转换速度最高（并联比较型逐次逼近型双积分型）。存储容量为64K(65536)位（bit），8K字节并联比较型1、用代数法将下列函数化简成为最简与或式；根据反演规则，写出L的反函数；

3、根据对偶规则，写出L的对偶式。二、（14分）逻辑函数化简2、用卡诺图法将下列函数化简成为最简与或式，写出函数的最简与非-与非表达式。三、（8分）试判断图题1所示电路能否按图中要求逻辑关系正常工作？若电路的接法有错，则修改电路。四、（6分）图题2为TTL门电路。1、写出Y的逻辑表达式。2、若已知A、B、C的波形，画出Y的波形。五、（8分）如图题3所示，试画出给定时钟脉冲的作用下，各触发器端的输出波形。设触发器初始状态为0。六、（10分）列出全加器的真值表，写出其逻辑表达式；使用图题4的双4选1数据选择器74LS153和一个反相器设计一位全加器。七、（13分）电路如题图5

4、所示，设初态Q2Q1Q0=000，1、试分析该电路是同步还是异步？2、列出电路的激励（驱动）方程；3、列出电路的状态方程；4、画出状态转换图；5、说明该时序电路功能；能否自启动？八、（14分）利用四位二进制同步加计数器74161、与非门和3/8译码器74138设计一个序列信号产生器，循环产生序列脉冲1101001。逻辑符号见图题6。八、（14分）利用四位二进制同步加计数器74161、与非门和3/8译码器74138设计一个序列信号产生器，循环产生序列脉冲1101001。逻辑符号见图题6。九、（7分）用555定时器组成单稳态触发器，已知R=1kΩ，C＝2μF。试求：1、画

5、出工作波形；2、计算输出脉冲宽度；3、电容0.01μF的作用。1、TTL与非门为提高开关速度，可采取措施。2、CMOS数字集成电路与TTL数字集成电路相比突出的优点是。1、抗饱和；2、静态功耗低；3、矩形脉冲、单稳态4、5V；5、123、多谐振荡器可产生信号波形。在数字系统中，电路可以产生脉冲定时。4、用555定时器组成施密特触发器，当输入控制端外接10V电压时，回差电压为。5、一个无符号12位数字量输入的DAC，其分辨率为位。练习1．555定时器的阈值分别为。2．555定时器输出端状态的改变有现象，回差电压为。1、1/3Vcc，2/3Vcc；2、滞回现象，回差电压为

6、1/3Vcc3．555定时器构成的多谐振荡器如图，其振荡周期为。其占空比为。4．555定时器构成的多谐振荡器如图所示，其充电时间常数为和放电时间常数为。5．图示电路的名称是什么？对触发脉冲的宽度有何要求？单稳态触发器，触发脉冲的宽度应小于暂稳态时间6．图示电路的名称是什么？对触发信号的逻辑电平有何要求？输出波形是什么形状？uo1和uo2的占空比是否相等？施密特触发器，触发信号的高电平应大于Vcc2/3，低电平应小于Vcc/3方波，相同2．设某8进制加法计数器的现态为6，经历30个计数脉冲后的状态为（2）A4B5C6D73．下列器件组中，均属于组合逻辑电路的是（3）组。

7、A计数器和比较器B寄存器和比较器C计数器和寄存器D比较器和编码器4．同步时序电路和异步时序电路的区别在于异步时序电路（4）。A没有触发器B没有统一的时钟脉冲C没有稳定状态D输出只与输入有关