哈工大数电大作业.doc

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1、HarbinInstituteofTechnology数电大作业（一）院系：航天学院班级：姓名：学号：指导教师：陶隽源哈尔滨工业大学航天学院2015年1月一、设计要求利用VerilogHDL设计一个逻辑控制电路，用于对某备进行模式切换控制，设备模式共三种，控制方式为：a)直通模式：高电平为直通有效，接地为直通无效；b)跳频模式：接地为跳频模式有效，高电平跳频无效；c)调谐模式：接地为调谐模式有效，高电平调谐无效。设备的同一时刻只有且必须有一个模式有效，其他两个无效。为防止同时多个模式有效，模式切换之间应有较小的延时，利用按键作为三种模式切换输入（按键最好有

2、消除抖动的措施）。二、编程环境编程软件：ISE13.4webpack版使用语言：verilogHDL语言三、源程序modulehomework_2(inputclk,inputkey,output[2:0]op);reg[2:0]out;reg[2:0]c_mode=3'b111,n_mode=3'b111;wirekey_done;regxiaodou1,xiaodou2,xiaodou3;parameterZ_mode=3'b111,T_mode=3'b001,D_mode=3'b010;always@(posedgeclk)beginxiaodou1

3、<=key;xiaodou2<=dou1;xiaodou3<=dou2;c_mode=n_mode;out=c_mode;endassignkey_done=(xiaodou1

4、xiaodou2

5、xiaodou3);always@(posedgekey_done)begincase(c_mode)Z_mode:n_mode=T_mode;T_mode:n_mode=D_mode;D_mode:n_mode=Z_mode;endcaseendassignop=out;endmodule一、程序电路原理图利用ISE中viewRTLschematic功能生成RT

6、L级原理图如下：二、仿真结果仿真程序：moduleasda;//Inputsregclk;regkey;//Outputswire[2:0]op;parameterPERIOD=20;alwaysbeginclk=1'b0;#(PERIOD/2)clk=1'b1;#(PERIOD/2);end//InstantiatetheUnitUnderTest(UUT)homework_2uut(.clk(clk),.key(key),.op(op));initialbegin//InitializeInputsclk=0;key=0;//Wait100nsforg

7、lobalresettofinish#100;//Addstimulushere#40key=0;#40key=1;#40key=0;#40key=1;#40key=0;#400key=1;#40key=0;#40key=1;#40key=0;#400key=1;#40key=0;#40key=1;#40key=0;#40key=1;#40key=0;#40key=1;#40key=0;#40key=1;#40key=0;#40key=1;#40key=0;#40key=1;endendmodule仿真结果：图一图二一、仿真结果分析需要实现的功能，按键消抖

8、，即按键按下出现抖动，快速01变换时，既要判断按键按下，并且不会判断按键多次按下。由仿真结果图一，按键连续出现两次峰值，我们看到只有第一次出现峰值时，实现了状态变化由111变为001，第二次峰值与第一次峰值只相差两个时钟周期，故不再重复触发。当间隔一段时间以后，又一次峰值到来时，才能再次触发，输出状态由001变为010。由仿真结果图二，按键为0一段时间后，出现连续的几个峰值，状态只变化一次，后面的峰值间隔小于三个时钟周期，故无论出现多少峰值，都不会再次触发，只有经历一个三周期的间隔，才能实现再次触发。经仿真验证，该设计符合题目要求。实现了消抖和延时功能。