中断控制实验.doc

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1、中断控制实验1.实验目的(1)掌握LM3S8962中的中断控制和NVIC的原理和使用方法(2)掌握CCS开发环境平台2.实验内容(1)ARM的初始化配置(2)占先优先权中断和尾链中断实验3.中断控制原理ARMCortex-M3处理器和NVIC将区分所有异常的优先等级并对其进行处理，所有异常都在处理器模式中处理。在出现异常时，处理器的状态将被自动存储到堆栈中，并在中断服务程序(ISR)结束时自动从堆栈中恢复。软件可在7个异常（系统处理程序）以及36个中断上设置8个优先级，通过NVIC中断优先级寄存器来配置其优先等级。当中断输入生效后，该中断就被挂起，当它的中断优先级最高时，开始执行其中

2、断服务程序，称此时中断进入了活跃状态，同时自动清零挂起位。当一个中断进入活跃状态，直到其服务程序执行完毕并且返回后，才能对同一中断的新请求予以响应。中断控制的状态如图1所示。图1中断控制的状态为了缩短中断延迟，设计了尾链中断机制。当处理器响应某中断时，又发生了其他优先级较低的中断，则先被挂起。在当前中断执行返回后，不再执行出栈和入栈操作，直接处理挂起的中断，就好像后一个中断与前一个中断的尾链接起来了，前后只执行了一次入栈/出栈操作。从而使两个ISR之间的间隔大大缩短。如图2所示是尾链中断机制。中断1的优先级高于中断2。图2尾链中断机制在发生嵌套中断的时候，如果后触发的中断的抢占优先级

3、高于先触发的中断，那么将发生占先优先级中断，即先执行完抢占优先级高的中断后再继续执行抢占优先级低的中断。4.软件流程设置3种不同的优先级：同等优先级、递减优先级和递增优先级。观察中断控制的不同状态，实现占先优先级中断控制，了解尾链中断机制。图3主函数流程图图4GPIOC的ISR流程图图5GPIOB的ISR流程图图6GPIOA的ISR流程图图7显示函数流程图5.实验步骤(1)运行CCS，添加驱动库"driverlib"，打开路径"D:LM3S8962MyDocumentsboardsek-lm3s8962"，选择存放中断控制实验的工程的文件夹"interrupts"，单击完成添

4、加到编辑界面；(2)浏览实现预定功能的源代码，编译、连接，检验并修正错误；(3)编链无错误后，点击调试按钮进入调试界面；(4)点击单步调试按钮，通过单步运行和设置断点调试程序，观察在同等优先级、递减优先级和递增优先级3种不同优先等级的情况下，中断的活跃和挂起状态；(5)单步调试完成后，取消断点，点击运行按钮，观察OLED上中断处理状态的显示。实验结果：首先显示同等优先级(C=B=A)时的中断处理状态，先进入GPIO端口C的中断服务子程序，挂起GPIO端口B的中断，然后进入GPIO端口B的中断服务子程序，挂起GPIO端口A的中断，最后进入GPIO端口A的中断服务子程序；接着显示递减优先

5、级(C>B>A)时的中断处理状态，过程与同等优先级时一样，这两种情况都用到了尾链中断机制，可通过外部设施观察需要的时钟周期；然后显示递增优先级(C