DSP系统控制及中断.ppt

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1、1、DSP的含义？－－2种第一讲内容回顾2、DSP芯片的特点？－－高速、实时3、DSP芯片的应用领域？信号处理、数字控制4、如何选择DSP芯片？TI的三个系列5、TMS320F28×芯片的特点？数字(电机)控制12.1时钟及系统控制2.2通用I/O2.3外设扩展中断模块2.4定时器中断举例DSP原理与应用技术第二讲系统控制与中断22.1时钟与系统控制TMS320F281×片上有基于PLL的时钟模块，为处理器和外设提供时钟信号。时钟源（OSCCLK）有两种配置模式：a）内部振荡器：在X1/XCLKIN和X2间接一个石英晶体；b）外部时钟源：将时钟信号直

2、接接到X1/XCLKIN引脚，X2悬空，此时不使用片内振荡器。3系统时钟选择系统时钟（CLKIN）的选择：1）系统复位时，如果XPLLDIS=0时，CPU直接采用外部时钟或片内振荡器输出作为系统时钟；2）系统复位时，如果XPLLDIS=1时，外部时钟经过PLL分频或倍频后为CPU提供时钟。晶体振荡器及锁相环模块(1)(2)(3)4系统时钟选择提示：通常需要使能PLL模式，OSCCLK=30MHz，时钟5倍频。模式功能概述CLKIN禁止PLL复位时如果引脚/XPLLDIS是低电平，则屏蔽PLL模块。直接使用引脚X1/XCLKIN输入的时钟信号作为CPU

3、时钟。XCLKIN旁路PLL上电时的默认值。如果PLL没有被禁止，则PLL将配置为旁路模式，此时引脚X1/XCLKIN输入的时钟信号经过2分频后作为CPU时钟。XCLKIN/2使能PLL通过向PLLCCR寄存器写入一个非零值n可以使能PLL。/2模块将PLL的输出二分频后送至CPU时钟。(OSCCLK·n)/2锁相环控制寄存器（PLLCR－－0x00007021）30MHz15MHz15－150MHz5设置系统时钟－CLKIN//ThisfunctioninitializesthePLLCRregister.voidInitPll(unsignedi

4、ntval){volatileunsignedinti;EALLOW;SysCtrlRegs.PLLCR.bit.DIV=val;EDIS;DisableDog();//WaitPLLlockcycles.for(i=0;i<((131072/2)/12);i++){;}}}注意：例程中的循环次数是针对0等待状态的内部RAM情形。如果程序是从FLASH或外部扩展存储器中读取，则循环次数可以相应减少。循环前需要屏蔽看门狗模块可选:等待PLL时钟输出锁定.Val=0～10寄存器PLLCR是写保护的。6时钟频率与功耗的关系提示：DSP时钟频率不是越高越好,

5、满足系统要求即可。1.8V3.3Vsum7外设时钟控制寄存器外设时钟控制寄存器（PCLKCR）使能或禁止相关外设的时钟（含CAN总线）。高速外设时钟寄存器（HISPCP）高速外设（并口）：EVA，EVB，ADCHSPCLK＝SYSCLK/(1～14）复位后的缺省值为：SYSCLK/2低速外设时钟寄存器（LOSPCP）低速外设（串口）：SCIA，SCIB，SPI，McBSpLSPCLK＝SYSCLK/(1～14）复位后的缺省值为：SYSCLK/475MHz37.5MHz8外设模块时钟的初始化voidInitPeripheralClocks(void){

6、EALLOW;//HISPCP/LOSPCPwillbesettodefaultvaluesSysCtrlRegs.HISPCP.all=0x0001;//HSPCLK＝SYSCLK/2SysCtrlRegs.LOSPCP.all=0x0002;//LSPCLK＝SYSCLK/4//Peripheralclockenablessetfortheselectedperipherals.SysCtrlRegs.PCLKCR.bit.EVAENCLK=1;SysCtrlRegs.PCLKCR.bit.EVBENCLK=1;SysCtrlRegs.PCLKC

7、R.bit.SCIAENCLK=1;SysCtrlRegs.PCLKCR.bit.SCIBENCLK=1;SysCtrlRegs.PCLKCR.bit.MCBSPENCLK=1;SysCtrlRegs.PCLKCR.bit.SPIENCLK=1;SysCtrlRegs.PCLKCR.bit.ECANENCLK=1;SysCtrlRegs.PCLKCR.bit.ADCENCLK=1;EDIS;}1、为了降低功耗，建议关闭不使用的外设时钟。2、如果外设时钟未使能，则无法读写相应的外设寄存器。//Thisfunctioninitializesthecloc

8、kstotheperipheralmodules.92、看门狗及其应用8位的看门狗计数器（WDCNTR），当