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《电工电子技术应用（第2版）教学课件作者杨达飞学习情境9.ppt》由会员上传分享，免费在线阅读，更多相关内容在教育资源-天天文库。
1、学习情境9十进制计数显示器的制作一、知识准备二、任务实施三、能力与知识拓展—数字计时器的制作上一页返回一、知识准备1.1触发器的认识触发器实物如图9-2所示。触发器是时序逻辑电路的基本单元，是各种计数器、寄存器的主要功能部件，它具有两种稳定的输出状态用来表示逻辑状态的“1”和“0”。在输入信号作用下，触发器的两个稳定状态可相互转换，输入信号消失后，已转换的稳定状态可长期保存下来，这就使得触发器能够记忆二进制信息。按结构和工作方式不同可分为RS触发器、JK触发器、D触发器、T触发器等。1.RS触发器的特点及
2、逻辑功能测试RS触发器的特点1)与非门组成的基本RS触发器下一页返回一、知识准备由与非门输入、输出交叉连接而成的基本RS触发器的逻辑图和逻辑符号如图9-3所示。输入端为复位端、为置位端，Q和是输出端。当Q=1,=0时，称触发器为1状态;当Q=0,=1时，称触发器为0状态。图中输入端在字母在加“-”表示低电平有效。当=0,=1时，不管触发器原来的状态是1还是0，因=0,G1输出=1，这时G2的输入都是高电平，输出Q=0，触发器被置0。当=1,=0时，不管触发器原有的状态是1还是0，因=0,G2输出Q=1，这
3、时G1的输入都是高电平，输出=0，触发器被置1。上一页下一页返回一、知识准备当=1时，若触发器原有的状态是Q=1,=0，这时G1门的两个输入信号都是高电平，则输出=0;=0反馈至G2的输入端，使G2的输出Q=1，触发器维持1状态。同样分析，若触发器原有的状态是Q=0,=1，这时G1门的输入信号有0，则输出=1;G2的输入端都是高电平，使G2的输出维持Q=0，触发器保持原状态。所以，当=1时，触发器“保持”逻辑功能。当=0时，G1、G2的输出都为1，既不是1状态，也不是0状态，破坏了Q和的互补关系。当同时由
4、0变为1时，触发器的输出状态无法预知，可能是0,也可能是1。所以，当=0时，触发器状态不定，实际上这种情况是不允许的。综上所述，当的状态改变时，输出端Q和是的状态也随之改变，如表9-1逻辑状态表所列。上一页下一页返回一、知识准备2)或非门组成的基本RS触发器由或非门输入、输出交叉连接而成的基本RS触发器的逻辑图和逻辑符号如图9-4所示。输入端R为复位端、S为置位端，Q和是输出端。当R=0,S=1时，不管触发器原来的状态是1还是0，因S=1，G2输出=0，这时G1的输入都是低电平，输出Q=1，触发器被置1。
5、当R=1,S=0时，不管触发器原有的状态是1还是0，因R=1,G1输出Q=0，这时G2的输入都是低电平，输出=1，触发器被置0。当R=S=0时，若触发器原有的状态是Q=1,=0，这时G1门的两个输入信号都是低电平，则输出Q=1;Q=1反馈到G2的输入端，则使G2的输出=0,触发器维持1状态。上一页下一页返回一、知识准备同样分析，若触发器原有的状态是Q=0,=1，这时G1门的输入信号有1，则输出Q=0,G2的输入端都是低电平，使G2的输出维持=1，触发器保持原状态。所以，当R=S=0时，触发器“保持”逻辑功
6、能。当R=S=1时，G1,G2的输出都为0，既不是1状态，也不是0状态，破坏了Q和的互补关系。当R、S同时有1变为0时，触发器的输出状态无法预知，可能是0，也可能是1。所以，当R=S=1时，触发器状态不定，实际上这种情况是不允许的。综上所述，当R和S的状态改变时，输出端Q和是的状态也随之改变，如表9-2逻辑状态表所列。上一页下一页返回一、知识准备3)同步RS触发器基本RS触发器无时钟脉冲输入端。在基本RS触发器的基础上增加了两个由时钟脉冲CP控制的传输门，当CP=0时，传输门“封锁”输入信号，不论R,S的
7、信号如何变化，触发器的状态保持不变。当CP=1时，解除封锁，同步RS触发器的工作状态如基本RS触发器一样。同步RS触发器的逻辑图和逻辑符号如图9-5所示。同步RS触发器逻辑状态表如表9-3所列。表中x表示“0”或者“1”。1)与非门组成的基本RS触发器功能测试用四2输入与非门CC4011(或74LS00)构成一个基本RS触发器，选择两个与非门按图9-3(a)图进行连接。上一页下一页返回一、知识准备触发器的输入端分别接人逻辑开关，输出端口接发光二极管，按表进行逻辑功能测试，观察并记录测试结果，完成表9-4的
8、填写。2)或非门组成的基本RS触发器功能测试用四2输入或非门CC4001(或74LS02)构成一个基本RS触发器，选择两个或非门按图9-4(a)图进行连接。触发器的输入端R、S分别接人逻辑开关，输出端口接发光二极管，按表进行逻辑功能测试，观察并记录测试结果，完成表9-5的填写。2.JK触发器的特点及逻辑功能测试主从JK触发器的主要组成部分是RS触发器，具有J和K两个输入端、时钟输入端(CP)端和输出端(Q和)。上一页下一页返回
