数字电子技术习题库

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1、习题库一、填空题1.(10110.1)2=()16=()8=()102.说明下图所示电路输出端的逻辑状态。3.将逻辑函数化成最小项表达式Y=()4．(01100110.0110)BCD=()10=（）165.说明下图所示电路输出端的逻辑状态，Y1为___________，Y2为___________，Y3为，Y4为___________，Y5为___________，Y6为。6．逻辑图和输入A，B的波形如图所示，分析在t1时刻输出Y为。7．已知卡诺图如下，则逻辑函数Y=其反函数=。8．对于四位二进制译码器，其相应的输出端共有（）。9．欲使JK触发器转换为T触发器，可使JK触发器的输入

2、端（）；要实现，则JK触发器的J、K取值应为（）。10．下图所示的电路是用双四选一数据选择器74LS153实现的组合逻辑函数，74LS153的真值表如下，则该函数的逻辑表达式为。11．欲使JK触发器转换为T触发器，可使JK触发器的输入端；要实现，JK触发器的J、K取值应为。12．若用触发器组成某十一进制加法计数器，需要个触发器，有个无效状态。13.用555定时器组成施密特触发器，当输入控制端CO外接8V电压时，回差电压为。14．知同步十进制加法计数器74LS160的的为同步置数端、为异步清零端，欲将下图所示电路接成4进制计数器，则D4D3D2D1=。15．逻辑图如下，当A=0，B=1

3、时Y为。16.一个32选一的数据选择器，其地址输入（选择控制输入）端有个。17.某电视机水平-垂直扫描发生器需要一个分频器将3600HZ的脉冲转换为60HZ的脉冲，欲构成此分频器至少需要___________个触发器。18.同步十进制加法计数器74LS160的为同步置数端、为异步清零端，试分析下图所示的计数器在M=1时为___________进制，M=0时为___________进制。11.将1KHz的脉冲转换为50Hz的脉冲，设计这样功能的分频器至少需要___________个触发器。12.同步十进制加法计数器74LS160的为同步置数端、为异步清零端，试分析下图所示的计数器在为_

4、__________进制。二、化简下列逻辑函数，方法不限1．约束条件2．已知卡诺图如下，求逻辑函数Y及其反函数3、4、5、，约束条件为AB+BC=06.7．三、组合逻辑电路1..由3-8译码器74HC138组成的电路如图所示，写出Y1和Y2逻辑函数式，并分析电路的逻辑功能(10分)。2.设计一个三人表决电路条件：三人中有组长一人，只要组长反对，表决不可通过；组长同意时，其余二人有一人同意即为通过。用1表示同意，0表示反对，表决结果通过用1表示，不通过用0表示。要求用与非门实现。3.设计要求：密码锁上有三个按键A、B、C。当三个按键同时按下，或A、B两个同时按下，锁就能被打开（用F表开

5、锁信号）；而当有键按下却不符合上述组合状态时，将发出报警信号（用G表示报警信号）。要求用与非门实现。4.用4选1数据选择器设计一个举重裁判表决电路，选择器的输入端、控制端如图所示。可附加必要的门电路。要求举重比赛有三个裁判，一个主裁判和两个副裁判。杠铃完全举上的裁决，由每一个裁判按一下自己面前的按钮来确定，只有当两个或两个以上裁判判明成功，并且其中有一个为主裁判时，表明成功的灯才亮。（10分）四、波形图的画法1.根据给定信号的波形画出各输出端的波形。设图（a）触发器的初始状态为“0”。（a）（b）2.分析图示触发器功能，写出两个触发器的状态方程，并根据给定A、CP信号的波形画出各输出

6、端的波形。设各触发器的初始状态均为“0”。3.边沿JK触发器输入cp端的波形如图所示，试画出输出Q，Qˊ，Y1，Y2端的波形。（设触发器的初始状态为Q=0）（10分）QQˊY1Y2五、1.分析图示电路的逻辑功能。写出其驱动方程、状态方程、输出方程，画出状态转换表（或状态转换图），验证电路能否自启动。2.自己找书上的习题，同步时序逻辑电路分析的习题即可。六、1.知同步十进制加法计数器74LS160的为同步置数端、为异步清零端.1、试分析下图所示电路为几进制计数器?并写出有效的状态转换图。2、在只允许增加一条连线情况下,请将其改为六进制加法计数器（在原图上修改即可）2.已知集成同步十进制

7、加计数器74LS160，试用其构成7进制加法计数器，并画出有效的状态转换图。（74LS160计数时EP、ET接高电平）七、1.由集成单稳态电路74121和555定时器构成的电路如图所示，74121的功能表如下表。（1）画出图中与的示意性波形（2）求555定时器输出电压的周期、频率和占空比。2.已知电路如图，1）说明555（1）和555（2）所组成的脉冲电路名称。2）频率为10Hz，试画出和的工作波形。3）计算的振荡频率。3.1）说明555定时器的电路类型以