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时间:2017-12-12
《毕业设计(论文)-基于vhdl的八路数字显示抢答器的设计》由会员上传分享,免费在线阅读,更多相关内容在学术论文-天天文库。
1、陕西理工学院毕业设计基于VHDL语言的八路数字抢答器系统的设计XXX指导教师:XXX[摘要]本设计使用VHDL语言设计一个八路数字抢答器系统。VHDL是一种全方位的硬件描述语言,几乎覆盖了以往各种硬件描述语言的功能,整个自顶向下或自底向上的电路设计过程都可以用VHDL来完成。本文阐述了EDA的概念和发展、VHDL语言的优点和语法结构并分析讲解了八路数字抢答器的各模块的功能要求、基本原理以及实现方法。本系统的设计就是采用VHDL硬件描述语言编程,基于MAX-PLUSII平台进行编译和仿真来实现的,其采用的模块化、逐步细化的设计方法有
2、利于系统的分工合作,并且能够及早发现各子模块及系统中的错误,提高系统设计的效率。本设计主要的功能是:1.对第一抢答信号的鉴别和锁存功能;2.抢答成功声音报警;3.数码显示抢答成功组别;4.答题限时功能。[关键词]电子设计自动化(EDA);VHDL语言;抢答器第25页共39页陕西理工学院毕业设计TheDesignofthe8DigitalViestoAnsweringSnatchesBasedonVHDLHeLiwei(Grade07,Class6,Majorelectronicsandinformationengineering,
3、ElectronicsandinformationengineeringDept.,ShaanxiUniversityofTechnology,Hanzhong723003,Shaanxi)Tutor:ZhangZhiwei[Abstract]Thisdesignisthe8digitalviestoansweringsnatchesbasedonVHDL.VHDLisakindofhardwaredescriptionlanguage,whichisall-rounds,nearlycoversthefunctionofeach
4、otherkindofhardwaredescriptionlanguage.Boththeentiretop-downandbottom-UpcircuitdesignprocesscouldbeaccomplishedbyVHDL.ThisarticleelaboratestheconceptanddevelopmentofEDA,explainstheadvantagesandgrammarstructureofVHDL,meanwhile,analysesthefunctionrequest,thebasicprincip
5、leaswellasthemethodofaccomplishmentofeachparts.Thissystem'sdesignprogrammersintheVHDLcompiledandemulatedbasingonMAX-PLUSIIplatformofAltera.Usingthemodulation,andthegraduallydetailingdesignmethodisofgreatbenefitforthesystem'sdivisionoflaborandcooperation,besides,theusa
6、geofthismethodcandetecterrors,asearlyaspossible,inseveralofsubmodulesandsystem,enhancingtheefficiencyofthesystemdesign.Themainfeaturesofthisdesignare:1.accuratelyidentificationofthesignalofthefirstanswerandlatchingthissignal;2.snatchestheansweringsuccessfulandvoiceala
7、rm3.Digitaldisplayfaction4.thetimelimitedfunction.[Keywords]:EDA;VHDL;theAnsweringsnatches第25页共39页陕西理工学院毕业设计目录1引言11.1EDA技术的设计优势11.2论文结构12系统方案的论证和选择23系统的设计平台概述33.1传统和现代的数字系统设计方法比较33.2硬件描述语言(VHDL)概述33.3硬件平台Max-plusⅡ概述44数字抢答器系统的设计与实现54.1抢答器系统设计要求54.2系统总体设计思想54.3子模块的设计思想和
8、实现64.3.1鉴别模块的设计与实现64.3.2锁存反馈模块的设计与实现84.3.3编码模块的设计与实现94.3.4声音报警模块的设计与实现104.3.5答题倒计时模块的设计与实现114.3.6组别译码显示模块的设计与实现145抢答器的系统实现16
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