MSP430系列超低功耗16位单片机PPT课件教程5.2.pdf

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1、USART模块结构UART模块结构异步串行异步通信特点•异步模式，包括线路空闲/地址位通信协议•两个独立移位寄存器：输入移位寄存器和输出移位寄存器•传输7位或8位数据，可采用奇校验或偶校验或者无校验•从最低位开始的数据发送和接收•可编程实现分频因子为整数或小数的波特率•独立的发送和接收中断•通过有效的起始位检测将MSP430从低功耗唤醒•状态标志检测错误或者地址位异步多机通信模式•Whentwodevicescommunicateasynchronously,theidle-lineformatisusedfortheprotocol.•Whenthreeormoredevicescommu

2、nicate,theUSARTsupportstheidle-lineandaddress-bitmultiprocessorcommunicationformats.线路空闲多机模式地址位多机模式串行操作自动错误检测•FE标志帧错误：当一个接收字符的停止位为0并被装入接收缓存，接收的为一个错误的帧，那么帧错标志被设置成1，即使在多停止位模式时也只检测第一个停止位。同样，丢失停止位意味着从起始位开始的同步特性被丧失，也是一个错误帧。在同步的4线模式时，因总线冲突使有效主机停止，并在STE引脚信号出现下降沿时使FE位设置为1•PE奇偶校验错误：当接收字符中1的个数与它的校验位不相符，并被装入接

3、收缓存时，发生校验错，设置PE为1•OE溢出错误标志：当一个字符写入接收缓存URXBUF时，前一个字符还没有被读出，这时前一个字符因被覆盖而丢失，发生溢出（同步与异步情况相同）•BRK打断检测标志：当发生一次打断同时URXEIE置位时，该位被设置为1，表示接收过程被打断过。RXD线路从丢失的第一个停止位开始连续出现至少10位低电平被识别为打断波特率的产生òNote:InitializingorRe-ConfiguringtheUSARTModuleTherequiredUSARTinitialization/re-configurationprocessis:1)SetSWRST(BIS.B

4、#SWRST,&UxCTL)2)InitializeallUSARTregisterswithSWRST=1(includingUxCTL)3)EnableUSARTmoduleviatheMExSFRs(URXExand/orUTXEx)4)ClearSWRSTviasoftware(BIC.B#SWRST,&UxCTL)5)Enableinterrupts(optional)viatheIExSFRs(URXIExand/orUTXIEx)FailuretofollowthisprocessmayresultinunpredictableUSARTUCTL0

5、=SWRST;UCTL0

6、=

7、CHAR;//8-bit字符UTCTL0=SSEL0+SSEL1;//UCLK=SMCLKUBR00=0xa0;//在4MHz下进行9600波特率通信UBR10=0x01;//4000000/9600=416.67UMCTL0=0x5e;//调整寄存器(0.67*8=5.4)UCTL0&=~SWRST;ME1

8、=(UTXE0+URXE0);//使能USART0TXD/RXDIE1

9、=URXIE0;IFG1=0x00;P2SEL

10、=0x30;//P2.4,P2.5=USART0TXD/RXDP2DIR

11、=0x10;SPI典型结构当MSP430USART模块控制寄存器UCTL的SYNC位置位且I

12、2C位复位时，串行模块工作在SPI模式，通过4线（SOMI，SIMO，UCLK及STE）或者3线（SOMI，SIMO，UCLK）同外界通信MSP430的同步通信模块特点•支持3线或4线SPI操作•支持主机模式与从机模式•接收和发送有单独的移位寄存器•接收和发送有独立的缓冲器MSP430的同步通信模块特点•接收和发送有独立的中断能力•时钟的极性和相位可编程•主模式的时钟频率可编程•7位或8位字符长度SPI的主机模式òSPI的从机模式同步通信举例I2C概述•在现代电子系统中，有为数众多的IC需要进行相互之间以及与外界的通信。为了提高硬件效率和简化电路设计而广泛使用Inter-IC。•Inter-

13、IC（I2C）总线是一种用于内部IC控制的具有多端控制能力的双线双向串行数据总线系统。能够用于替代标准的并行总线，连接各种集成电路和功能模块。I2C器件的应用能够减少电路间连线，减小电路板尺寸，降低硬件成本，并提高了系统可靠性•MSP430和有关设备互连MSP430I2C模块结构MSP430系列I2C模块的主要特征•符合I2C规范V2.1•读写采取先进先出缓冲结构•可编程时钟发生器•16位数据访问可达到总线的