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时间:2020-03-24
《基于AFS600的CAN核重用设计.pdf》由会员上传分享,免费在线阅读,更多相关内容在行业资料-天天文库。
1、自动控制基于AFS600的CAN核重用设计一与0捡测戚振军,张承瑞,綦声波(山东大学机械工程学院高效洁净机械制造教育部重点实验室,山东济南250061)DesignofReusingCANIPCoreonAFS600QIZhen—jun,ZHANGCheng—rui,QISheng—bo(KeyLaboratoryofHighEfficiencyandCleanMechanicalManufacture,MinistryofEducationSchoolofMechanicalEngineering,ShandongUnive
2、rsity,Jinan250061,China)摘要:通过分析CAN核管脚信号的有效电平强,但开发周期长;而第三方提供的IP核,如open—和添加RAM块,实现了CAN核的移植;通过改双cores网站提供的开源IP核,则具有免费、适用性向总线为单向总线和设计时序转换桥,实现了强、用户开发周期短等优势。本设计采用在FPGACore8051和修改后的CAN核的通信。经试验验中嵌入CANIP核来实现CPU软核与其它系统的证,CAN核和Core8051核组成的CAN节点,可以CAN通信嘲。参考文献[3—4]都采用用户自定义与CAN总线
3、上的测试设备正常通信。的方式设计了CAN总线控制器IP核,工作量较关键词:CAN核;AFS600;IP重用;Core8051;大,开发周期较长。鉴于成本和开发时间的考虑,本时序转换文采用opencores网站提供的开源CAN核],将其中图分类号:TP332移植到AFS600上,设计了CAN总线控制器。文献标识码:B1CAN核在AF$600上的移植文章编号:1001—2257(2010)05—0041—04Abstract:ByanalyzingtheCANIPcore’Ssig—1.1CAN核的模块组织结构nalandaddi
4、ngRAMblocks,theCANIPcoreis该can核的顶层模块是can—top。顶层模块下transplantedonAFS600;InordertoconnectCAN有3个子模块:BSP(位流处理器)模块、BTL(位时IPcoreandCore8051IPcore,bi—directiona1busis序逻辑)模块和REGISTERS(寄存器)模块。每个changedintotwoone—waybuses,andatiming子模块又由多个模块组成。CAN核的模块组织结conversionbridgeisdesi
5、gned.Theresultoftheda-构如图1所示。tatransmissionshowsthatthenode,consistedwithCANandCore8051IPcores。cancommunicatewith\—/,———————————————theCAN—testingequipmentbyCANbus.,、can—bsp.vKeywords:CANIPcore;AFS600;IPreuse;Core8051;timingconversion吣0引言藓IP(intellectualproperty)核以其
6、可重用性(re~图1CAN核的模块组织结构1.2CAN核管脚信号有效电平的分析usability)的特点,在FPGA设计中获得了广泛的应对于该CAN核,opencores网站上作出了这样用。IP核一般有3个来源:EDA厂商提供,用户的标识:“sJA1000(Philips)compatibleinterface”。自己定义,第三方提供。EDA厂商提供的IP核但是,这仅仅表示该CAN核的接口时序与常用的适用性强但需要付费;用户自定义的IP核耦合性CAN协议芯片SJA1000兼容,并不表明相关信号收稿日期:2010一O1—2Z的有
7、效电平的高低也与SJA1000一致。在重用《机械与电子>2010(5)·41·CAN核的过程中,通过阅读相关源代码和多次试.WCLOCK(elk),验,确定了相关信号的有效电平。CAN核移植前后.DI(1en~cnt&{4{~initialize—memories))),的引脚信号图和SJAlOOO的引脚及封装图如图2.PO(),//paritynotused所示。CAN核和SJAlOOO相关引脚信号的有效电.WRB(-~(writelengthinfo&(~infoful1)_——平的对照关系如表1所示。Jinitializ
8、e—memories)),AD6『1.RDB(1O),//alwaysenabledAD7.WADDR(wr_info—pointer),ALE/ASL羔.RADDR(rd_info磊I4—pointer));WRl6分析上面的代码可知,“aetel—ram一64x4一syn
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