同步fifo设计实验报告.docx

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1、课程设计报告题目:同步FIFO的设计姓名:贾安乐学号:20105000学院:电子科学与应用物理学院专业:电子科学与技术10-3组员:徐健勋、兰伯章指导老师:杨小平、杞宁日期:2014.12.159/9一.课程设计要求1.课程设计的目的通过运用Verilog语言编写程序,体会程序的逻辑性,掌握基本的程序开发的注意事项。在实践中,学习掌握简单、周全的编程方法。掌握较大工程的基本开发技能。培养综合运用Modelsim,QuartusII工具进行硬件开发的能力。培养数字系统设计的基本能力。理解FIFO的定义与功能,掌握FIFO的Verilog编写方法。2.课程设计的条件FI

2、FO的定义与功能QuartusII仿真工具3.课程设计的要求FIFO是英文FirstInFirstOut的缩写,是一种先进先出的数据缓存器,他与普通存储器的区别是没有外部读写地址线,这样使用起来非常简单,但缺点就是只能顺序写入数据,顺序的读出数据,其数据地址由内部读写指针自动加1完成,不能像普通存储器那样可以由地址线决定读取或写入某个指定的地址。使用Verilog语言和QuartusII仿真器完成同步FIFO的设计和验证。使用QuartusII和SOPC实验箱验证设计的正确性。Verilog代码要符合微电子中心编码标准。4.Verilog语言VerilogHDL是一

3、种硬件描述语言(HDL:HardwareDescriptionLanguage),是一种以文本形式来描述数字系统硬件的结构和行为的语言,用它可以表示逻辑电路图、逻辑表达式,还可以表示数字逻辑系统所完成的逻辑功能。Verilogs是由Gateway设计自动化公司的工程师于1983年末创立的。当时Gateway设计自动化公司还叫做自动集成设计系统(AutomatedIntegratedDesignSystems),1985年公司将名字改成了前者。该公司的菲尔·莫比(PhilMoorby)完成了Verilog的主要设计工作。1990年代初,开放Verilog国际(Open

4、VerilogInternational,OVI)组织(即现在的Accellera)成立,Verilog面向公有领域开放。1992年,该组织寻求将Verilog纳入电气电子工程师学会标准。最终,Verilog成为了电气电子工程师学会1364-1995标准,即通常所说的Verilog-95。设计人员在使用这个版本的Verilog的过程中发现了一些可改进之处。为了解决用户在使用此版本Verilog过程中反映的问题,Verilog进行了修正和扩展,这部分内容后来再次被提交给电气电子工程师学会。这个扩展后的版本后来成为了电气电子工程师学会1364-2001标准,即通常所说的

5、Verilog-2001。Verilog-2001是对Verilog-95的一个重大改进版本,它具备一些新的实用功能,9/9例如敏感列表、多维数组、生成语句块、命名端口连接等。目前,Verilog-2001是Verilog的最主流版本,被大多数商业电子设计自动化软件包支持。2005年,Verilog再次进行了更新,即电气电子工程师学会1364-2005标准。该版本只是对上一版本的细微修正。这个版本还包括了一个相对独立的新部分,即Verilog-AMS。这个扩展使得传统的Verilog可以对集成的模拟和混合信号系统进行建模。容易与电气电子工程师学会1364-2005标

6、准混淆的是加强硬件验证语言特性的(电气电子工程师学会1800-2005标准),它是Verilog-2005的一个超集,它是硬件描述语言、硬件验证语言(针对验证的需求,特别加强了面对对象特性)的一个集成。2009年,IEEE1364-2005和IEEE1800-2005两个部分合并为IEEE1800-2009,成为了一个新的、统一的SystemVerilog硬件描述验证语言(hardwaredescriptionandverificationlanguage,HDVL)。5.QuartusII仿真器QuartusII是Altera公司的综合性PLD/FPGA开发软件,

7、支持原理图、VHDL、VerilogHDL以及AHDL(AlteraHardwareDescriptionLanguage)等多种设计输入形式,内嵌自有的综合器以及仿真器,可以完成从设计输入到硬件配置的完整PLD设计流程。QuartusII可以在XP、Linux以及Unix上使用,除了可以使用Tcl脚本完成设计流程外,提供了完善的用户图形界面设计方式。具有运行速度快,界面统一,功能集中,易学易用等特点。QuartusII支持Altera的IP核,包含了LPM/MegaFunction宏功能模块库,使用户可以充分利用成熟的模块,简化了设计的复杂性、加快了设计速度。

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