计算机组成原理试卷集.doc

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1、说明:请在答题纸上答题一.选择题(每题1分,共6分)1.在下述存储器中,允许随机访问的存储器是()。①磁带②磁盘③磁鼓④半导体存储器2.在下面的结论中,()正确。①主存是主机的一部分,不能通过单总线被访问②主存可以和外围设备一样地,通过单总线被访问③主存是主机的一部分,必须通过专用总线进行访问④主存是主机的一部分,必须通过内总线进行访问3.下列设备中,哪种适于通过DMA方式与主机进行信息交换()。①键盘②电传输入机③针式打印机④磁盘4.下列存储器中,()存取时间的长短与信息所在的位置有关。①主存②调整缓

2、存③磁带④固存5.磁表面存储器所记录的信息()。①能长期保存②不能长期保存③读出后,原存信息即被破坏④读出若干次后要重写6.在调频制记录方式中,记录0时,写电流()变化一次。①在只在本位单元中间位置处②只在本位单元起始位置处③本位单元起始位置处负向④在本位单元起始位置和中间位置处各二.填空题(每空1分,共20分)1.计算机主机是由和两部分组成。2.有一个(7,4)码,其生成多项式G(x)=1011,则数据1010的CRC码为。3.某机字长4位,若[x]补=1110,则[-x]补=,[-x]移=。4.在存

3、储系统的层次结构中,CPU可直接访问的存储器是。5.时序控制有、和三种方式。6.浮点数字长16位,其中阶码含阶符共4位,移码表示,尾数含一位数符共12位,补码表示,规格化。则真值(-25×0.375)10浮点数代码应为。7.直接寻址方式,指令中的地址码部分给出的是操作数的。8.设置高速缓冲存储器的目的是,其实现依据是。9.动态RAM刷新有4种方式,分别为、、、。10.总线优先权控制有、及三种实现方法。三、判断题(正确打“Ö”错误打“×”,每题3分,共18分)1.CPU同时接受到外部中断请求和DMA请求时

4、,CPU优先响应外部中断请求。()2.当Cache的各个块都被占用后,CPU就将无法再使用它。()3.中断向量和向量中断含义相同。()4.74181只能完成加减运算。()5.微程序由用户编制,存放于主存中。()6.大多数微型机的总线由地址总线,数据总线和控制总线组成,因此,它们是三总线结构的。()四、简述题(每题5分,共25分)1.磁盘存储器的地址格式如何?为什么要采用这种格式?2.简述中断处理的一般过程。3.水平型微指令,微命令字段的编码方法有哪些?每种方法的基本思想如何?4.简述浮点加减法的运算步骤

5、。5.简述控制器的组成,并说明各部分功能。五、计算题(请写出详细步骤)(第1~2题每题6分,第3题5分,共17分)1.用Booth算法计算,已知x=-0.1001,y=+0.1011求x×y,写出分步运算过程。2.设数的阶码为3位,尾数为6位(均不包括符号位),已知x=2--011×0.01011,y=2--0015×(--0.01010),用补码形式计算x+y。3.一个磁盘组有8面,每一面的存储区的内径20cm,外径30cm,磁盘的最大位密度为1600bps,磁道间最小间隔为0.25mm,转速为360

6、0rpm,问(1)该磁盘组可以存储的最大位数为多少?(2)对该磁盘的平均存取时间(设平均找道时间为20ms)与数据传输率。六、编写微程序(8分)已知一CPU内部的数据通路如下图所示。部件U的输入/输出分别用Ui和Uo表示,1®R,1®W,Add分别表示读主存、写主存、ALU加法控制信号。请写出指令ADDA,X(设该指令为单字节,X为立即数)的微操作序列。指令功能:(A)+X®A七、现有8K×8位的ROM和8K×4位的RAM芯片若干,程序存储器地址空间为6000H~9FFFH,用ROM芯片构成,数据存储器

7、地址空间为0000H~5FFFH,用RAM芯片构成,请选用上述芯片构造这样的存储器,画出逻辑连接图。(6分)、选择题(每题1分,共6分)1.④2.②3.④4.③5.①6.②二、填空题(每空1分,共20分)1.CPU主存(或:主存CPU)2.10100113.001010104.主存5.同步、异步、联合6.1(阶符)1001(数符)010000000007.有效地址8.提高CPU的利用率,程序的局部性访问原理9.集中、分散、异步、透明10.链式查询、计数器定时查询、独立请求方式三、判断题(正确打“Ö”错误

8、打“×”,每题3分,共18分)1.X2.X3.X4.X5.X6.X四、简述题(每题5分,共25分)1.驱动器号—柱面号(磁道号)---记录面号—扇区号减少找道时间,提高读写效率。2.中断请求—中断响应--中断识别--中断服务(保护现场、中断服务、恢复现场)---中断返回3.编码方法:直接编码、字段直接编码、字段间接编码、混合编码等。基本思想:4.对阶---尾数相加减---结果规格化5.IR:寄存正在执行的指令;PC:程序计数器;时序逻辑指令

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