习题答案(数电).ppt

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1、《数字电子技术基础》习题答案西安工程大学房晔第四章组合逻辑电路十一、某工厂有三个车间和一个自备电站，站内有两台发电机X和Y。Y的发电能力是X的两倍。如果一个车间开工，只起动X即可；如果两个车间同时开工，只起动Y即可；如果三个车间同时开工，则X和Y都要起动。试设计一个控制发电机X、Y起动和停止的逻辑电路。（1）用全加器实现。（2）用译码器实现。（3）用门电路实现，门电路种类不限。答案：用E、F、G三个变量作为输入变量分别对应三个车间，并设车间开工为1，不开工为0；X、Y两个变量作为输出变量分别对应两台发电机，并设电机启动为1，停止为0。根据题意可列真值表：由真值表写出逻

2、辑表达式：（1）用全加器实现令CI=EA=FB=G则S=XCO=Y（2）用译码器实现令A2=EA1=FA0=G则（3）用门电路实现，门电路种类不限。第五章触发器15.画出由与非门组成的SR锁存器输出端的电压波形，输入端的电压波形如图中所示。答案：16.画出由或非门组成的SR锁存器输出端的电压波形，输入端S、R的电压波形如图中所示。答案：17.由或非门组成的触发器和输入端信号如图所示，设触发器的初始状态为1，画出输出端Q的波形。答案：18.在下图电路中，若CP、S、R的电压波形如图中所示，试画出Q的波形，假定触发器的初始状态为Q=0。答案：19.若主从结构RS触发器各输入

3、端的电压波形如图中所示，试画出端对应的电压波形。设触发器的初始状态为Q=0。答案：20.已知主从结构JK触发器输入端J、K和CP的电压波形如图所示，试画出端对应的波形。设触发器的初始状态为Q=0。答案：21.图示电路中，已知CP和输入信号T的电压波形，试画出触发器输出端的电压波形，设触发器的起始状态为Q=0。答案：22.已知上升沿触发的D触发器输入端的波形如图所示，画出输出端Q的波形。若为下降沿触发，画出输出端Q的波形。设初始状态为Q=0。答案：23.已知D触发器各输入端的波形如图所示，试画出端的波形。答案：24.如图所示为边沿D触发器构成的电路图，设触发器的初状态Q1

4、Q0=00，确定Q0及Q1在时钟脉冲作用下的波形。答案：因为所以即两个D触发器的输入信号分别为另一个D触发器的输出信号，故在确定它们输出端波形时，应该分段交替画出其波形。第六章时序逻辑电路7.试分析下图所示时序逻辑电路的逻辑功能。解：属同步时序电路，时钟方程省去。输出方程：驱动方程：T触发器的特性方程：将各触发器的驱动方程代入特性方程，即得电路的状态方程：列状态转换表画状态转换图和时序波形图由状态图可以看出，当输入X＝0时，状态变化为：00→01→10→11→00→…当X＝1时，状态变化为：00→11→10→01→00→…可见，该电路既具有递增计数功能，又具有递减计数功

5、能，是一个2位二进制同步可逆计数器。8.写出下图电路的驱动方程、特性方程和输出方程。解：驱动方程状态方程输出方程10.输入信号波形如图所示，试画出电路对应的输出Q2、Q1的波形图。11.试分析下图所示时序逻辑电路的逻辑功能。解：属同步时序电路，时钟方程省去。驱动方程：将各触发器的驱动方程代入特性方程，即得电路的状态方程：列状态转换表画状态转换图由状态转换图可知：该电路属同步五进制计数器，不具备自启动功能。12.已知计数器的输出端Q2、Q1、Q0的输出波形如图所示，试画出对应的状态图，并分析该计数器为几进制计数器。由状态转换图可知：该电路属七进制计数器。解：13.分析图示

6、时序电路的逻辑功能，假设电路初态为000，如果在CP的前六个脉冲内，D端依次输入数据为1，0，1，0，0，1，则电路输出在此六个脉冲内是如何变化的？解：属同步时序电路，时钟方程省去。驱动方程：将各触发器的驱动方程代入特性方程，即得电路的状态方程：列状态转换表该电路属三位右移移位寄存器。14.分析图示计数器电路，说明这是多少进制的计数器，并画出对应的状态转换图。十进制计数器74160的功能表与表6.3.4（教材P282）相同。这是一个七进制进制的计数器。15.下图所示计数器电路为几进制计数器？图示计数器电路分别为八进制计数器和七进制进制的计数器。16.试用两片4位二进制

7、加法计数器74161采用并行进位方式构成8位二进制同步加法计数器。模为16×16=256。17.试用74161构成九进制计数器。（可采用异步清零法或同步预置数法）异步清零法同步预置数法18.试用集成计数器74160和与非门组成五进制计数器，要求直接利用芯片的进位输出端作为该计数器的进位输出。20.试用集成计数器74160和与非门组成48进制计数器。解：因为N＝48，所以要用两片74160构成此计数器。两芯片采用并行进位方式连接成100进制计数器，再用异步清零法组成了48进制计数器。21.某石英晶体振荡器输出脉冲信号的频率为32768Hz，