微机系统原理与接口第7章.ppt

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1、第7章总线7.2总线与总线标准7.132位微处理器的外部引脚CPU系统总线总线插槽ABABDBDBCBCBCPU总线地址锁存缓冲器数据锁存缓冲器总线控制逻辑I/O接口存储器系统I/O接口总线的类型按总线连接的对象和所处系统的层次分芯片级总线系统总线局部总线外部总线7.132位微处理器的外部引脚(教材P.27)1.数据线数据线:D63~D0共64位Pentium处理器的外部引脚2.地址线A31~A3:高29位地址线BE7#~BE0#:字节允许信号(存储体选中信号)外围电路对BE7#~BE0#译码以产生A2~A0信号时钟输入CLK是微处理器内部与外部操作的同步时基信号,由时钟(CLK)输入信

2、号来提供。CLK时钟周期:T状态:就是指时钟周期TPentium处理器的外部引脚3.系统控制信号M/IO:=1,表明该总线周期,CPU与存储器交换信息=0,表明该总线周期,CPU与I/O接口交换信息W/R:=1,表明该总线周期,CPU进行写操作=0,表明该总线周期,CPU进行读操作D/C:=1,表明该总线周期,传输的是数据=0,表明该总线周期,传输的是指令代码这三个信号的组合,决定当前总线周期所完成的操作4.总线周期定义信号(输出)“周期”是一段时间CPU通过总线与存储器、I/O交换一个数据所需要的时间称为总线周期Pentium处理器的外部引脚总线周期定义的操作M/IOD/CW/R操作0

3、00中断001中止/专用周期010I/O读011I/O写100微代码读101保留110存储器读111存储器写Pentium处理器的外部引脚5.总线控制信号(ADS,RDY)与32位微处理器典型时序(教材P.36)ADS:地址选通信号(输出)该信号由1→0,表明地址线和总线定义信号(M/IO,W/R,D/C)均为有效可用。Pentium处理器的外部引脚RDY:准备就绪信号(输入)该信号由外电路产生→X86RDY=0,表明外部电路(存储器、I/O接口)已经做好数据W/R的准备,能在规定时间内完成数据的读写。RDY=1,表明存储器或I/O不能在规定时间内完成数据的读/写,请CPU延长总线周期。

4、以下为X86的基本总线周期时序图(以pentium为例)Pentium处理器的外部引脚CLKADSADDRM/IO、D/CW/RRDYD0~D31PCHK读读写Pentium非流水线式读写周期时序图(无等待)T1T2T1T2T1T2CLKADSBE0~BE3A2~A31M/IO、D/CW/RRDYD0~D31读写有等待状态总线周期T1T2TWT1T2TWT16.总线仲裁信号(1)HOLD:总线保持请求(输入)(2)HLDA:总线保持响应(输出)ABDBCBX86DMAC高速I/O接口HOLDHLDAPentium处理器的外部引脚7.2总线与总线标准总线插槽是主板和I/O接口之间的连接器.

5、PC系列机主板上的总线标准有:XT总线、AT(ISA)总线、EISA总线、VESA总线和PCI总线。1.ISA(AT)总线(P.171)ISA总线是16位总线,始于286机型。之后在386~奔腾机上都有ISA总线。ISA总线由62芯+36芯两个插槽组成Industrystandardarchitecture工业标准结构主要特性:数据传输率最高为8MB/S24根地址线,可寻址16MB存储空间64KB个可寻址的I/O端口(16根地址线)一次可进行16位或8位数据存取15级中断控制7个DMA通道可产生I/O等待状态支持多个主控器(XT总线中只有CPU是唯一的主控设备,而ISA总线可使CPU释放

6、总线由其它主控、器(如DMAC、DRAM刷新控制器等)占用总线)GNDRESETDRVB1B2B3B4B5B6B7B8B9B10B11B12B13B14B15B16B17B18B19B20B21B22B23B24B25B26B27B28B29B30B31A1A2A3A4A5A6A7A8A9A10A11A12A13A14A15A16A17A18A20A19A22A21A23A24A25A26A27A28A29A30A31D1D2D3D4D5D6D7D8D9D10D11D12D13D14D15D16D17D18C1C2C3C4C5C6C7C8C9C10C11C12C13C14C15C16C1

7、7C18+5VIRQ9-5VDRQ2-12V0WS+12VGNDSMEMWAT总线插槽引脚分配SMEMRIOWIORDACK3DRQ3DRQ1DACK1REFRESHCLKIRQ7IRQ5IRQ6IRQ4IRQ3DACK2T/CBALE+5VOSCI/OCHCKGNDSD7SD6SD5SD4SD3SD2SD1SD0I/OCHRDYAENSA19SA18SA17SA16SA15SA14SA13SA12SA11SA10SA9SA8SA7

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