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1、第二章VHDL语言语法基础VHDL入门例:2选1选择器设计abmux21ysLIBRARYIEEE;USEIEEE.STD_LOGIC_1164.ALLENTITYmux21ISPORT(a,b:INSTD_LOGIC;s:INSTD_LOGIC;y:OUTSTD_LOGIC);ENDmux21;ARCHITECTUREoneOFmux21ISBEGINy<=aWHENs=‘0’ELSEbWHENS=‘1’;ENDone;IEEE库使用说明器件mux21的外部接口信号说明,PORT相当于器件的引脚,这一部分称为实体器件mux21的内部工作逻辑描述,即为实体描
2、述的器件功能结构,称为结构体例:锁存器设计LATCHDQENALIBRARYIEEE;USEIEEE.STD_LOGIC_1164.ALL;ENTITYLatchISPORT(D:INSTD_LOGIC;ENA:INSTD_LOGIC;Q:OUTSTD_LOGIC);ENDlatch;ARCHITCTUREoneOFlatchISSIGNALsig_save:STD_LOGIC;BEGINPROCESS(D,ENA)BEGINIFENA=‘1’THENsig_save<=D;ENDIF;Q<=sig_save;ENDPROCESS;ENDone;锁存器的实体
3、,定义了此器件的输入输出引脚及其信号属性定义信号进程语句结构,描述逻辑的时序方式结构体例:全加器设计1位半加器1位全加器H_ADDERacobsoH_ADDERacobsoH_ADDERacobsoF_ADDERaincoutbinsumcinainbinainacbu1u2u3sumcoutdefLIBRARYIEEE;USEIEEE.STD_LOGIC_1164.ALL;ENTITYor2ISPORT(A,B:INSTD_LOGIC;c:OUTSTD_LOGIC);ENDor2;ARCHITECTUREfulOFor2ISBEGINc<=aORb;END
4、fu1;LIBRARYIEEE;USEIEEE.STD_LOGIC_1164.ALL;ENTITYh_adderISPORT(a,b:INSTD_LOGIC;co,so:OUTSTD_LOGIC);ENDh_adder;ARCHITECTUREfh1OFh_adderISBEGINso<=aAND(aNANDb);co<=NOT(aNANDb);ENDfh1;LIBRARYIEEE;USEIEEE.STD_LOGIC-1164.ALL;ENTITYf_adderISPORT(ain,bin,cin:INSTD_LOGIC;cout,sum:OUTSTD_LO
5、GIC);ENDf_adder;ARCHITECTUREfd1OFf_adderISBEGINCOMPONENTh_adderPORT(a,b:INSTD_LOGIC;co,so:OUTSTD_LOGIC);ENDCOMPONENT;COMPONENTor2PORT(a,b:INSTD_LOGIC;c:OUTSTD_LOGIC);ENDCOMPONENT;SIGNALd,e,f:STD_LOGIC;BEGINu1:h_adderPORTMAP(ain,bin,d,e);u2:h_adderPORTMAP(e,b,f,sum);u3:or2PORTMAP(d,
6、f,cout);ENDfd1;元件调用声明元件连接第2章VHDL语言程序的基本结构实体构造体配置包集合库VHDL语言的基本结构库及包集合LIBRARY库名；使用说明USE库名.包集合名.项目名；ENTITY实体名IS实体说明[类属参数说明]；[端口说名]；END实体名；ARCHITECTURE构造体名OF实体名IS[定义语句]内部信号,常数,数据类型,函数等的定义；构造体描述BEGIN[并行处理语句]；END构造体名；VHDL语言程序的基本结构2.1VHDL语言设计的基本单元及其构成基本单元门微处理器系统基本单元构成实体说明:规定了设计单元的输入输出接口信号
7、或引脚。构造体：定义了设计单元的具体构造和操作(行为)。多路选择器的VHDL描述例2选1多路选择器的VHDL描述2选1输入/输出端口（实体－Entity）abymux21s电路功能实现（结构体－Architecture）?例2选1多路选择器的实体描述多路选择器的VHDL描述abymux21sENTITYmux21ISPORT（a,b,:INBIT;S:INBIT;y:OUTBIT);ENDENTITYmux21;实体在电路中主要是说明该电路的输入、输出关系，更具体地说就是用来定义实体与外部的连接关系以及需传送给实体的参数。ENTITYmux21ISPORT(
8、a,b:INBIT;s:INBIT;y:OUTBIT
