计算机组成原理实验指导一

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1、实验二4位运算器设计一、实验名称：4位运算器设计二、实验学时：4学时三、实验目的：1.利用Verilog建立4位运算器模型2.对所设计的运算器进行功能验证四、实验内容：设计一个四位算术逻辑运算器电路，并测试其功能。具体要求如下：1.设计运算器，实验加减乘、逻辑与、或等功能和自行设计记录表格2.输入端的0,1可由拨码开关模拟3.输出端接Led灯显示输出数据4.观察输出结果，记录输入、输出数据。五、实验原理：1.ALU原理算术逻辑单元（Arithmetic-LogicUnit,ALU）是屮央处理器的执行单元，是所有中央处理器的核心组成部分，由〃

2、AndGate"和〃OrGate"构成的算术逻辑单元，主要功能是进行二位元的算术运算，如加减乘（不包括整数除法）。2.用拨码开关來模拟0、1输入3.led指示灯显示输出4.用按钮来模拟0、1的低位进位输入六、实验步骤：1.根据实验要求作预习报告。2.建立工程，设计程序：1）新建工程；ProjectVizard:Fabily>DeviceSetting«[pn“3of6]■rwProjectVixard:Directory,Naac^TopLevelEntity[pa<・••「X

3、M£X1KZJ73rAaodrvcewtecfed^teFft

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5、Ftl甥728728728W72872811111nM1112）新建verilogHDL文件（注

6、：文件名和模块名称要和工程名保持一致）。3）调试程序：3.配置管脚：参照实验指导中的管脚图，配置管脚。4.下载到开发板，观察实验结果，尝试创造自己的实验方案：:df

7、Progranm芒片

8、:七、实验报告要求：1.说明实验目的、原理、步骤2.实验程序及程序分析3.给出试验结果（显示的结果，如照片或计算机绘制图片）4.给出实验记录，并对记录进行分析。5.总结分析实验中所出现的问题，有何收获和体会