数字信号处理器

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1、数字信号处理器DigitalSignalProcessor第二部分TIDSP介绍纪震博士Dr.JiZhenShenzhenUniv.-TexasInstrumentsDSPsLab2003.011学习目的:了解典型的定点DSP－TMS320C54x的结构特点和组成原理2Dr.JIZHEN主要内容1．TMS320系列DSP发展概况2．C54x结构特点3．总线结构4．CPU5．存储器和寻址方式6．在片外围电路和外部总线3Dr.JIZHEN1.1三个TMS320系列DSPLowestCostControlSystemsStorageMotorControlHighestEff

2、iciencyBestMIPSper:Watt/Dollar/SizeWirelessClientsModems/TelephonyVoIPHighestPerformanceMultiChannel,MultiFunctionCommInfrastructurexDSLImaging,VideoC6000(C62x,C67x,C64x)C3xC4xC8x’C2000(C20x,C24x,C28x)C1xC2xC5000(C54x,C55x)C5x4Dr.JIZHEN1.2TMS320系列DSP的典型应用(1)5Dr.JIZHEN1.2TMS320系列DSP的典型应用（2)6D

3、r.JIZHEN1.2TMS320系列DSP的典型应用（3)7Dr.JIZHEN1.2TMS320系列DSP的典型应用（4)8Dr.JIZHEN主要内容1．TMS320系列DSP发展概况2．C54x结构特点3．总线结构4．CPU5．存储器和寻址方式6．在片外围电路和外部总线9Dr.JIZHEN2C54xDSP的主要特点围绕8条总线构成的增强型哈佛结构高度并行和带有专用硬件逻辑的CPU设计高度专业化的指令系统模块化结构设计先进的IC工艺能降低功耗和提高抗核辐射能力的新的静电设计方法10Dr.JIZHEN2.1C54xDSP主要特性----CPU先进的多总线结构(1条程序总线

4、、3条数据总线和4条地址总线)40位算术逻辑运算单元(ALU)，包括1个40位桶形移位寄存器和2个独立的40位累加器17位*17位并行乘法器，与40位专用加法器相连用于非流水线式单周期乘法/累加(MAC)运算比较、选择、存储单元(CSSU)，用于加法/比较选择指数编码器，可以在单个周期内计算40位累加器中数值的指数双地址生成器，包括8个辅助寄存器和2个辅助寄存器算术运算单元(ARAU)11Dr.JIZHEN2.2C54xDSP主要特性----存储器192K字可寻址存储空间(64K字程序存储器、64K字数据存储器以及64K字I/O空间‘C548和’C549中存储空间可扩展至8M字片内

5、ROM，可配置为程序/数据存储器双寻址在片RAM(DARAM)单寻址在片RAM(SARAM)('C548和'C549)12Dr.JIZHEN2.3C54xDSP主要特性----指令系统单指令重复和块指令重复操作块存储器传送指令32位长操作数指令同时输入2或3个操作数的指令能并行存储和并行加载的算术指令条件存储指令从中断快速返回13Dr.JIZHEN2.4C54xDSP主要特性----在片外围电路软件可编程等待状态发生器可编程分区转换逻辑电路带有内部振荡器或用外部时钟源的在片锁相环(PLL)时钟发生器全双工串行口，支持8位或16位传送(仅'C541、'LC545和'LC546)时分多

6、路(TDM)串行口(仅''C542、'C543、'C548和'C549)缓冲串行口(BSP)(仅'C542、'C543、'LC545、'LC546、'C548和'C549)16位可编程定时器8位并行主机接口(HPI)('C542、'LC545、'C548和'C549)外部总线关断控制，以断开外部的数据总线、地址总线和控制信号数据总线具有总线保持器特性14Dr.JIZHEN2.5C54xDSP主要特性----电源和在片仿真接口电源可用IDLE1、IDLE2和IDLE3指令控制功耗，以工作在省电方式CLKOUT输出信号可以关断在片仿真接口具有符合IEEE1149.1标准的在片仿真接口

7、15Dr.JIZHEN2.6C54xDSP主要特性----速度单周期定点指令的执行时间为25/20/15/12.5/10ns(40/50/66/80/100MIPS)16Dr.JIZHEN2.7TMS320C54xDSP的主要特性￥：2个标准串口；§：1个时分多路串口(TDM)和1个BSP；@：1个标准串口和1个BSP；&：1个TDM和2个BSP；17Dr.JIZHEN2.8TMS320C54xDSP的主要特性说明：1、TQFP：薄型正方形平面封装；2、BGA：球(形