DSP实验板原理图分析

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时间:2019-10-25

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1、DSP实验板原理图分析实验板原理图CPU引其将脚中C。右P上U角原部理分图为分与成I三O部图分相进连行用说的明,第一部分TPS75733(U1):电压转换,提供3.3V的数字电压信号原理图实物图引脚功能原理功能解释:EN使能端接地,IN端输入5V电压,OUT端输出3.3V电压,电容用于滤波,用于监视输出电压,当输出低电压低于门限值时产生高电平信号。与TPS76801Q使能端相连。TPS76801Q(U3):调整输出电压(1.2V~5.5V)实物图原理图引脚功能原理功能解释:IN输入3.3V电压,二极管保护.OUT端输出1.2V~5V电压,电容

2、用于滤波。通过7引脚调节输出电压,有公式因为Vref=1.1834V,由R2=30K1可算输出为1.89V.使能端正常情况下由TP75733芯片的输出PG提供低电平使能,当TP75733芯片输出电压过低时PG产生高电平从而TPS76801停止工作。PG端置空不使用检测电压功能。TPS3825(U5):加电复位,电压监测原理实物图图引脚功能TPS3825芯片没有看门狗模块.VDD输入3.3V数字电源的电压,*RESET接DSP的引脚如右图原理功能解释:刚上电后当电压升高至1.1V时(!RESET)输出低电平并延时,通过(!XPS)复位DSP,之

3、后保持高电平.在运行过程中若D3.3V输入的电压小于约2.9V时,(!RESET)再次输出低电平并延时重启DSP.同时可以通过手动按键RESET_KEY从(!MR)输入低电平,进而使(!RESET)输出低电平人为复位。1117(U13):电压转换,提供3.3V模拟电压原实物图理图典型接法原理功能解释:类似典型接法,电容滤波,输出端接出A3.3V。其他原理实物图图原理功能解释:通过电容电感连接模拟电源和数字电源,连接模拟地和数字地。原实物图理图原理功能解释:电源指示LED灯。第二部分MAX3223(U4):逻辑电平转换,实物图原理图原理功能解释

4、:RXDA/B与TXDA/B分别接dsp的相应通信接口,(!FORCEOFF)D3.3V,FORCEON接地,(!EN)接地,电源正常时正常工作,输出RS232接口的逻辑电平。SN65HVD230(U23):为实现CAN模块功能的配套CAN收发器,提供收发功能。原实物图理图引脚功能原理功能解释:与CAN功能的接插件连接,当CANH-CANL的电压差大于900mV时,R(CAN接收器)输出值为低电平,低于500mV或开路时为高电平.而D(CAN发送器)输入的值为低电平时,CANH输出高电平,CANL输出低电平,其余情况下为高阻态.MCG1286

5、4(U8):12864液晶显示屏原实物图理图原理功能解释:CSA/B片选择信号选择液晶块,GND,VCC提供逻辑地和逻辑电源,D0~7数据或指令入口,A供给LCD背光电源,G调节亮度,DI选择写入数据还是指令,RW为读写开关,E为使能。PCF8583(U10):提供时钟/日历支持,基于I2C总线原实物图理图引脚功能原理功能解释:OSCI与OSCO之间提供晶振,A0为地址输入,接高电平选中该芯片,SCL与SDA为I2C通信的时钟线和数据线,同时有3.3V的电压上拉。VSS和VDD为电源输入,!INT悬空。74LVC245(U34):双向收发转换

6、芯片,可以定义信号传递方向,同时具有电平转换的功能实物图原理图引脚功能原理功能解释:!OE接地使能,T/!R选择输入输出方向,高电平时从A传向B,低电平时从B传向A,.经接插件外部输入信号CAP1/2/3*经该芯片整形后送到DSP。McBSP配套硬件(JP14)原实物图理图原理功能解释:外部与dsp通过McBSP通信用的接插件,LED灯起指示作用。第三部分MAX5742(U9):四输出D/A转换实物图原理图原理功能解释:GPIOF14产生片选信号,由SPICLk*提供时钟,SPISIMO进行转换数据的传递,四路输出为DAOUT1~4,REF提

7、供3.3V的参考电压引脚功能24LC256(U11):基于I2C总线的EEPROM,用于存储掉电后仍需保留的信息原实物图理图引脚功能原理功能解释:不需要对芯片进行地址选择故A1~4接地,GPIOD6控制写保护,借用SPI总线接口对该芯片提供串行数据和串行时钟PWM波形发生接插件(JP5/6)原原理功能解释:PWMx向理外输出通用定时器比较输图出后的PWM波形,FAULTx经与门后控制(!T1CTRIP_PDPINTA)位使能比较输出。实物图74HC08(U6、U7):4-2输入与门原实物图理图引脚功能原理功能解释:将FOUT1~4及FOUT5

8、~8经与门输出用于PWM发生器的控制,另外让时钟信号LACK,SPICLK经一个与门延时JTAG模块接插件(JP3,JP4)实物图原理图电源供给以及部分模块的插排(

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