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1、一、数据采集卡设计的功能要求：设计一块三通道的数据采集卡，该数据采集卡可以把外部速度、加速度或压力等传感器输出的电量信号转换成电压信号，并且采集储存到相应的三片数据存储器屮，该数据采集卡留冇与PC机通信的串行接口，PC可以通过串行口把储存在数据存储器中的数据读入到PC机中。二、数据釆集卡原理设计：根据功能要求考虑数据采集卡系统设计方案，设计出系统原理图，并进行参数计算和原件器件算则，并月•说明电路的工作原理。I•数据采集卡理论定义：数据采集卡就是把模拟信号转换成数字信号的设备。II.数据采集卡数据釆集原理：利用
2、数字信号处理(DigitalSignalProcessing,简称：DSP)中，将连续信号进行采样，得到一串离散的模拟信号，经过A/D,D/A,计算机(PC机)处理，得到最终结果。举例：现在对一个模拟信号x(t)每隔△t吋间采样一次。吋间间隔△t被称为采样间隔或者采样周期。它的倒数1/At被称为采样频率，单位是采样数/每秒。t=0,△t,2△t,3At……等等，x(t)的数值就被称为采样值。所冇x(0),x(At),x(2△t)都是采样值。这样信号x(t)可以用{a(0),x(Az),.r(2A/),x(3A/
3、),…，兀伙△/),・・・}・_组分散的采样值來表示：下图显示了一个模拟信号和它采样后的采样值。采样间隔是△t,注意，采样点在时域上是分散的。图1模拟信号和采样显示如果对信号X(t)釆集N个采样点，那么x(t)就可以用下而这个数列表一%={x[O],x[l],x[2],x[3],…,x[N—1]}这个数列被称为信号x(t)的数字化显示或者采样显示。注意这个数列屮仅仅用下标变量编制索引，而不含有任何关于采样率(或at)的信息。所以如果只知道该信号的采样值，并不能知道它的采样率，缺少了时间尺度，也不可能知道信号x(
4、t)的频率。根据采样定理，最低采样频率必须是信号频率的两倍。反过來说，如杲给定了采样频率，那么能够正确显示信号而不发生畸变的最人频率叫做建超卷嫂＜它是采样频率的一半。如果信号屮包含频率高于奈奎斯特频率的成分，信号将在直流和恩奎斯特频率之间畸变。图2显示了一个信号分别用合适的采样率和过低的采样率进行采样的结果。采样率过低的结果是还原的信号的频率看上去与原始信号不同。这种信号畸变叫做麗壹(alias)。出现的旎濒漪差(aliasfrequency)是输入信号的频率和最靠近的采样率整数倍的差的绝对值。Adequate
5、lysampledsignalAliasedsignalduetoundersampling图2不同采样率的采样结果图3给出了一个例子。假设采样频率fs是100HZ,,信号屮含冇25、70、160、和510Hz的成分。25HZF270HiF3160HZFrequency庇二soNyquistFrequencygooSamptogFroouoncyF4510Hi图3说明混叠的例子采样的结果将会是低丁•奈奎斯特频率(fs/2=50Hz)的信号可以被正确采样。而频率高于50HZ的信号成分采样时会发生畸变。分别产生了3
6、0、40和10Hz的畸变频率F2、F3和F4。计算混频偏差的公式是：混频偏差=ABS(采样频率的最近整数倍一输入频率)其中ABS表示“绝对值”,例如：混频偏差F2=
7、100-70
8、=30Hz混频偏差F3=1(2)100-160
9、=40Hz混频偏差F4=1(5)100-5101=10Hz为了避免这种情况的发生，通常在信号被采集(A/D)Z前，经过一个低通滤波器，将信号中高于奈奎斯特频率的信号成分滤去。在图3的例了中，这个滤波器的截止频率自然是25HZ。这个滤波器称为抗混叠滤波器采样频率应当怎样设置呢？也许你可能会
10、首先考虑用采集卡支持的最大频率。但是，较长时间使用很高的采样率可能会导致没有足够的内存或者硕盘存储数据太慢。理论上设置釆样频率为被采集信号最高频率成分的2倍就够了，实际上工程中选用5〜10倍，有时为了较好地还原波形，甚至更高一些。通常，信号采集后都要去做适当的信号处理，例如FFT等。这里对样本数又冇一个要求，一般不能只提供-个信号周期的数据样木，希望有5〜10个周期，甚至更多的样本。并且希望所提供的样本总数是整周期个数的。这里乂发生一个困难，有时我们并不知道，或不确切知道被采信号的频率，因此不但采样率不一定是信
11、号频率的整倍数，也不能保证提供整周期数的样本。我们所有的仅仅是一个时间序列的离散的函数x(n)和采样频率。这是我们测量与分析的唯一•依据。ni.数据采集卡设计元件初始清单:序列元件名称元件个数序列元件名称元件个数1电阻165ADC0820芯片12电容14674LS373芯片13放大器3774LS139芯片1487C51单片机18DS1248Y芯片3三、数据采集卡电气CAD设计:(1)数
