实验三数码管显示

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1、实验三数码管显示一、实验目的1.掌握用verilogHDL的编程方法七段数码管显示；2.掌握七段数码管的使用；3.掌握对设计电路进行仿真。二、实验设备1.安装QuartusII软件的计算机2.SmartEDA实验箱三、实验内容PARTI:数码管显示电路（基础）1.实验原理数字钟电路的设计主要包含三个部分：1）秒信号产生；2）吋钟计数，包括分和秒的计数；3）数码管的动态显示，将分和秒同时用数码管显示出來。1）秒信号的产生整个数字钟的基准时钟为核心板上所提供的48M晶振时钟，要将其转化成为秒时钟信号，需要对其进行计数分频。2）时钟计数由秒信号作为计数时钟，完成秒和分的计

2、时。应分别由两个60进制的计数器来完成。3）数码管的动态显示要将分和秒的信息用数码管显示出来。为了完整的显示信息，至少需要4根数码管。由于4根数码管的段码是复用（共用）的，所以需要对数码管进行动态管理。即通过位码的选择，使得在某一时刻将段码用于某根数码管,另一时刻则将段码用于另一根数码管，经过一段时间后再重复刚才的步骤。则只要位码的切换速度足够快，由于人眼的视觉停留效应，和关的数码管在感觉上都是一直处于显示状态。2.实验程序a）秒信号的产生PROCESS（clk_48M）BEGINIFRISING_EDGE（clk_48M）THENIFcount=THEN-24M-

3、0.5S到了吗count<=Bn0_0000_0000_0000_0000_0000_0000,，r-清零sec<=;-置位秒标志ELSEcount<=count+l;ENDIF;ENDIF;ENDPROCESS;b)时钟计数PROCESS(sec)BEGINIFfalling_EDGE(sec)THENhour(3downto0)=;一秒加1IFhour(3DOWNTO0)=XHanTHENhour(3DOWNTO0)<=;hour(7DOWNTO4)<=;••秒的十位加一IFhour(7DOWNTO4)=THENhour(7DOWNTO4)<=;hour(llD

4、OWNTO8)<=hour(11DOWNTO8)+XT”；■■分个位加一IFhour(llDOWNTO8)=THENhour(llDOWNTO8)<=XH0H;hour(15DOWNTO12)<=hour(15DOWNTO12)+XT”;-分十位加一IFhour(15DOWNTO12)=X”5”THENhour(15DOWNTO12)<=”；ENDIF;ENDIF;ENDIF;ENDIF;ENDIF;ENDPROCESS;c)数码管的动态显示〃数码管动态扫描显示部分PROCESS(clk_48M)BEGINIFRISING_EDGE(clk_48M)THENCASE

5、count(17DOWNTO15)IS—选择数据扫描的快慢WHEN”000”=>disp_dat<=;一秒个位WHEN”001”=>disp_dat<=；••秒十位WHEN”010”二〉disp_dat<=XnaH;••显示”•”WHEN”011”二〉disp_dat<=;一分个位WHEN”100”=>disp_dat<=；一分十位WHENT01”=>disp_dat<=XHaM;一显示”■”WHENT10”=>disp_dat<=hour(19DOWNTO16);-时个位WHEN”111”二〉disp_dat<=hour(23DOWNTO20);••时十位ENDC

6、ASE;CASEcount(17DOWNTO15)IS—选择数据扫描的快慢WHEN”000”=>dig_r<=;••选择第一个数码管显示WHEN”001”=>dig_r<=;••选择第二个数码管显示WHEN"010n=>dig_r<=;一选择第三个数码管显示WHENn011H=>dig_r<=;—选择第四个数码管显示WHENT00”=>dig_r<=;••选择第五个数码管显示WHEN”10I”=>dig_r<=;••选择第六个数码管显示WHEN”110”二〉dig_r<=;一选择第七个数码管显示WHENdig_r<=；―选择第八个数码管显示ENDCASE;ENDIF

7、;ENDPROCESS;PROCESS(clk_48M)BEGINIFRISING_EDGE(clk_48M)THENCASEdisp_datISseg_r<=XHcOn;一显示0WHEN”0000”二〉WHEN”0001”=>seg_r<=Xnf9n;―显示1WHENn0010n=>seg_r<=XHa4n;一显小2WHEN”0011”=>seg」v=X”bO”；■■显示3WHEN”0100”二>seg_r<=XH99u;■■显不4WHEN”0101”二〉seg_r<=XH92H;—显示5WHENH0110n=>seg_r<=XH82n;—.MR/Js6WHE