电子电工类高考综合模拟试卷三

电子电工类高考综合模拟试卷三

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1、电子电工类高考综合模拟试卷三姓名计分一、填空题(每格6分,共60分)1、如题1图所示电路屮,Rab=1―f5Q15Q15QI3•题2图IiO2、电路如题2图所示,Ii=2A,I2二3A,则h二Ao3、有一交流电压u=100V2sin(314t+30o)V,加在一容抗Xc=50Q的理想电容两端,这时电路中的电流i二o4、在如图所示电路中,已知R1二6Q,R2二3Q,B=6T,长为lm的导体AB(r=2Q),以4m/s的速度向右进行无摩擦的滑动,则导体A,B的电流为AoR1图4图9十°U5、逻辑函数I=AB+AB+AD+AC的最简与或式为C2题10图6、十进制数(30)

2、转换成十六进制数为o7、在F二AB+C的真值表中,F二1的状态有个。8、译码是编码的逆过程,4个输入信号的译码器可表示种信号。图2A.3inAB.4mAC.一3mAD.——4niA图310、如题10图所示,C.=2C2,则C】、C2所带电荷量Qi、Q2关系o二、单项选择题(每小题6分,共120分)1、把下图1所示的电路用下图2所示的等效电压源代替,该等效电压源的参数为()。A.E。二IV,R。二2QB.E0=2V,R。二2QC.E。二2V,Ro二0.5QD.E0=lv,Ro二0.5Q2、在题3图电路中,已知:E=9V,h二6mA,当电压源E单独作用时,通过比的电流是

3、1mA,那么当电压源E和电流源h共同作用时,通过电阻R.的电流・是()03、已知单相交流电路中某负载无功功率为3kVar,有功功率为4kW,则其视在功率为()。A.kVAB.7kVAC.5kVAD.OkVA4、电路如题4图所示,设各电流表内阻为零。若电流表A的读数为3A,电流表九的读数为4图1A,则电流表A?的读数是(A.2AB.诩AC・3AD.-AOA5、对于理想变压器来说,下面叙述中正确的是()A.变压器可以改变各种电源电压B.变压器不仅能改变电压,还能改变电流和功率C.变压器一次绕组的输入功率由二次绕组的输出功率决定D.除去变压器的铁心,互感现象依然存在,变压

4、器仍然能正常工作。6、某交流电路中,电感L与电阻R串联,己知感抗Xl=7.07Q,电阻R二7.07Q,则其串联等效阻抗口

5、为()oC.7.07QD.0Q7、欲测单相桥式整流电路的输入电压匕及输出电压U。,应采用的方法是()A.用直流电压表分别测匕及U。B.用直流电压表测匕,用交流电压表测U°C.用交流电压表分别测匕及U。D.用交流电压表测6,用直流电压表测U°8、共发射极分压偏置放大电路中,选用B值较大晶体管的目的是()A.提高放大电路的电压放大倍数B.减轻信号源的负担C.增强放大电路带动负载的能力D.稳定放大电路的输出电流9、希望向前级或信号源索取的电流小,可选用

6、()A.共射接法B.共集接法C.共基接法10、带放大环节的串联型稳压电路中,被放大的量是(A.基准电压B.输出采样电压C.输入采样11、在甲乙类互补对称功放电路中,设电源电压为正负14V,大输出功率Pg为()A.1.8WB.4W12、在附图5所示理想运算放大电路中,3V的是()A.U,U2C・U3D.U4C.9WR尸lkQ,RE=3kQ,严Uit卜R1R2U4F-uo+TC1UID.任何接法)D.误差电压负载电阻Ri二8Q,Uces-2V,则最D.12.25W从二IV,贝6、匕、山、匕中为RblRb2ReT+VCC

7、RcC2RLUO附图5附图613、如附图6所示电路

8、,已知VCC=1OV,Rbl=4K,Rb2=6K,R(:二2K,RE=3.3K,RL=2K,电容G、G、Ce足够大。若保持P=50不变,将R卜:由3.3K改为6.6K,则电压放大倍数A(为()A.约为原来的2倍C.约为原来的4倍14、NPN型晶体管放大电路中,失真的原因是()A.静态工作点太低,h的负半周进入截止区.B.静态工作点太高,h的正半周进入截止区.B.约为原来的1/2倍D.基本不变当输入交流正弦波时,输岀电压波形岀现顶部失真,则引起A.l/4f2B.l/2f2C.2f2D.4f2Q2A.静态工作点太高,ib的正半周进入饱和区.B.与静态工作点无关,只是耦合

9、电容的故障.15、附图7所示电路,以下说明正确的是()A•该电路可以产生正弦波振荡;B•该电路不能产生正弦波振荡,原因在于振幅平衡条件不满足;C•该电路不能产生正弦波振荡,原因在于相位平衡条件不满足;D•该电路不能产生正弦波振荡,原因在于振幅平衡、相位平衡条件均不满足;16、逻辑电路如图所示,已知Q端输出脉冲的频率为f2,则输入时钟脉冲CP的频率为()17、单稳态触发器输出脉冲的宽度tp取决于()。A.电路的定时元件B.触发脉冲的宽度C.触发脉冲的幅度D.触发脉冲的重复周期18、四位移位寄存器可以寄存四位数码,若将这些数码全部从串行输出端输出,需经过的时钟周期是

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