EDA技术实用教程第4章PPT课件

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1、FPGA技术第4章VHDL设计初步4.1多路选择器的VHDL描述4.1.12选1多路选择器的VHDL描述图4-1mux21a实体4.1多路选择器的VHDL描述4.1.12选1多路选择器的VHDL描述图4-2mux21a结构体4.1多路选择器的VHDL描述4.1.12选1多路选择器的VHDL描述LIBRARYIEEE;USEIEEE.STD_LOGIC_1164.ALL;ENTITYmux21aISPORT(a,b:INBIT;s:INBIT;y:OUTBIT);ENDENTITYmux21a;ARCHITECTUREoneOFmux21aIS

2、BEGINy<=aWHENs='0'ELSEb;ENDARCHITECTUREone;IEEE库使用说明器件mux21外部接口信号说明，PORT相当于器件引脚，此为实体器件mux21内部工作逻辑描述，即为实体描述的器件功能结构，称为结构体【例4-1】2021/9/7第2章5(1)库(LIBRARY)：包含了描述器件的输入、输出端口数据类型中将要用到的IEEE的标准库中的STD_LOGIC_1164程序包。(2)实体(ENTITY)：电路意义相当于器件，在电路原理图上相当于元件符号。实体是一个完整的、独立的语言模块，它描述了mux21接口信息，

3、定义了mux2l端口引脚的输入输出性质和数据类型。PORT所描述的就相当于电路器件的外部引脚，对端口引脚作了信号流向的方向说明，同时指明了端口的数据类型。(3)结构体(ARCHITECTURE)：描述mux21内部的逻辑功能，在电路上相当于器件的内部电路结构。“Y<=a”表示将a获得的信号赋给(传入)y输出端，这是一个单向过程。选择器逻辑功能的VHDL描述使用了三个层次：4.1多路选择器的VHDL描述4.1.12选1多路选择器的VHDL描述【例4-3】ENTITYmux21aISPORT(a,b,s:INBIT;y:OUTBIT);ENDEN

4、TITYmux21a;ARCHITECTUREoneOFmux21aISBEGINPROCESS(a,b,s)BEGINIFs='0'THENy<=a;ELSEy<=b;ENDIF;ENDPROCESS;ENDARCHITECTUREone;4.1多路选择器的VHDL描述4.1.12选1多路选择器的VHDL描述图4-3mux21a功能时序波形4.1多路选择器的VHDL描述4.1.2相关语句结构和语法说明【例4-4】ENTITYe_nameISPORT(p_name:port_mdata_type;...p_namei:port_midata_

5、type);ENDENTITYe_name;1.实体表达2.实体名3.端口语句和端口信号名4.1多路选择器的VHDL描述4.1.2相关语句结构和语法说明4.端口模式IN输入端口，定义的通道为单向只读模式OUT输出端口，定义的通道为单向输出模式INOUT定义的通道确定为输入输出双向端口BUFFER缓冲端口，其功能与INOUT类似4.1多路选择器的VHDL描述4.1.2相关语句结构和语法说明5.数据类型6.结构体表达【例4-5】ARCHITECTUREarch_nameOFe_nameIS[说明语句]BEGIN(功能描述语句)ENDARCHITE

6、CTUREarch_name；4.1多路选择器的VHDL描述4.1.2相关语句结构和语法说明7.赋值符号和数据比较符号赋值符“<=”表式中的等号“=”没有赋值的含义，只是一种数据比较符号。IFaTHEN...--注意，a的数据类型必须是booleanIF(s1='0')AND(s2='1')OR(c

7、法说明10.WHEN_ELSE条件信号赋值语句赋值目标<=表达式WHEN赋值条件ELSE表达式WHEN赋值条件ELSE...表达式；z<=aWHENp1='1'ELSEbWHENp2='1'ELSEc;4.1多路选择器的VHDL描述4.1.2相关语句结构和语法说明11.进程语句和顺序语句在一个结构体中可以包含任意个进程语句结构，所有的进程语句都是并行语句，而由任一进程PROCESS引导的语句（包含在其中的语句）结构属于顺序语句。12.文件取名和存盘4.2寄存器描述及其VHDL语言现象4.2.1D触发器的VHDL描述KX康芯科技【例4-6】LI

8、BRARYIEEE;USEIEEE.STD_LOGIC_1164.ALL;ENTITYDFF1ISPORT(CLK:INSTD_LOGIC;D:INSTD_LOGI