微机原理总复习湖北文理学院

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1、微机原理总复习考试题型及分值分布一、选择（20分，单选和多选都有，多选不超过2个，多选题错选，漏选，多选均不得分）二、填空（15分）三、判断改错（20分）四、读图回答（5分）五、简答（20分）六、程序设计（20分）冯·诺依曼计算机结构和冯·诺依曼(a)运算器内存储器控制器外存储器输入设备输出设备主机(b)冯·诺伊曼计算机结构计算机应由运算器、控制器、存储器、输入设备和输出设备五个部分组成；数据和程序均以二进制代码形式不加区别地存放在存储器中，存放的位置由存储器的地址指定；计算机在工作时能够自动地从存储器中取出指令加以执行。（3）总线总线(Bus)，是计算机部件与部件之间进行数据信息传输的一组

2、公共信号线及相关的控制逻辑。它是一组能为计算机的多个部件服务的公共信息传输通路，能分时地发送与接收各部件的信息。总线属于微型计算机的重要组成部件之一。微处理器、主存储器和I/O接口之间通过地址总线、数据总线和控制总线三组总线相连。通常将这三组总线统称为系统总线(SystemBus)。数据总线用来传送数据信息(包括二进制代码形式的指令)。从传输方向看，数据总线是双向的，通常它和微处理器本身的位数(即字长)相一致。地址总线用来传送地址信息。地址总线是单向的，地址总线的位数决定微处理器可以直接访问的主存或I/O接口的地址范围。控制总线用来传送控制信息。CPU的典型结构1.运算器实现算术运算和逻辑运

3、算功能。它以算术逻辑部件(ALU)为核心，还包括累加器(Accumulator)A、程序状态标志寄存器(FlagRegister)F及暂存器等。ALU用来完成二进制数的算术运算和逻辑运算，累加器A是CPU中工作最频繁的寄存器。在进行算术、逻辑运算时，累加器A往往在运算前暂存一个操作数(如被加数)，而运算后又保存其结果(如代数和)；也用于CPU与存储器和输入/输出接口电路间的数据传送。标志寄存器F用来存放运算结果的一些特征。暂存器用来暂时存放操作数。2.控制器控制器是指挥和控制计算机各部件协调动作的功能部件。它从存储器中逐条取出指令，并产生各种控制信号指挥整个计算机有条不紊地工作。同时控制器还

4、要接收输入/输出(I/O)设备的请求信号以及运算器操作状况的反馈信息，以决定下一步的工作任务。控制器主要由定时控制逻辑电路、指令寄存器IR)、指令译码器(ID)组成。IR存放当前正在执行的指令代码；ID对指令代码进行分析、译码，根据指令译码的结果，输出相应的控制信号；定时控制逻辑电路产生出各种操作电位、不同节拍的信号、时序脉冲等执行此条命令所需的全部控制信号。实现控制指令的执行。为了让各种操作能按照一定的时间关系有序地进行，计算机内设有一套时序信号，给出时间标志。计算机的各个功能部件按照统一的时钟或节拍信号，一个节拍一个节拍地快速而有秩序地完成各种操作任务。通常将一条指令的整个执行时间定义为

5、一个指令周期(InstructionCycle)；每个指令周期再划分为几个机器周期(MachineCycle)；每个机器周期又分为几个时钟周期。时钟周期是机器操作的最小时间单位，它由机器的主频来决定。指令周期、总线（机器）周期、时钟周期总线控制逻辑ALU数据总线(16位)指令执行部件(EU)图2-18086/8088CPU内部功能结构图数据总线20位地址总线地址加法器CSDSESSSIP内部暂存寄存器ALU标志寄存器(FR)暂存寄存器队列总线8位8088：8位8086：16位段寄存器SPBPDISIAHALAX通用寄存器BHBLBXCHCLCXDHDLDX总线接口部件(BIU)EU控制单元指

6、令队列808880861654328086/8088CPU的内部结构包含两大部分：指令执行单元(EU)和总线口单元(BIU)EU从BIU的指令队列中取出指令，执行指令BIU完成取指令，读操作数，送结果，所有与外部的操作由其完成BIU和EU的操作是并行的。若需要访问内存或I/O端口，则由EU向BIU发出访问所需要的地址，在BIU中形成物理地址，然后访问内存或I/O端口，得到操作数后送到EU，或将结果到送指定的内存单元或I/O端口。这种并行工作方式，大大提高了系统工作效率。总线接口部件BIUBIU具有地址形成、取指令、指令排队、读/写操作数和总线控制的功能，它是CPU与外部(内存和I/O端口)的

7、接口，它提供了16位双向数据总线和20位地址总线，完成所有外部总线操作。它由4个16位段寄存器、16位指令指针IP和内部暂存器、6字节(8088为4字节)指令队列缓存器、20位地址加法器以及总线控制逻辑部件等组成。段寄存器。指令指针。地址加法器。指令队列缓存器。总线控制逻辑。指令执行部件EUEU完成指令译码和执行指令的工作。EU从BIU的指令队列中取得指令，并在ALU上执行指令；然后，将处理的结果送回BIU，