《DSP综合实验箱》PPT课件

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1、Dr.ZhangJianpingShanghaiUniversityofElectricPowerShanghai,2000902009.5基于DSP的数字信号处理实验指导教程3.1实验系统结构3.2系统硬件模块3.3硬件仿真系统3.3.1仿真器的安装3.3.2仿真器的使用内容提要基于DSP的数字信号处理实验指导教程3.1实验系统结构基于DSP的数字信号处理实验指导教程EL-DSP-EXPII教学实验系统其硬件资源主要包括：1、CPU单元；2、数字量输入输出单元；3、静态存储器单元；4、BOOTLOADER单元；5、语音模

2、块；6、液晶模块；7、CPLD接口；3.2系统硬件模块8、A/D转换单元；9、D/A转换单元；10、信号源单元；11、温控单元；12、步进电机；13、直流电机单元；14、键盘接口；15、其他接口说明。基于DSP的数字信号处理实验指导教程3.2系统硬件模块1、CPU单元CPU单元包括CPU1、CPU2两块可以更换的CPU板，用户可根据需要选择不同种类的CPU板。板上除CPU之外还包括以下四个单元：（1）CPU模式选择；（2）电源模块；（3）电平转换；（4）复位电路以及时钟单元。基于DSP的数字信号处理实验指导教程3.2系统硬

3、件模块2、数字量输入输出单元（1）8bit的数字量输入(由八个带自锁的开关产生)，通过74LS244缓冲；8bit的数字量输出(通过八个LED灯显示)，通过74LS273锁存。输入输出都映射到CPU的IO空间；（2）数字量显示的八个LED数码管，通过HD7279控制。基于DSP的数字信号处理实验指导教程3.2系统硬件模块3、静态存储器单元在该实验板上，使用的存储器接口芯片是ISSI公司的IS61C256，它具有以下特点：★访问速度10、12、15、20、25ns可选★低功耗：400mW(典型)★低静态功耗：-250μW(典

4、型)CMOS及-55mW(典型)TTL器件★全静态操作，无需时钟或刷新★输入输出和TTL电平兼容基于DSP的数字信号处理实验指导教程3.2系统硬件模块4、BOOTLOADER单元使用的存储器接口芯片是28C25632K×8bit，地址为数据空间8000H～0FFFFH。板上芯片序号U24用来存放用户程序，可以通过选择CPU板上来选择bootloader模式。出厂时存储器内固化了系统测试程序，上电后可对系统硬件进行自动测试。在本系统中采用并行存储器引导模式。基于DSP的数字信号处理实验指导教程3.2系统硬件模块5、语音处理单

5、元音频信号通过D/A转换后输出，由于TLC320AD50输出的是差动信号，因此首先经过差动放大，然后可以推动功率为0.4W的板载扬声器，也可以接耳机输出。基于DSP的数字信号处理实验指导教程3.2系统硬件模块5、语音处理单元语音处理单元原理框图基于DSP的数字信号处理实验指导教程3.2系统硬件模块6、液晶模块本实验系统选用中文液晶显示模块LCM12864ZK，其字型ROM内含8192个16*16点中文字型和128个16*8半宽的字母符号字型；另外绘图显示画面提供一个64*256点的绘图区域GDRAM；而且内含CGRAM提供

6、4组软件可编程的16*16点阵造字功能。基于DSP的数字信号处理实验指导教程3.2系统硬件模块跳线JS1的配置示意图6、液晶模块基于DSP的数字信号处理实验指导教程3.2系统硬件模块7、CPLD接口采用XILINX公司的XC95144XL芯片，完成译码和时序控制。JTAG4为CPLD下载接口，其定义说明由表3-7给出。可用XILINX公司的软件，通过并口下载电缆对CPLD在线编程。其中，D2、D3为CPLD工作指示灯，正常工作时D2、D3点亮。CPU1复位时，D3不亮，CPU2复位时，D2不亮。基于DSP的数字信号处理实验

7、指导教程3.2系统硬件模块JTAG4CPLD下载接口定义JTAG1引脚序号JTAG功能组相关说明1TCK时钟2NC空脚3TMS模式控制4GND地5TDI数据输入6NC空脚7TDO数据输出8GND地9+5V电源10+5V电源基于DSP的数字信号处理实验指导教程3.2系统硬件模块8、D/A转换单元数模转换采用DAC08芯片，分辨率8位，精度1LSB，转换时间可达85ns，D/A单元原理框图如图3-6所示，其中，底板DAC08参考电压Vref=+5V；输入00h，输出电压-5V；输入ffh，输出电压+5V。DAC08可以应用在8

8、-bit,1usA/D变换，伺服电机、波形发生、语音编码、衰减器、可编程功率变换器、CRT显示驱动、高速modems以及其他要求低成本、高速等多功能场合。在本实验系统中，DAC08采用对称偏移二进制输出方式，其编码图由表3-8给出(注：Vref=+10V)，输出电压范围-5V~+5V。基于DSP的数字信