复杂可编程逻辑器件CPL

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1、一、复杂可编程逻辑器件CPLDComplexProgrammableLogicDevice1.PLD器件简介由大量（高至几百万个）独立的与门阵列、或门阵列、触发器和可配置的连线构成的单片通用CMOS大规模集成电路。根据所要求的特定功能，通过编程选择内部器件并连线特定功能的专用芯片使用方法：CPLD（复杂可编程逻辑器件）：FPGA（现场可编程门阵列）：PLD分类有大量触发器，更易设计时序电路。编程数据只需通过简单设备即可下载到芯片中，实现现场编程功能。大量门电路，更易设计组合电路。编程数据通过计算机下载到芯片中。在系统编程芯片，可在电路板上直接对芯片编程。PLD优点高集成度、高可靠性：

2、可将整个系统集成于同一芯片中，实现所谓片上系统。通用芯片有固定逻辑功能，其构成的电路技术很难保护。专用芯片是电路设计者自己制造出来的，而且很容易设置保密位，从而形成电路设计者自己的知识产权。2.EPM7128SLC84器件介绍EPM7128S器件系列是美国ALTERA公司生产的在系统可编程CPLD器件。在实验中使用该器件是很方便的。其优点是可以反复编程，能多达百余次，而且不必拆下芯片就可以直接在电路板上编程。EPM7128SLC84－67000系列产品有128个逻辑宏单元在线可编程器件塑封包装84个外端子全局时钟到输出端的时延为6ns每个宏单元包含：一个可编程的“与”阵列和固定的“或

3、”阵列以及一个触发器111098765432184838281807978777675333435363738394041424344454647484950515253ALTERAMAXEPM7128SLC84VCCINTGND121314151617181920212223242526272829303132747372717069686766656463626160595857565554I/O.TDII/O.TMSVCCINTGNDGNDVCCIOVCCIOGNDVCCIOGNDVCCIOVCCIOGNDGNDVCCIOGNDI/O.TD0I/O.TKINPUT/GCLRnI

4、NPUT/OE2/GCLK2INPUT/GCLK1INPUT/OE116个电源和地脚：（同名端内部均连通）6个VCCI0：I/O输出电路电源，接5V或3.3V2个VCCINT：内部电路和输入缓冲器电源，接5V8个接地端下载板中正电源统一都为＋5V，由实验箱提供，并与实验箱共地。111098765432184838281807978777675333435363738394041424344454647484950515253ALTERAMAXEPM7128SLC84VCCINTGND121314151617181920212223242526272829303132747372717

5、069686766656463626160595857565554I/O.TDII/O.TMSVCCINTGNDGNDVCCIOVCCIOGNDVCCIOGNDVCCIOVCCIOGNDGNDVCCIOGNDI/O.TD0I/O.TKINPUT/GCLRnINPUT/OE2/GCLK2INPUT/GCLK1INPUT/OE11脚：全局清零端2、83脚：2个全局时钟输入端对于时序电路：4个专用输入端获得最高的工作速度专用输入脚，不用时不允许悬空，防止CMOS器件输入击穿损坏。11109876543218483828180797877767533343536373839404142434

6、4454647484950515253ALTERAMAXEPM7128SLC84VCCINTGND121314151617181920212223242526272829303132747372717069686766656463626160595857565554I/O.TDII/O.TMSVCCINTGNDGNDVCCIOVCCIOGNDVCCIOGNDVCCIOVCCIOGNDGNDVCCIOGNDI/O.TD0I/O.TKINPUT/GCLRnINPUT/OE2/GCLK2INPUT/GCLK1INPUT/OE1CPU编程数据通过此端口下载到CPLD中的被编程置为输入的引脚，

7、不用时不允许悬空，防止CMOS器件输入击穿损坏。被编程置为输出的引脚不能接VCC或地。4个在系统编程专用输入、输出端口60个供用户的普通I/O引脚3.CPLD下载板介绍数字电路实验箱并行输出口+5V地下载接口入/出端口50M连续脉冲入/出端口入/出端口位驱动电路共阳型段驱动信号a～h位驱动信号CS1～CS4GLCKGOEGCLR单脉冲复位输出使能数据开关LED灯218483CPLD芯片4568910118176777980共16个管脚已被定义占用二、CPL