上下拉电阻耦合电容注意点

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1、上拉电阻，下拉电阻，耦合电容，退耦电容的总结（ZT）上拉电阻：1、当TTL电路驱动COMS电路时，如果TTL电路输出的高电平低于COMS电路的最低高电平（一般为3.5V），这时就需要在TTL的输出端接上拉电阻，以提高输出高电平的值。2、OC门电路必须加上拉电阻，才能使用。3、为加大输出引脚的驱动能力，有的单片机管脚上也常使用上拉电阻。4、在COMS芯片上，为了防止静电造成损坏，不用的管脚不能悬空，一般接上拉电阻产生降低输入阻抗，提供泄荷通路。5、芯片的管脚加上拉电阻来提高输出电平，从而提高芯片输入信号的噪声容限增强抗干扰能力。6、提高总线的抗电磁干扰能力。管脚悬空就比

2、较容易接受外界的电磁干扰。7、长线传输中电阻不匹配容易引起反射波干扰，加上下拉电阻是电阻匹配，有效的抑制反射波干扰。上拉电阻阻值的选择原则包括:1、从节约功耗及芯片的灌电流能力考虑应当足够大；电阻大，电流小。功耗？？？2、从确保足够的驱动电流考虑应当足够小；电阻小，电流大。3、对于高速电路，过大的上拉电阻可能边沿变平缓。综合考虑以上三点,通常在1k到10k之间选取。对下拉电阻也有类似道理对上拉电阻和下拉电阻的选择应结合开关管特性和下级电路的输入特性进行设定，主要需要考虑以下几个因素：1．驱动能力与功耗的平衡。以上拉电阻为例，一般地说，上拉电阻越小，驱动能力越强，？？？

3、但功耗越大，设计是应注意两者之间的均衡。2．下级电路的驱动需求。同样以上拉电阻为例，当输出高电平时，开关管断开，上拉电阻应适当选择以能够向下级电路提供足够的电流。3．高低电平的设定。不同电路的高低电平的门槛电平会有不同，电阻应适当设定以确保能输出正确的电平。以上拉电阻为例，当输出低电平时，开关管导通，上拉电阻和开关管导通电阻分压值应确保在零电平门槛之下。4．频率特性。以上拉电阻为例，上拉电阻和开关管漏源级之间的电容和下级电路之间的输入电容会形成RC延迟，电阻越大，延迟越大。上拉电阻的设定应考虑电路在这方面的需求。下拉电阻的设定的原则和上拉电阻是一样的。OC门输出高电平

4、时是一个高阻态，其上拉电流要由上拉电阻来提供，设输入端每端口不大于100uA,设输出口驱动电流约500uA，标准工作电压是5V，输入口的高低电平门限为0.8V(低于此值为低电平)；2V(高电平门限值)。选上拉电阻时：500uAx8.4K=4.2即选大于8.4K时输出端能下拉至0.8V以下，此为最小阻值，再小就拉不下来了。如果输出口驱动电流较大，则阻值可减小，保证下拉时能低于0.8V即可。当输出高电平时，忽略管子的漏电流，两输入口需200uA200uAx15K=3V即上拉电阻压降为3V，输出口可达到2V，此阻值为最大阻值，再大就拉不到2V了。选10K可用。COMS门的可

5、参考74HC系列设计时管子的漏电流不可忽略，IO口实际电流在不同电平下也是不同的，上述仅仅是原理，一句话概括为：输出高电平时要喂饱后面的输入口，输出低电平不要把输出口喂撑了（否则多余的电流喂给了级联的输入口，高于低电平门限值就不可靠了）别的地方看到的和大家分享，大家觉得好的话请帮顶一下！谢谢了！扫盲知识持续更新帖~~~~~~~~~~~~~~~~~~~~~~~~~~什么是耦合电容？什么是去耦电路？耦合指信号由第一级向第二级传递的过程，一般不加注明时往往是指交流耦合。退耦是指对电源采取进一步的滤波措施，去除两级间信号通过电源互相干扰的影响。耦合常数是指耦合电容值与第二级输

6、入阻抗值乘积对应的时间常数。退耦有三个目的：1.将电源中的高频纹波去除，将多级放大器的高频信号通过电源相互串扰的通路切断。2.大信号工作时，电路对电源需求加大，引起电源波动，通过退耦降低大信号时电源波动对输入级/高电压增益级的影响；3.形成悬浮地或是悬浮电源，在复杂的系统中完成各部分地线或是电源的协调匹有源器件在开关时产生的高频开关噪声将沿着电源线传播。去耦电容的主要功能就是提供一个局部的直流电源给有源器件，以减少开关噪声在板上的传播和将噪声引导到地。 摘引自伦德全《电路板级的电磁兼容设计》一文，该论文对噪声耦和路径、去耦电容和旁路电容的使用都讲得不错。请参阅。干扰的

7、耦合方式干扰源产生的干扰信号是通过一定的耦合通道对电控系统发生电磁干扰作用的。干扰的耦合方式无非是通过导线、空间、公共线等作用在电控系统上。分析下来主要有以下几种。直接耦合：这是干扰侵入最直接的方式，也是系统中存在最普遍的一种方式。如干扰信号通过导线直接侵入系统而造成对系统的干扰。对这种耦合方式，可采用滤波去耦的方法有效地抑制电磁干扰信号的传入。公共阻抗耦合：这也是常见的一种耦合方式。常发生在两个电路的电流有共同通路的情况。公共阻抗耦合有公共地和电源阻抗两种。防止这种耦合应使耦合阻抗趋近于零、使干扰源和被干扰对象间没有公共阻抗。电容耦合：又称电场耦合