6.5 计数器&定时器8253

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1、6.56.5计数计数//定时器定时器定时信号的获得方式¢软件定时方式¢CPU干预¢指令执行时间作间隔¢硬件定时方式¢不可编程的硬件定时方式¢方式固定¢硬件设定参数¢可编程的硬件定时方式¢程序设定、程序控制¢中断定时定时//计数作用计数作用——可编程计数器/定时器的功能主要体现在计数和定时两方面——基于计数器的减1工作计数器模式：减到终值时输出一个信号，计数过程结束。周期性或非周期性定时器模式：减到终值时又自动装入初值，重新作减1计数，于是输出端会不间断地产生为时钟周期整数倍地定时间隔。周期性在多

2、任务分时系统中作为中断信号实现程序的切换可以往I/O设备输出精确的定时信号作为一个可编程的波特率发生器实现时间延迟……典型计数器典型计数器//定时器的原理定时器的原理数据初始值寄存器、控控制寄存器时钟制寄存器分别对应两RDCLKWR个输出端口。初始值寄存器RESETREADY计数输出寄存器和状态寄存器对应两个计数器计数器输入端口。由设备来GATE译码CS门脉冲输入输出的概念都A1是从CPU角度而言。A计数输出寄存器0往设备去状态寄存器OUT计数器不直接和中断请求CPU联系。工作模式工作模式门脉冲

3、控制时钟输入门脉冲到来时时钟有效；门脉冲结束时时钟无效。门脉冲重新启动计数门脉冲停止计数原来不停计数，当门脉冲到来时计数停止，OUT高电平。单一计数要求定时的时间循环计数计数值n=时钟脉冲的周期82538253工作原理工作原理——8253可编程CLK0计数/定时控制器D~D数据总线通道70GATE缓冲器00OUT具有三个独立的0通道，最高计数RD读/写CLK1率为2.6MHz。WR通道A控制电路1GATE10AOUT11CS——8253芯片控制字CLK2有24条引脚，通道寄存器2GATE2OUT

4、2封装在双列直插式陶瓷管壳内。8253的引脚及其功能∑数据总线缓冲器数据总线缓冲器D7~D0¾8位三态双向D7124VccD6223WRD5322RD∑读读//写控制逻辑写控制逻辑D4421CSD3520A1¾CS：片选信号低电平有效D26825319A0D1718CLK2D0817OUT2¾RD：读信号低电平有效CLK0916GATE2OUT01015CLK1¾WR：写信号低电平有效GATE01114OUT1GND1213GATE1¾A1A0：端口选择信号原理说明（原理说明（11））数据总线缓

5、冲器——8253与CPU之间的数据接口，由8位双向三态缓冲器构成。读/写控制电路——接收CPU送入的读/写控制信号，并完成对芯片内部各功能部件的控制功能，是8253的内部控制器。CSRDWRA1A0功能端口地址分配及功能01000写计数器001001写计数器101010写计数器201011写控制字寄存器00100读计数器000101读计数器100110读计数器200111无操作1XXXX禁止使用011XX无操作原理说明（原理说明（22））每个通道内部有一个16位计数器，可进行二进制或十进制（BC

6、D码）计数，减计数，最大计数值为0。每个通道内设有一个16位计数值锁存器。要求计数的次数值应预置到该通道的计数器中，被计数的事件应以脉冲方式从CLK端输入，每输入一个时钟脉冲，计数器内容减“1”，当计数值到i“0”，OUT端将输出，表示计数次数已到。i当某通道作定时器时，由CLK输入一定频率的时钟脉冲（1~2MHz范i围），根据要求定时的长短确定所需的计数值（定时系数），预置到计数器中，每输入一个脉冲，计数器内容减“1”，当计数值到“0”，OUT端将输出，i表示定时时间已到。要求定时的时间计数值

7、n=时钟脉冲的周期82538253编程结构编程结构控制寄存器(8位)VCCGND计数器0数据总线计数初值寄存器CR(16位)CLK0D7~D0GATE0OUTRD0RD计数执行部件CE(16位)WRWRREADY输出锁存器OL(16位)IO/M计数器1译码CSA1A计数器20控制寄存器控制寄存器DDDDDDDD76543210SCSCRWRWMMMBCD1010210SCSC选择计数器1000计数器0计数值格式1：BCD码格式01计数器10：二进制格式10计数器211无意义MMM模式选择210R

8、WRW读写指示10001模式000计数器锁存操作001模式101只读写低8位字节x10模式210只读写高8位字节x11模式311先读写低8位，后100模式4读写高8位字节101模式5初始化编程先写入控制字，再写入计数初值先写入控制字，再写入计数初值¢写入控制字即：指定计数器通道规定计数器工作方式规定计数器计数格式规定写计数器的方式（如是16位计数，则先低字节，后高字节）¢写入计数器初值初值可以是8位，一次写入也可以是16位，分二次写入82538253工作模式工作模式控制字写入计数器时，所有控制逻