数字电子技术基础试卷A(电气工程和其自动化)

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1、卷号：（A）　　　（2008年6月）　湖北师范学院本科期末考试试卷数字电子技术基础考试范围全部章节命题人皮大能院系控制科学及工程系考试形式闭卷课程类别必修学期20081专业电气工程及其自动化大题号一二三四五六七八班级题分102010812121315学号得分姓名阅卷人总分———————————————————————————————————本题得分一、选择题(选择正确答案,并将其代号写在题干后面的括号里.答案选错或未选全者,该题不得分.每小题1分，共10分)1、图1所示逻辑电路为()。(a)“与非”门(b)“与”门(c)“或”门(d)“或非”门图12、场效应管门电路如图2所示，该电

2、路为()。(a)“与非”门(b)“非”门(c)“或”门7图23、逻辑图和输入A，B的波形如图3所示，分析在t1时刻输出F为()。(a)“1”(b)“0”(c)任意图34、半加器的逻辑图如图4所示，指出它的逻辑式为()。(a)ABC=AB(b)B+AC=(c)ABC=图45、逻辑电路如图5所示，当A=“0”，B=“1”时，脉冲来到后触发器()。7(a)具有计数功能(b)保持原状态(c)置“0”(d)置“1”图56、某数/模转换器的输入为8位二进制数字信号（D7~D0)，输出为0~25.5V的模拟电压。若数字信号的最低位是“1”其余各位是“0”，则输出的模拟电压为()。(a)0.1V(

3、b)0.01V(c)0.001V7、逻辑式BC+ABC+C，化简后为()。(a)B+C(b)C+AB(c)C+BC8、如图6，二位二进制译码器的逻辑式为Y0=、Y1=A、Y2=B、Y3=BA，由逻辑式画出的逻辑电路为()。图69、引起组合电路中竞争与冒险的原因是（）(a)逻辑关系错(b)电路延时(c)干扰信号(d)电源不稳定710、欲将正弦波信号转换成与之频率相同的脉冲信号，应用（）(a)移位寄存器(b)A/D转换器(c)T触发器(d)施密特触发器本题得分二、填空题（每空1分，共20分）。1、如果对160个符号进行二进制编码，则至少需要位二进制数。2、A/D转换输出的二进制代码位数

4、越多，则量化误差转换精度。3、二进制码11101101表示的十进制为，相应的8421BCD码为。4、5个变量可构成个最小项，每个变量取值均为1可使个最小项的值为1。5、构造一个模6计数器需要个状态，个触发器。6、(DC)H=()B=()O=()D7、已知三个电路的输入信号均为Ui，且Ui与各电图7路输出电压U01、U02、U03的波形关系如图7所示。请将各电路名称填在下列空格中：电路1为；电路2为；电路3为。8、CMOS电路的结构特点是以MOS管作驱动管，以MOS管作负载管，以极作为输入端，以极作为输出端。9、一个5位地址码，8位输出的ROM，其存贮矩阵的容量为。本题得分三、判断改

5、错（下列命题你认为正确的在题后括号内打“√”，错误的打“×”。每小题1分，共10分）。（）1、组合电路没有记忆功能。（）2、JK触发器只有J、K端同时为1，则一定引起状态翻转。（）3、动态RAM必须进行周期性刷新。（）4、脉冲异步时序电路的输入信号既可以是脉冲又可以是电平。7（）5、ROM的与门阵列、或门阵列都是可编程的。（）6、已知，则。（）7、二进制并行加法器中，采用先行进位的目的是简化电路结构。（）8、TTL“或非门”，在使用时，将多余的输入端悬空。（）9、TTL“或非门”，在使用时，将多余的输入端通过一个电阻接工作电源。（）10、时序电路一定不要组合电路。本题得分四、逻辑电

6、路如图8所示，试写出逻辑式，并化简之。（8分）图8本题得分五、已知逻辑图和输入A，B，C的波形如图9所示，试画出输出和的波形。（12分）图9本题得分7六、已知逻辑电路如图10所示及C脉冲的波形，试画出各触发器输出，，的波形并写出它们的状态表（设，，初始状态均为“0”）。（12分）图10本题得分七、列出逻辑电路图11的状态表，写出输出F的逻辑式，画出输出，及F的波形图，计算F的脉宽和周期T（设C脉冲频率为1kHz，各触发器初始状态均为“0”，J0=K1=1）。（13分）图117CF012345本题得分八、某产品有A、B、C、D四项质量指标。规定：A必须满足要求，其它三项中只要有任意两

7、项满足要求，产品就算合格。试设计一个检验产品合格的逻辑电路，用与非实现。（15分）7