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时间:2019-05-10
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1、声明尸明本学位论文是我在导师的指导下取得的研究成果,尽我所知,在本学位论文中,除了加以标注和致谢的部分外,不包含其他人已经发表或公布过的研究成果,也不包含我为获得任何教育机构的学位或学历而使用过的材料。与我一同工作的同事对本学位论文做出的贡献均已在论文中作了明确的说明。≯l中年3月w日学位论文使用授权声明南京理工大学有权保存本学位论文的电子和纸质文档,可以借阅或上网公布本学位论文的部分或全部内容,可以向有关部门或机构送交并授权其保存、借阅或上网公布本学位论文的部分或全部内容。对于保密论文,按保密的
2、有关规定和程序处理。叫l牛年;月弦目硕士论文基于FPGA的通信信号信道化检测及参数估计摘要...煳近年来,随着无线电技术的迅猛发展,电子对抗的频带越来越宽,形式越来越复杂多变,传统的电子侦察接收机已经远远不能满足要求。于是,基于软件无线电构想的大动态范围、宽瞬时接收带宽、高灵敏度、高分辨率、多信号处理能力的数字信道化接收机应运而生。本文的主要研究内容有:分析了数字信道化的基本理论,针对信道化接收机相邻信道交界处有混叠的问题,推导了抗混叠信道化接收机结构,仿真试验和数据验证了该结构的可行性。研究了通
3、信信号的检测和参数估计的问题。为了提高检测性能,提出了适应本工程的恒虚警检测方案。深入研究了通信信号测频算法,推导了基于测相的频率估计算法,并使用CORDIC算法优化结构,仿真试验表明,该算法能够达到课题的性能指标。探索了通信信号信道化检测及其参数估计的FPGA实现方法,详细分析了实现过程中遇到的问题并给出了解决方案。详细介绍了本工程中各模块的实现结构,为工程实验结果再现提供便利。实现了FPGA与DSP高速互连通信。一方面使用DDR3实现了高速率数据的存储和读取,研究了多种DDR3的控制方法,并对
4、这些方法进行了比较和分析,提出了一些使用建议。另一方面使用RapidIO实现了FPGA与DSP高速数据传输,分析了IP核RapidIOv5.6的使用方法并在硬件上进行了实验,实验表明单路传输速率可以达到3.125Gbaud。关键词:抗混叠,数字信道化接收机,参数测量,FPGA,DDR3,RapidIOAbstract硕士论文Withtherapiddevelopmentofwirelesstechnologyrecentyears,仔equencybandofelectroniccounterme
5、asuresisbecomingmoreandmorewide,formsofelectroniccountermeasuresarebecomingmoreandmorecomplicated,thetraditionalelectronicreconnaissancereceiverhasbeenfarawayformOurdemands.So,thedigitalchannelizedreceiverbasedonsoftwareradioideawiththeabilityofmulti—
6、signalprocessing,largedynamicrange,wideinstantaneousreceivefrequencybandwidth,highsensitivityandhi曲resolutionarisesatthishistoricmoment.Themaincontentsofthispaperinclude:First,thebasictheoryofchannelizedreceveriSintroduced.Fortheproblemofthespectrumal
7、iasingbetweenadjacentchannels,anAnti—aliasingchannelizedreceiverstructureisinferred.Thesimulationtestanddatashowthatthisstructureisfeasible.Then,thedetectionandparameterestimationofcommunicationsignaliSdiscussed.Toimprovethedetectionperformance,aconst
8、antfalsealarmdetectionschemeadaptedtothisprojectisproposed.Specially,thefrequencymeasurementalgorithmofcommunicationsignalisstudiedindepth,whichisinferredbasedonphasemeasurementandoptimizedbyusingCORDICalgorithm.Simulationtestshowsthatthisalgo
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