（mpc83xx的datasheet中文翻译，绝对难找）第16章 通用串行总线接口2（usb）

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1、第16章通用串行总线接口本章介绍MPC8349E的通用串行总线接口（USB）。该接口支持许多工业标准。有关这些复杂的工业标准的说明已经超出了本文档的讨论范围，这些留待读者去参考官方规范。以下文档可以在USB实现论坛上找到，网址为：http：//www.usb.org/developers/docs/l通用串行总线规范，版本2.0lUSB2.0规范的On-The-Go补充规范，版本1.0a以下文档可以在IntelUSB规范网页上找到，网址为：http：//www.intel.com/technology/usb/spec.html通用

2、串行总线的增强型主机控制器接口规范，版本2.0lUSB2.0收发器宏单元接口规范（UTMI），版本1.05以下文档可以在ULPI网页上找到，网址为：http：//www.ulpi.org/lUTMI+规范，版本1.0lUTMI少引脚数接口（ULPI）规范，版本1.016.1绪论MPC8349E实现了两种USB模块，多端口主机（MPH）模块和双角色（DR）模块。这些模块能够连接一个或者二个外部端口。这些模块和外部端口总称为USB接口。USE接口如图16-1所示。图16-1USB接口结构图16.1.1概述MPH和DR模块是实现USB接口

3、的符合USB2.0的串行接口引擎。这两个模块的寄存器和数据结构均基于Intel公司的通用串行总线的增强型主机控制器接口规范。MPH模块可以充当一个或者二个USB端口的主机控制器。DR模块可以充当USB总线上的主机、外设、以及支持便携式On-The-Go（OTG)）可协商主机/外设。DR模块有必需的信令，用于USB收发器宏单元接口（UTMI）、或UTMI少引脚数接口（ULPI）收发器（PHYs）、或全速（FS）或低速（LS）串行接口。无论是ULPIPHY还是FS/LS串行接口，MPH模块中的每一个主机均为之提供必需的信令。每一个模块均

4、包含一系列直接存储器访问（DMA）引擎，这些引擎用来降低应用处理器的中断负载，并降低总的系统总线带宽。该带宽必须是专门服务USB接口要求的。16.1.2特性MPH模块包含下述特性：l支持USB2.0规范l可以作为单独的主机控制器工作n支持带有一个或者两个下行端口的USB根集线器n支持增强型主机控制器接口（EHCI）l支持高速（480Mbps）、全速（12Mbps）和低速（1.5Mbit/s）操作l支持具有ULPI和串口的外部PHYsDR模块包含下述特性：l符合USB修订版2.0规范l可以作为单独的主机控制器工作n支持增强型主机控制器

5、接口（EHCI）lUSB设备模式lUSBThe-Go模式，能作为主机使用l支持高速（480Mbps）、全速（12Mbps）和低速（1.5Mbit/s）操作l支持具有ULPI、UTMI和串口的外部PHYsl可以作为单独的USB设备工作n支持一个上行端口n支持6个可编程、双向USB端点。l主机模式支持和FS/LS设备的直接连接。16.1.3操作模式MPH模块提供多达2个USB2.0主机的功能。对于MPH模块，可以把每一个主机都配置成连接一个ULPIPHY或者一个串行FS/LS收发器。但是，当两个主机都被占用时，必须把它们配置成相同的PH

6、Y类型。任何没有用到的MPH主机端口都必须被挂起。DR模块有三个基本操作模式：主机、设备和OTG。可以把DR模块配置成使用UTMI、ULPI或者FS/LS串行收发器中的任何一种PHY接口。由于引脚的限制，UTMI接口只能用在设备操作模式。值得注意的是，设备模式下的DR模块不支持LS操作。总共支持八种USB模块和外部端口的配置方式，表16-1汇总了这些配置方式。表16-1外部端口配置配置号外部USB端口1外部USB端口2DR设备MPH主机01主机/设备/OTG，ULPI主机，ULPI2主机/设备，串行主机，串行3主机/设备/OTG，U

7、LPI主机，串行4主机/设备，串行主机，ULPIMPH主机1MPH主机05主机，ULPI主机，ULPI6主机，串行主机，串行DR设备7设备，UTMIDROTG（可协商主机/设备）8OTG，串行OTG16.2外部信号本节详细说明用于少引脚数的USB接口信号；PHY接口的许多信号都复用到相同的引脚。表16-2说明了所有可能模式下的USB接口的外部信号功能。后面几节将针对每种接口模式给出具体说明。注意，每个USB端口的MPH/DR选择是通过设置系统配置寄存器SICRL和SICRH实现的。更多的细节参看5.3.2.5节“系统I/O配置寄存器

8、低端（SICRL）”和5.3.2.6节“系统I/O配置寄存器高端（SICRH）”。注意，每个USB端口的操作ULPI/UTMI/串行操作模式是通过设置USBMPH/DR端口状态和控制寄存器（PORTSC1/PORTSC2）实现的。更多