candence数字仿真参数大全

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1、Candence数字仿真参数大全（Ncverilog，irun）=======================Ncverilog=====================================ncverilog+access+wrc+nctimescale+1ns/100ps+libext+.vospecify+incdir+$PATH+define+$urmicro+notimingcheck-l$urLogFile+nclibdirname+$urWorkDir-f$urFileListloadpli1=$urPliPath/li

2、bpli.so=======================Irun=========================================irun-64bit–l$LogFile–f$FileList+abcd+efgk=”efgk”+notimingcheck+delay_mode_distributed–access+RWC–timescale1ns/10ps–override_timescale-covfile$CovFile–covdesigncoverage–covtest$CovDataBaseName–covworkdir$CovPat

3、h-sysc–gcc_vers$GccVersion–scautoshellverilog===================================================================调试模式增加-gui–linedebug$CovFileset_branch_scoringselect_coverage–all$Design_top…set_com<屏蔽常数项>deselect_coverage–allmodule$ModuleName…<屏蔽Module>deselect_coverage–allinstance$Inst

4、anceName…<屏蔽instance>set_toggle_excludefile–bitexclude$CovExcludefile<按比特位屏蔽信号，支持通配符>$CovExcludefilemodule$ModuleName.$signalinstance$InstanceName.$signal==================================================================     我们知道，由于NC-Verilog使用了NativeCompileCode 的技术来加强电路模拟的效率，因此在进行模拟时必须

5、经过compile(ncvlog 命令）以及elaborate(ncelab命令）的步骤。编译之后，针对每一个HDL设计单元会产生中间表达。接着elaborate命令会建立整个电路的结构，产生可以用来模拟的资料。最后使用ncsim命令来进行模拟。 1、三命令模式(wolf评论：分步执行，了解即可，没有必要尝试！)    命令如下：    ncvlog-frun.f    ncealbtb-accesswrc    ncsimtb-gui第一个命令中，run.f是整个的RTL代码的列表，值得注意的是，我们需要把tb文件放在首位，这样可以避免出现提示timescale的错

6、误。第二个命令中，access选项是确定读取文件的权限。其中的tb是你的tb文件内的模块名字。第三个命令中，gui选项是加上图形界面值得注意的是，在这种模式下仿真，是用“ -”的。而下边要说的ncverilog是采用“ +”的。 2、单命令模式    ncverilog+access+wrcrtl+gui    在这里，各参数与三命令模式相同。注意“ +”。    在本文里将详细讲述ncverilog 的各种常用的参数，对于三命令模式，请读者自己查看资料。    +cdslib+...           设定你所仿真的库所在    +define+macro... 

7、    预编译宏的设定    +errormax+整数       当错误大于设定时退出仿真    +incdir+path         设定include的路径    +linedebug           允许在代码中设定linebreakpoint(wolf评论：可以与+gui结合，利用simvisiontrace代码！)    +log+logfile           输出到名为logfile的文件中    +status               显示内存和CPU的使用情况    +work               工作库