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1、杭电数字电子钟整点报时系统实验报告学长只能帮你到这了1.自主设计：1.1选题目的数字电子钟是一种用数字电路技术实现时、分、秒计时的装置，与机械钟相比具有更高的准确性和直观性，且具有无机械传动装置等特点，因此得到了广泛的使用。数字电子钟从原理上看是一种典型的数字电路，其中包括了组合逻辑电路和时序电路。设计与制做数字电子钟可以使我们了解数字电子钟的原理，并且学会制作数字电子钟。而且通过数字电子钟的制作进一步地了解各种在制作中用到的中小规模集成电路的作用及使用方法.且由于数字电子钟包括组合逻辑电路和时序电路.通过此次课程设计可以进一步学习与掌握各种组合逻辑电路与时序电路
2、的原理与使用方法。(为方便测试，实际电路只做分秒单元，电路改为分钟报时)1.2项目构思1.2.1设计任务和基本要求用中、小规模集成电路设计一台能显示分、秒的数字电子钟，基本要求如下：·各用2位数码管显示累计时间“分”、“秒”；·具有校时功能，可以分别对分及秒进行单独校时，使其校正到标准时间；·具有整点报时功能。要求整点前鸣叫五次低音（500Hz左右），整点时再鸣叫一次高音（1000Hz左右），共鸣叫6响，两次鸣叫间隔0.5S。1.2.2设计方案（系统简介）整个设计主要分为六个模块：分模块、秒模块、分频模块、校时模块、整点报时模块、译码显示模块。分、秒模块分别用两块
3、CD4029实现，并且分别将它们都设置为60进制。秒信号的产生，用石英晶体振荡器产生32768Hz的脉冲，经过整形、分频产生1Hz的秒脉冲。分频用CD4060分出2Hz的脉冲，再用CD4013分出1Hz的脉冲。将秒信号送入秒模块，每累计60秒发出一个分脉冲信号，分模块实现60分钟的累计，通过用74LS47实现的译码显示电路将时间在四个七段LED显示器中显示出来。整点报时电路根据计时系统的输出状态产生一脉冲信号，然后加上一个高频或低频信号送到蜂鸣器实现报时。校时电路是直接加一个脉冲信号到分计数器或者秒计数器来对“分”、“秒”显示数字进行校对调整。1.2.3原理框图数
4、字电子钟系统框图（实际报告不画小时单元）1.2.4各模块电路设计1．分频模块（秒信号发生器）这部分电路现有石英晶体振荡器产生32768Hz的脉冲，经过CD4060十四次分频后产生2Hz的脉冲。再经过CD4013产生1Hz的脉冲。原理比较简单。CD4060是十四位二进制计数器。它内部有十四级二分频器，有两个反相器G1、G2。R为高电平时，计数器清零且振荡器使用无效。在CP1下降沿，计数器以二进制计数。CP1(11脚)、CP0(10脚)分别为时钟输入、输出端。电源电压范围为3V～15V，输入电压范围为0V～VDD。它有十六个引脚，Q4～Q10、Q12～Q14为计数器输
5、出端。VDD接正电源，Vss接地。其引脚图如下所示：在CD4060的10、11脚之间接上一个32768Hz的晶体，就可以构成一个振荡器，其输出脉冲经过施密特整形电路整形后送入内部进行计数、分频，经214=16384分频，在输出端可得到2Hz（）的标准信号。再经一级CD4013组成的一级分频电路分频，即可得到秒脉冲信号。CD4013为双D触发器，在CP上升沿有效。其特性表如下：输入输出注CPDRDSDQn+1↑↑↓XXX01XXXX00001100010101Qn10不用同步置0同步置1保持异步置1异步置0不允许内部功能框图1.分模块、秒模块（60进制计数器）分模块
6、、秒模块为60进制计数器。60进制计数器可由两个计数器CD4029经过一定的方式连接组成的。一片CD4029用低位，另一片设计成六进制计数器做为高位。CD4029是由具有预进位功能的4位二进制或BCD码十进制加减计数器构成。PE为高电平时，J1～J4预置计数器为任何状态,为低电平时,对计数器清零。当CI和PE均为低电平时,在时钟上升沿计数器计数。CO一般为高电平,只有在加至最大或减至最小时,为低电平。计数器闲置时,CI端需与VSS相连,当B/D为高电平时,以二进制计数;反之,为十进制。U/D为高电平时,为加计数器;反之,为减计数器。故将“B／D”接低电平,将“U／
7、D”接高电平。将第一片CD4029计数器的进位输出CO连到第二片CD4029计数器的进位输入CI,可实现100进制的计数器。利用“反馈置零”的方法,当计数器输出“2Q3Q2Q1Q0、1Q3Q2Q1Qo=0110、0000”时，通过门电路形成一置数脉冲，使计数器归零,这样就实现了60进制计数器。60进制计数器1.译码显示模块译码器的逻辑功能是将每个输入的二进制代码译成对应的输出的高、低电平信号。常用于驱动LED七段数码管的译码器有74LS47。74LS47是BCD-7段数码管译码器/驱动器,74LS47的功能用于将BCD码转化成数码块中的数字,通过它解码,可以直接把
8、数字转换为
