ps2接口协议解析及应用

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1、ps/2接口标准的发展过程       随着计算机工业的发展，作为计算机最常用输入设备的键盘也日新月异。1981年IBM推出了IBMpc/XT键盘及其接口标准。该标准定义了83键，采用5脚DIN连接器和简单的串行协议。实际上，第一套键盘扫描码集并没有主机到键盘的命令。为此，1984年IBM推出了IBMAT键盘接口标准。该标准定义了84~101键，采用5脚DIN连接器和双向串行通讯协议，此协议依照第二套键盘扫描码集设有8个主机到键盘的命令。到了1987年，IBM又推出了ps/2键盘接口标准。该标准仍旧定义了84~101键，但是采用6脚mini-D

2、IN连接器，该连接器在封装上更小巧，仍然用双向串行通讯协议并且提供有可选择的第三套键盘扫描码集，同时支持17个主机到键盘的命令。现在，市面上的键盘都和ps/2及AT键盘兼容，只是功能不同而已。ps/2接口硬件 2.1物理连接器一般，具有五脚连接器的键盘称之为AT键盘，而具有六脚mini-DIN连接器的键盘则称之为ps/2键盘。其实这两种连接器都只有四个脚有意义。它们分别是Clock(时钟脚)、DATA(数据脚)、+5V(电源脚)和Ground(电源地)。在ps/2键盘与pc机的物理连接上只要保证这四根线一一对应就可以了。ps/2键盘靠pc的ps

3、/2端口提供+5V电源，另外两个脚Clock(时钟脚)和DATA(数据脚)都是集电极开路的，所以必须接大阻值的上拉电阻。它们平时保持高电平，有输出时才被拉到低电平，之后自动上浮到高电平。现在比较常用的连接器如图1所示。2.2电气特性ps/2通讯协议是一种双向同步串行通讯协议。通讯的两端通过Clock(时钟脚)同步，并通过DATA(数据脚)交换数据。任何一方如果想抑制另外一方通讯时，只需要把Clock(时钟脚)拉到低电平。如果是pc机和ps/2键盘间的通讯，则pc机必须做主机，也就是说，pc机可以抑制ps/2键盘发送数据，而ps/2键盘则不会抑制

4、pc机发送数据。一般两设备间传输数据的最大时钟频率是33kHz，大多数ps/2设备工作在10~20kHz。推荐值在15kHz左右，也就是说，Clock(时钟脚)高、低电平的持续时间都为40μs。每一数据帧包含11~12个位，具体含义如表1所列。表1数据帧格式说明1个起始位 总是逻辑08个数据位 （LSB）低位在前1个奇偶校验位 奇校验1个停止位 总是逻辑11个应答位 仅用在主机对设备的通讯中表中，如果数据位中1的个数为偶数，校验位就为1；如果数据位中1的个数为奇数，校验位就为0；总之，数据位中1的个数加上校验位中1的个数总为奇数，因此总进行奇校

5、验。2.3ps/2设备和pc机的通讯ps/2设备的Clock(时钟脚)和DATA(数据脚)　都是集电极开路的，平时都是高电平。当ps/2设备等待发送数据时，它首先检查Clock(时钟脚)以确认其是否为高电平。如果是低电平，则认为是pc机抑制了通讯，此时它必须缓冲需要发送的数据直到重新获得总线的控制权(一般ps/2键盘有16个字节的缓冲区，而ps/2鼠标只有一个缓冲区仅存储最后一个要发送的数据)。如果Clock(时钟脚)为高电平，ps/2设备便开始将数据发送到pc机。一般都是由ps/2设备产生时钟信号。发送时一般都是按照数据帧格式顺序发送。其中数

6、据位在Clock(时钟脚)为高电平时准备好，在Clock(时钟脚)的下降沿被pc机读入。ps/2设备到pc机的通讯时序如图2所示。当时钟频率为15kHz时，从Clock(时钟脚)的上升沿到数据位转变时间至少要5μｓ。数据变化到Clock(时钟脚)下降沿的时间至少也有5μｓ，但不能大于25μｓ，这是由ps/2通讯协议的时序规定的。如果时钟频率是其它值，参数的内容应稍作调整。上述讨论中传输的数据是指对特定键盘的编码或者对特定命令的编码。一般采用第二套扫描码集所规定的码值来编码。其中键盘码分为通码(make)和断码(Break)。通码是按键接通时所发

7、送的编码，用两位十六进制数来表示，断码通常是按键断开时所发送的编码，用四位十六进制数来表示。3ps/2接口的嵌入式软件编程方法ps/2设备主要用于产生同步时钟信号和读写数据。3．1ps/2向pc机发送一个字节 从ps/2向pc机发送一个字节可按照下面的步骤进行：(1)检测时钟线电平，如果时钟线为低，则延时50μｓ；(2)检测判断时钟信号是否为高，为高，则向下执行，为低，则转到(1)；(3)检测数据线是否为高，如果为高则继续执行，如果为低，则放弃发送(此时pc机在向ps/2设备发送数据，所以ps/2设备要转移到接收程序处接收数据)；(４)延时20

8、μｓ(如果此时正在发送起始位，则应延时４0μｓ)；(5)输出起始位(0)到数据线上。这里要注意的是：在送出每一位后都要检测时钟线，以确保pc机没有抑制