verilog基本电路设计指导书new

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1、绝密Verilog基本电路设计指导书请输入文档编号文档编号版本密级深圳市华为技术有限公司1.0内部公开研究管理部文档中心资源类别：HDL语言共56页Verilog基本电路设计指导书(仅供内部使用)拟制：VerilogGroup日期：2000/04/04批准：日期：yyyy/mm/dd批准：日期：yyyy/mm/dd深圳市华为技术有限公司版权所有不得复制2001/02/28版权所有，侵权必究第1页，共56页绝密Verilog基本电路设计指导书请输入文档编号修订记录日期修订版本描述作者2000/04/041.00初稿完成VerilogGroup2001/02/281.01修订，主要增加三态和一

2、些电路图苏文彪2001/02/28版权所有，侵权必究第2页，共56页绝密Verilog基本电路设计指导书请输入文档编号目录1前言52典型电路的设计52.1全加器的设计62.2数据通路62.2.1四选一的多路选择器62.2.2译码器72.2.3优先编码器82.3计数器92.4算术操作102.5逻辑操作102.6移位操作112.7时序器件122.7.1上升沿触发的触发器122.7.2带异步复位、上升沿触发的触发器122.7.3带异步置位、上升沿触发的触发器132.7.4带异步复位和置位、上升沿触发的触发器142.7.5带同步复位、上升沿触发的触发器152.7.6带同步置位、上升沿触发的触发器1

3、62.7.7带异步复位和时钟使能、上升沿触发的触发器162.7.8D-Latch（锁存器）172.8ALU182.9有限状态机（FSM）的设计202.9.1概述202.9.2One-hot编码232.9.3Binary编码262.10三态总线302.10.1三态buffer302.10.2双向I/Obuffer313常用电路设计313.1CRC校验码产生器的设计313.1.1概述313.1.2CRC校验码产生器的分析与硬件实现323.1.3并行CRC-16校验码产生器的VerilogHDL编码333.1.4串行CRC-16校验码产生器的VerilogHDL编码353.2随机数产生电路设计3

4、73.2.1概述372001/02/28版权所有，侵权必究第3页，共56页绝密Verilog基本电路设计指导书请输入文档编号3.2.2伪随机序列发生器的硬件实现373.2.38位伪随机序列发生器的VerilogHDL编码383.3双端口RAM仿真模型403.4同步FIFO的设计413.4.1功能描述413.4.2设计代码413.5异步FIFO设计443.5.1概述443.5.2设计代码442001/02/28版权所有，侵权必究第4页，共56页绝密Verilog基本电路设计指导书请输入文档编号Verilog基本电路设计指导书关键词：电路、摘要：本文列举了大量的基本电路的VerilogHDL代

5、码，使初学者能够迅速熟悉基本的HDL建模；同时也列举了一些常用电路的代码，作为设计者的指导。缩略语清单：对本文所用缩略语进行说明，要求提供每个缩略语的英文全名和中文解释。参考资料清单：请在表格中罗列本文档所引用的有关参考文献名称、作者、标题、编号、发布日期和出版单位等基本信息。参考资料清单名称作者编号发布日期查阅地点或渠出版单位（若道不为本公司发布的文献，请填写此列）ActelHDLNovember1997文档室Actel公司codingStyleGuide1前言当前业界的硬件描述语言中主要有VHDL和VerilogHDL。公司根据本身ASIC设计现有的特点、现状，主推VerilogHDL

6、语言，逐渐淡化VHDL语言，从而统一公司的ASIC/FPGA设计平台，简化流程。为使新员工在上岗培训中能迅速掌握ASIC/FPGA设计的基本技能，中研基础部ASIC设计中心开发了一系列的培训教材。该套HDL语言培训系列包括如下教程：《VerilogHDL入门教程》《VerilogHDL代码书写规范》《Verilog基本电路设计指导书》《TestBench编码技术》系列教材完成得较匆忙，本身尚有许多不完善的地方，同时，可能还需要其他知识方面的培训但没有形成培训教材，希望大家在培训过程中，多提宝贵意见，以便我们对它进行修改和完善2典型电路的设计2001/02/28版权所有，侵权必究第5页，共5

7、6页绝密Verilog基本电路设计指导书请输入文档编号在本章节中，主要讲述触发器、锁存器、多路选择器、解码器、编码器、饱和/非饱和计数器、FSM等常用基本电路的设计。如果你是初学者，我们建议你从典型电路学起，如果你已经非常熟悉电路设计，我们建议你从第3章看起。2.1全加器的设计/*********************************************************************Fi