dsp原理及应用李利第二版课后习题答案

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1、第1章1.简述DSP芯片的主要特点。答：哈佛结构；多总线结构；指令系统的流水线操作；专用的硬件乘法器；特殊的DSP指令；快速的指令周期；硬件配置强。2.请详细描述冯·诺曼依结构和哈佛结构，并比较它们的不同。答案在P6第一自然段。3.简述DSP系统的设计过程。答案依图1-3答之。4.在进行DSP系统设计时，如何选择合适的DSP芯片？答：芯片运算速度；芯片硬件资源；运算精度（字长）；开发工具；芯片的功耗；其他因素（封装形式、环境要求、供货周期、生命周期等）。5.TI公司的DSP产品目前有哪三大主流系列?各自应用领域是什么?答案在P8第二自然段。第2章一、填空题1.TMS320C54xDSP

2、中传送执行指令所需的地址需要用到PAB、CAB、DAB和EAB4条地址总线。P132.DSP的基本结构是采用哈佛结构，即程序和数据是分开的。3.TMS320C54xDSP采用改进的哈佛结构，围绕8条16位总线建立。P134.DSP的内部存储器类型可分为随机存取存储器(RAM)和只读存储器(ROM)。其中RAM又可以分为两种类型：双访问RAM,即DARAM和单访问RAM,即SARAM。P24-2.4节5.TMS320C54xDSP的内部总存储空间为192K字，分成3个可选择的存储空间：64K程序存储器空间、64K数据存储器空间和64KI/O存储空间。P23-2.4节6.TMS320C54

3、xDSP具有2个40位的累加器。7.溢出方式标志位OVM=1，运算溢出。若为正溢出，则ACC中的值为007FFFFFFFH。8.桶形移位器的移位数有三种表达方式：5位立即数；ST1中5位ASM域；暂存器T的低6位。9.DSP可以处理双16位或双精度算术运算，当C16=0为双精度运算方式，当C16=1为双16位运算方式。10.TMS320C54x系列DSP的CPU具有三个16位寄存器来作为CPU状态和控制寄存器，它们是：ST0、ST1和PMST。11.TMS320C54x：DSP软硬件复位中断号为0，中断向量为00H。12.TMS320C54xDSP主机接口HPI是8位并行口。引脚13.

4、TMS320C54xDSP的中断源中，中断号小者，中断级别最高。P2914.若PMST寄存器的值为01A0H(0000000110100000b)，中断矢量为INT3(60H)，则中断响应时，程序计数器指针PC的值为0000000111100000b。15.TMS320C54x有两个通用引脚，即BIO和XF，BIO输入引脚可用于监视外部接口器件的状态；XF输出引脚可以用于与外部接口器件的握手信号。P34-2.7节二、选择题1.以下控制位中，(B)用来决定程序空间是否使用内部RAM。A．MP/MCB．OVLYC．DROMD．SXM2.下列说法中错误的是(C)。P24A．每个DARAM块在

5、单周期内能被访问2次B．每个SARAM块在单周期内能被访问1次C．片内ROM主要存放固化程序和系数，只能作为程序空间D．DARAM和SARAM既可以被映射到数据存储空间，也可以映射到程序空间3.C54x进行32位长数据读操作时使用的数据总线是(C)p15表2-1A．CB和EBB．EB和DBC．CB和DBD．CB、DB和EB4.要使DSP能够响应某个可屏蔽中断，下面说法正确的是(B)。A．需要把状态寄存器STl的INTM位置1，且中断屏蔽寄存器IMR相应位置0B．需要把状态寄存器STl的INTM位置0，且中断屏蔽寄存器IMR相应位置1C．需要把状态寄存器STl的INTM位置1，且中断屏蔽

6、寄存器IMR相应位置1D．需要把状态寄存器STl的INTM位置0，且中断屏蔽寄存器IMR相应位置0三、简答题1.请描述TMS320C54x的总线结构。答：一条程序总线，三条数据总线，四条地址总线。程序总线PB传送从程序存储器来的指令代码和立即数；数据总线CB和DB传送从数据存储器读出的数据、数据总线EB传送写入到存储器中的数据。四组地址总线PAB、CAB、DAB、EAB传送执行指令所需地址，基本上是与PB、CB、DB、EB对应配套使用。2.写出提取B=0365434321中的指数值的指令，执行后T中的值为多少?3.TMS320C54x芯片的CPU包括哪些部分?其功能是什么?答案在p11

7、。4.TMS320C54x有几个状态和控制寄存器?它们的功能是什么?答：3个，ST0、ST1、PMST。ST0和ST1包括各种条件和工作方式的状态，PMST包括存储器配置状态和控制信息。5.TMS320C54x片内存储器一般包括哪些种类?如何配置TMS320C54x片内存储器。答：ROM、DARAM、SARAM三种。利用状态寄存器PMST的MP/MC位、DROM位和OVLY位配置片内存储器。P226.TMS320C54x片内外设主要有哪些?答案