abs-s信道解调芯片的测试策略及实现

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1、工学硕士学位论文ABS-S信道解调芯片的测试策略及实现王旭哈尔滨工业大学2007年12月国内图书分类号：TN47国际图书分类号：621.3.049.77工学硕士学位论文ABS-S信道解调芯片的测试策略及实现硕士研究生：王旭导师：张岩教授申请学位级别：工学硕士学科、专业：微电子学与固体电子学所在单位：深圳研究生院答辩日期：2007年12月授予学位单位：哈尔滨工业大学ClassifiedIndex：TN47U.D.C.:621.3.049.77DissertationfortheMasterDegreeofEngineeringIMPLEMENTATIONANDSTRATEGYOFT

2、ESTABS-SCHANNELDEMODULATORCHIPCandidate：Supervisor：AcademicDegreeAppliedfor：Specialty：DateofOralExamination：University：WangXuProf.ZhangYanMasterofEngineeringMicroelectronicsandSolid-StateElectronicsDecember,2007HarbinInstituteofTechnology哈尔滨工业大学工学硕士学位论文摘要ABS-S是我国第一个拥有自主知识产权的安全传输技术标准。该标准在信号接收性

3、能上明显优于目前国际通用的传输标准，而且该标准只有我国自己使用，与境外卫星的传输标准不兼容，这样就确保了卫星直播系统的安全性和稳定性。本文着重讨论ABS-S信道解调芯片在FPGA开发板上的原型测试和验证。ABS-S信道解调芯片的测试策略就是将被测芯片RTL代码和负责测试的RTL代码写入FPGA中，并将经过解调处理的输出数据保存到FPGA上的SRAM，当解调数据输出完毕后，再通过串口将SRAM中的数据发送到PC机保存为文本文件，与行为级模型的输出结果进行比较来验证解调芯片的正确性。为实现原型验证的功能和要求，需要对解调后的数据进行读、写和发送等多种操作。文中设计了操作解调输出数据的主

4、控制器、对寄存器组进行数据操作的控制器和对FPGA上的存储单元(SRAM)进行16位宽读写的控制器。由于要将解调后的数据发送到PC机，文中利用串口实现了FPGA与PC机的通信，设计了用于串口通信的简化UARTIP核。由于解调芯片模块工作时钟、验证模块工作时钟和串口通信模块工作时钟属于晶振倍频后的同步多时钟，我们还设计了多时钟信号同步模块。芯片原型测试平台可以对芯片整体RTL代码进行测试；也可以通过配置接口测试解调芯片中的任何关键模块。实践证明，解调芯片原型测试平台可以在20MHz到100MHz时钟范围内正常工作，串口发送的波特率可以根据时钟频率更改，本文采用的时钟频率是90MHz，

5、波特率为57600bit/s。文中最后介绍了综合的概念，给出ISE和DC综合分析报告。关键词先进卫星广播系统标准；可编程逻辑阵列；串口；波特率I哈尔滨工业大学工学硕士学位论文AbstractABS-Sisthefirstsatellitesecuritytransmissionstandardofournationwhoownitsintellectualpropertyrights.Thisstandardisobviouslysuperiortothepresentinternationaltransmissionstandardonsignalreceptivity,and

6、itisonlyusedinourcountry.Thetransmissionstandardwiththeexternalsatelliteisnotcompatible.Thestandardguaranteesbroadcastingsatellitesystematicsecurityandstability.ThisdissertationmainlydiscussestheimplementationandstrategyoftestandverificationofABS-Schanneldemodulatorchip.Thestrategyisthatwewrit

7、etheDUTandtestRTLcodeintoFPGA.WhenFPGAisrunning,wesavetheoutputdataintoSRAMonFPGAboard.Afterthetesthasfinished,wetransmitthedatainSRAMtoPCthroughRS-232serial.Thedatatransmittedwillcomparewiththebehaviorlevelresulttoverifythefunctionofth