大规模数字逻辑设计

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1、大规模数字逻辑课程设计题目：交通灯设计专业电信班级091学号学生姓名设计时间2011-2012学年上学期教师评分2011年10月29日7目录一、概述2二、程序代码2（1）主程序代码（led.v）2（2）分频器代码(clk_div.v)3三、SYMBOL图4四、原理图4五、管脚分配4六、原理5七、运行结果6八、心得体会6九、参考文献77一、概述当前，大量的信号灯电路正向着数字化、小功率、多样化、方便人、车、路三者关系的协调，多值化方向发展随着社会经济的发展，城市交通问题越来越引起人们的关注。，这些城市

2、纷纷修建城市高速道路，在高速道路建设完成的初期，它们也曾有效地改善了交通状况。然而，随着交通量的快速增长和缺乏对高速道路的系统研究和控制，高速道路没有充分发挥出预期的作用。而城市高速道路在构造上的特点，也决定了城市高速道路的交通状况必然受高速道路与普通道路耦合处交通状况的制约。人、车、路三者关系的协调，已成为交通管理部门需要解决的重要问题之一。城市交通控制系统是用于城市交通数据监测、交通信号灯控制与交通疏导的计算机综合管理系统，它是现代城市交通监控指挥系统中最重要的组成部分。这次课程设计的题目是交通

3、灯控制器的设计，设计了主干道的交叉路口交通信号灯无人自动管理的控制系统。将路口红绿灯的各种亮灯情况定义不同的状态,根据状态的不同实现红绿灯自动循环跳变。7二、程序代码主程序代码（led.v）moduleled(clk,p,led);inputclk;output[5:0]led;outputp;reg[5:0]led;regp;always@(posedgeclk)beginintegercount;p=p+1;count<=count+1;if(count<8)led<=6'b100010;els

4、eif(count<11)led<=6'b100001;elseif(count<18)led<=6'b010100;elseif(count<20)led<=6'b001100;elsecount<=0;endendmodule分频器代码(clk_div.v)//分频器部分，获得便于试验观察的时钟信号moduleclk_div(clk_out,clk_in);inputclk_in;outputclk_out;regclk_out;reg[25:0]counter;//50_000_000=101

5、1_1110_1011_1100_0010_0000_00parametercnt=50_000_000;///50MHzisthesysclk,50_000_000=2FAF080always@(posedgeclk_in)begincounter<=counter+1;7if(counter==cnt/2-1)beginclk_out<=!clk_out;counter<=0;endendendmodule三、symbol图7四、原理图五、管脚分配实体意义程序中的变量EFC35F484C7中的实

6、际分配闪烁时间东西红灯led[0]PIN_Y1310东西绿灯led[1]PIN_AA167东西黄灯led[2]PIN_U143南北红灯led[3]PIN_AA1710南北绿灯led[4]PIN_W157南北黄灯led[5]PIN_AA1837闪烁显示pPIN_W16隔一秒亮六、原理1.首先，南北红灯亮10秒；与此同时，东西绿灯亮7秒，后闪三次2.南北绿灯亮7秒，闪3次。东西红灯亮10秒。3.重复以上步骤七、运行结果实验和程序符合：八、心得体会由于没有多少用Verilog语言写程序的经验，所以在编程的

7、初期，很多方面都没有考虑到，比如说分模块、尽量少用输入输出等问题；分配引脚时却出现了非常多的警告，显示我的输入输出以及寄存器变量使用过多，无法一一对应地分配引脚。这是一次颇有收获的实训，7这次的实训中，我们更进一步体会到自主学习和团队合作的乐趣与必要性。为了完成项目，在网络上找到了许多相关资料，大大扩充自己的知识面，使许多以前想解决却无法解决的困难迎刃而解，这才知道老师的良苦用心。通过努力，完成了我的设计任务——用VHDL设计交通灯控制器。通过本次课程设计的学习，我深深的体会到设计课的重要性和目的性

8、所在。对传统软件工程设计流程有了更深刻的理解，掌握了QuatarsII软件的使用。此次实验，不仅仅是考查了我这学期的学习成果，而且让我跟进一步地了解了语言的理论学习与实际应用是有很大的差别的。所以，在以后的学习中，我们一定要将理论和实际联系起来，将理论用于实际中，这样才能真正地检验我们所学知识的情况。另一方面，此次试验也极大地锻炼了我发现问题、思考问题、分析问题以及解决问题的能力，逐步地加强了我科学认真的习惯，为我今后的学习和生活打下良好的基础。在此，感谢张老师的细心