stmf最少有个ad模数转换器

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1、STM32 ADC 采样 频率的确定   （4）16.7 可编程的通道采样时间ADC 使用若干个ADC_CLK 周期对输入电压采样，采样周期数目可以通过ADC_SMPR1 和ADC_SMPR2 寄存器中的SMP[2:0]位而更改。每个通道可以以不同的时间采样。总转换时间如下计算：TCONV = 采样时间+12.5 个周期例如：当ADCCLK=14MHz 和1.5 周期的采样时间TCONV = 1.5+12.5=14 周期 =1μs  SMPx[2:0]：选择通道x的采样时间这些位用于独立地选择每个通道的采样时间。在采样周期中通道选择位必须保持不变。000：1.5周期 100：41.5周期

2、001：7.5周期 101：55.5周期010：13.5周期 110：71.5周期011：28.5周期 111：239.5周期注：–ADC1的模拟输入通道16和通道17在芯片内部分别连到了温度传感器和VREFINT。–ADC2的模拟输入通道16和通道17在芯片内部连到了VSS。 2.     具体分析如下： （1）我们的输入信号是50Hz （周期为20ms），初步定为1周期200个采样点，（注：一周期最少采20个点，即采样率最少为1k），每2个采样点间隔为 20ms/200=100usADC可编程的通道采样时间我们选最小的 1.5 周期，则 ADC采样周期一周期大小为100us/1.5=

3、66us 。 ADC 时钟频率为 1/66us=15KHz。  ADC可编程的通道采样时间我们选71.5 周期，则 ADC采样周期一周期大小为（100us/71.5）。 ADC 时钟频率为 7.15MHz。 （2）接下来我们要确定系统时钟：我们用的是 8M Hz 的外部晶振做时钟源（HSE），估计得经过 PLL倍频 PLL 倍频系数分别为2的整数倍，最大72MHz。为了提高数据计算效率，我们把系统时钟定为72MHz，(PLL9倍频)。则 PCLK2=72MHz,PCLK1=36MHz； 我们通过设置时钟配置寄存器(RCC_CFGR) 中 有 为ADC 时钟提供一个专用的可编程预分器，将P

4、CLK28 分频后作为ADC 的时钟，则可知ADC 时钟频率为 9MHz        从手册可知： ADC 转换时间：STM32F103xx 增强型产品：ADC 时钟为56MHz 时为1μs(ADC 时钟为72MHz 为1.17μs)17/17 （3）由以上分析可知：不太对应，我们重新对以上中内容调整，提出如下两套方案： 方案一：我们的输入信号是50Hz （周期为20ms），初步定为1周期2500个采样点，（注：一周期最少采20个点，即采样率最少为1k），每2个采样点间隔为 20ms/2500=8usADC可编程的通道采样时间我们选71.5 周期，则 ADC采样周期一周期大小为8us/

5、71.5 。 ADC 时钟频率约为 9MHz。将PCLK2 8 分频后作为ADC 的时钟，则可知ADC 时钟频率为 9MHz 方案二：我们的输入信号是50Hz （周期为20ms），初步定为1周期1000个采样点，（注：一周期最少采20个点，即采样率最少为1k），每2个采样点间隔为 20ms/1000=20usADC可编程的通道采样时间我们选239.5周期，则 ADC采样周期一周期大小为20us/239.5 。 ADC 时钟频率约为 12MHz。将PCLK26 分频后作为ADC 的时钟，则可知ADC 时钟频率为 12MHzstm32f103最少有2个AD模数转换器，每个ADC都有18个通道

6、，可以测量16个外部和2个内部模拟量。最大转换频率为1Mhz，也就是转换时间为1us（在ADCCLK=14Mhz,采样周期为1.5个时钟周期时）。最大时钟超过14Mhz，将导致ADC转换准确度降低。stm32的ADC是12位精度的。stm32的ADC转换有两种通道，规则通道和注入通道，注入通道可以抢占式地打断规则通道的采样，执行注入通道采样后，再执行之前的规则通道采样，和中断类似。本例只使用规则通道实现独立模式的中断采样，这里不再赘述两种通道区别。stm32的ADC可以由外部事件触发(例如定时器捕获，EXTI线)和软件触发(即在配置相关寄存器时，直接开启采样）。17/17STM32的AD

7、C在单次转换模式下，只执行一次转换，该模式可以通过ADC_CR2寄存器的ADON位（只适用于规则通道）启动，也可以通过外部触发启动（适用于规则通道和注入通道），这是CONT位为0。以规则通道为例，一旦所选择的通道转换完成，转换结果将被存在ADC_DR寄存器，EOC（转换结束）标志将被置位，如果设置了EOCIE，则会产生中断。然后ADC将停止，直到下次启动。寄存器简介ADC控制寄存器（ADC_CR1和ADC_CR2）ADC_CR1的S