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1、询}j£if扭¥fXHUBEINORMALUNIVERSITYVerilog课程设计verilogCurriculumDesign所在院系教育信息与技术学院专业名称电了信息工程班级1005题目篮球30秒可控计数器的设计指导教师成员完成时间2012.6.12一、设计任务及要求:设计任务:篮球30秒可控计数器的设计要求:(1)具有30秒计时、显不功能。(2)设置外部操作开关,控制计时器的直接清零、装数、启动和暂停连续功能。(3)30s倒计时,其时间间隔为Is。(4)计时器递减计时到零时显示器不能灭灯,同时发出报警信号。(5)能解除报警信号。指导
2、教师签名:2012年6月12日二、指导教师评语:指导教师签名:2012年6月12口三、成绩验收盖章2012年6月12H篮球30秒可控计数器的设计摘要:随着技术的不断发展,EDA设计得到不断地发展和应用。本文以篮球30秒可控计数器为设计对象,根据运行规则和所需基本功能,采用层次化的设计方法,用ve珀log硕件描述语言实现篮球30秒计数器。内容主要涉及算法,控制器的硬件组成框架以及最后整个控制器的检测方案和仿真。本设计可以实现电梯运行所需的基本功能,并用modelsim进行了仿真。关键词:FPGA;VerilogHDL;1•设计要求与思路1.1
3、设计要求(1)具有30秒计吋、显示功能。(2)设置外部操作开关,控制计时器的直接清零、装数、启动和暂停连续功能。(3)30s倒计时,其时间间隔为Is。(4)计时器递减计时到零时显示器不能灭灯,同时发出报警信号。(5)能解除报警信号。1.2设计思路表一篮球30秒可控计数器的示意表模块状态对应信号倒计时间情况显示控制模块1rst=0载入倒计时信号30秒不暂停,不报警控制模块2rst=l,pause=l,t二1,continus二0倒计吋暂停不报警,暂停控制模块3rst二1,pause=0,t=0,continus=l倒计时暂停不报警,暂停控制模
4、块4rst二1,pause二1,t=0,continus=l暂停取消,倒计吋开始不报警显示模块1rst=l倒计时30秒不报警不暂停报警模块1rst=l倒计时30秒不报警报警模块2rst二0,cancel=0载入倒计时信号报警报警模块3rst二0,canccl二1载入倒计时信号不报警1・3系统设计框图本设计分三个模块,控制模块,显示模块和报警模块,用户在按下rst=l键后,开始从30秒倒计时,若中途按下pause=0,continus=l吋,计时器暂停,当到达00时,警报系统发岀响应,提示用户吋间已到,可进行下一轮计吋。其中脉冲发生部分的设计
5、,以elk为计吋脉冲加以分频屯路就可以得到1HZ的计吋脉冲,每隔一秒钟计数器减一,到零时发出报警信号。图3系统设计示意图1•详细模块设计2.1控制模块设计控制模块直接控制计数器的启动计数、暂停、连续计数功能。表2I/O管脚描述(一)名称方向位宽功能Clkinput1分频时钟信号(1HZ)RSTinput1复位信号(高电平有效)PAUSEinput1暂停信号CONTINUSinput1继续信号Toutput1控制信号2.2显示模块设计这里的显示模块,没有用到数码管。直接用if〜else语句输出数字,在仿真出的波形中,用a表示显示数字。在属性设
6、置中改为无符号(unsign)就可以转换成我们熟悉的十进制数。这与数码管中的属性设置是不同的。在篮球30秒倒计时中,显示模块是比较重要的。表3I/O管脚描述(二)名称方向位宽功能CLKinput1系统时钟RSTinput1复位信号(高电平有效)Aoutput5译码显示2.3报警模块设计根据设计要求,当倒计时结束时,要进行报警,而且灯还不能灭。报警一段时间后,报警信号又自动取消。这就需要一个取消信号(cancel),当cancel信号上升沿来临时,报警信号取消。从仿真波形上可以看得出來。倒计时的数字是不连续的,原因是,有暂停、继续信号的干扰,
7、所以,不像单一的数码管倒计时器,屮间没有停顿。表4I/O管脚描述(三)名称方向位宽功能CLKinput1系统时钟RSTinput1复位信号(高电平有效)Aoutput5译码显示1•功能仿真与测试(1)控制模块仿真波形如图4图4(2)显示模块仿真波形如图5图5(3)报警模块仿真波形如图64/tb_counter/dk01/tbjounter/rst1J/tb_counter/ancel11/tbjounter/alertsto(4)篮球30秒可控制计器综合仿真结果如图7'/tbjounter/dk'/tbjounter/rst'/tbjoun
8、ter/pause'/tbjounter/continus'/tbjounter/give//tbjounter/cancd/tbCter/t10111stoStl图5QUART
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