路定时抢答器说明书

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1、目录一、设计简介1.抢答器简介……………………………………22.功能简介………………………………………23.使用软件及参考资料………………………..3二、设计及芯片介绍1．设计思路框图……………………………….42．抢答电路设计……………………………….53．定时电路设计……………………………….65．使用芯片资料……………………………….76.设计中存在的问题…………………………197.仿真图………………………………………19三、材料清单………………………………….22四、总结……………………………………….23-22-一、设计简介1、抢答器

2、简介当今的社会竞争日益激烈，选拔人才，评选优胜，知识竞赛之类的活动愈加频繁，而在竞赛中往往分为几组参加，这时针对主持人提出的问题，如果要是让抢答者用举手等方法，这在某种程度上会因为主持人的主观误断造成比赛的不公平性。比赛中为了准确、公正、直观地判断出第一抢答者，这就要有一种抢答设备作为裁判员，这就必然离不开抢答器。抢答器是一种应用非常广泛的设备，在各种竞赛、抢答场合中，它能迅速、客观地分辨出最先获得发言权的选手。早期的抢答器只由几个三极管、可控硅、发光管等组成，能通过发光管的指示辩认出选手号码。现在大多数抢答器均使用单片机或数字集成电路，并增加

3、了许多新功能，如选手号码显示、抢按前或抢按后的计时、选手得分显示等功能。2、功能简介1.抢答组数为八组，序号分别为S1,S2,S3,S4,S5,S6,S7,S8，优先抢答者按动本组按键，组号立即显示在LED显示器上显示，同时封锁其他组的按键信号。2.系统设置外部清除键，按动清除键，LED显示器清零灭灯。3.数字抢答器定时为30S，启动开始键后，要求30S定时起开始工作，LED显示器计时。4.抢答者在30s内进行抢答，无抢答者，则本次抢答无效，系统短暂报警。-22-3、使用软件及参考资料使用软件：multisim12，MicrosoftWordS

4、tarter2010,EasyPaintToolSAI1.1.0,AdobeReader9参考文献：《数字电子技术基础》（高等教育出版社，第五版），《模拟电子技术》（高等教育出版社，第四版），《电子创新设计与实践》（国防工业出版社2005年版），百度百科-22-二、设计及芯片介绍1、设计思路框图抢答按钮译码显示译码电路锁存器优先编码电路控制电路主持人控制开关定时电路秒脉冲产生电路显示电路译码电路报警电路-22-2、抢答电路设计简介：当选手按动开关时，编码器74ls147将抢答选手的编号编码为2进制输入锁存器74ls373中，同时利用D触发器74

5、ls74和74ls373对输出的数据进行锁存，输出的数据通过计数器74ls192进入CD4511驱动数码管显示。当主持人闭合清零开关时，74ls192清零，数码管显示变为0。消隐级开关闭合时，CD4511消隐功能端为低电平，数码管不显示。-22-3、定时电路设计简介：当主持人打开清零开关，74ls160开始计数，CD4511驱动数码管计时，选手按下抢答开关，CD4511消隐端为低电平，数码管不显示数。-22-4、芯片介绍（1）、抢答电路部分①74ls14710线－4线优先编码器（BCD输出）简要说明：147将9条数据线（1－9）进行4线BCD编

6、码，即对最高位数据线进行译码。当1－9均为高电平时，编码输出（ABCD）为十进制零。故不需单设/IN0输入端。管脚图:真值表：-22-②74ls373八D锁存器(3S,锁存允许输入有回环特性)373的输出端O0~O7可直接与总线相连。当三态允许控制端OE为低电平时，O0~O7为正常逻辑状态，可用来驱动负载或总线。当OE为高电平时，O0~O7呈高阻态，即不驱动总线，也不为总线的负载，但锁存器内部的逻辑操作不受影响。当锁存允许端LE为高电平时，O随数据D而变。当LE为低电平时，O被锁存在已建立的数据电平。-22-引脚图：真值表：③74ls192十进

7、制同步加减计数器-22-管脚图：真值表：④CD4511七段译码器，数码管驱动器管脚图：-22-真值表：-22-⑤74ls74双上升沿D触发器（有预置、清除端）引脚图：真值表：⑥74ls00与非门引脚图：-22-⑦74ls04六反向器引脚图：-22-⑧74ls308输入与非门引脚图：⑨74ls260双5输入或非门引脚图：-22-（2）、定时电路部分①555定时器引脚图：NE555管脚功能介绍：1脚为地。2脚为触发输入端；3脚为输出端，输出的电平状态受触发器控制，而触发-22-器受上比较器6脚和下比较器2脚的控制。当触发器接受上比较器A1从R脚输入

8、的高电平时，触发器被置于复位状态，3脚输出低电平；2脚和6脚是互补的，2脚只对低电平起作用，高电平对它不起作用，即电压小于1Ucc/3，此时3脚输出高